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PIC: Blocos Timer, Capture/Compare/PWMe Interrupção
OBJETIVOS
 
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Compreender a operação dos três timer´s implementados no PIC;
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Compreender como funciona o bloco Capture/Compare/PWM;
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Compreender como os timer´s 1 e 2 estão associados com o bloco Capture/Compare/PWM;
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Utilizar as interrupções dos Timer´s e do bloco Capture/Compare/PWM para identificar eventos/gerar eventos;
TIMER 0
O módulo do Timer 0 possui as seguintes características:
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Contador/Timer de 8 bits;
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Registrador de contagem de escrita e leitura;
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Pré-escalonador (divisor de freqüência) programável;
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Utiliza sinal de clock interno ou externo;
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Gera interrupção quando a contagem muda de FF para 00;
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Permite selecionar o tipo de transição quando usa clock externo (Borda de subida oudescida).O modo de operação do Timer 0 é definido a partir do bit T0CS (bit 5 do Reg. OPTION). Nomodo timer, o Timer 0 incrementa a cada ciclo de instrução (sem pré-escalonador). Se ocorrer uma escrita no registrador TMR0, o incremento é inibido pelos dois ciclos de instrução seguintes.O modo de contagem é selecionado setando o bit T0CS. No modo de contagem , o Timer 0incrementará a cada subida ou descida do sinal no pino RA4/TOCKL. A borda é definida pelo bitT0SE (bit 4 do Reg. OPTION).
Interrupção do Timer 0
A interrupção TMR0 é gerada quando o registrador TMR0 estoura (overflow), conta de FF para00. Este overflow seta o bit T0IF (bit 2 do Reg. INTCON). A interrupção pode ser mascaradaresetando o bit T0IE (bit 5 do Reg. INTCON). O bit T0IF deve ser apagado por software (narotina de serviço de interrupção do Timer 0) antes de reabilitar a própria.
Pré-escalonador
 Há um único pré-escalonador que é compartilhado com o WatchDogTimer de forma mutuamenteexcludente (se o Timer 0 usa o pré-escalonador o WatchDog não pode usar e vice versa). Os bitsPSA e PS2:PS0 (bits 3 a 0 do Reg. OPTION) determinam o fator de escalonamento da freqüênciado sinal de clock do Timer 0. Quando atribuído ao Timer 0, todas as instruções que escrevem para o registrador TMR0 (CLRF 1, MOVWF 1, BSF 1,x...) apagarão o contador do pré-escalonador mas não alterarão a sua configuração.
 
 
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Registrador OPTIONRegistradores associados ao Timer 0
TIMER 1
O módulo Timer 1 é um timer/contador de 16 bits, dividido em dois registradores de 8 bits(TMR1H e TMR1L), que são de escrita e leitura. O par de registradores (TMR1H e TMR1L)incrementa de 0000h a FFFFh e retorna a 0000h (overflow). A interrupção TMR1, se habilitada,seta o bit de flag TMR1IF (bit 0 do Reg. PIRI) quando ocorre o overflow. Essa interrupção podeser habilitada/desabilitada setando/resentando, respectivamente, o bit de habilitação deinterrupção TMR1IE (bit 0 do Reg. PIE1).O Timer 1 pode operar de dois modos:
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Como timer: Neste modo o Timer 1 incrementa a cada ciclo de instrução;
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Como contador: Neste modo o Timer 1 incrementa a cada transição do sinal de clock externo.O modo de operação é determinado pelo bit de seleção de clock, TMR1CS (bit 1 do Reg.T1CON).
 
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O Timer 1 pode ser habilitado/desabilitado setando/resetando, respectivamente, o bit de controleTMR1ON (bit 0 do registrador). O Timer também possui um reset interno que pode ser gerado pelos módulos “Capture/Compare/PWM - CCP”. Quando o oscilador do Timer 1 está habilitado(T1OSCEN setado), os pinos RC1/T1OSI/CCP2 e RC0/T1OSO/T1CKL tornam-se entradasindependente do valor dos bits 1 e 0 do registrador TRIS, que são ignorados.
Resetando o Timer 1 usando uma saída de Trigger do módulo CCP
Se o módulo CCP1 ou CCP2 (este apenas no PIC 16F877) é configurado no modo de comparação para gerar um “special event trigger” (CCP1M3:CCP1M0 = 1011), esse sinal resetará o Timer 1. Nos casos em que uma escrita coincide com um “special event trigger” de CCP1 ou CCP2, aescrita terá precedência. Nesse modo de operação os registradores CCPRxH:CCPRxL tornam-seos registradores de período do Timer 1.
Pré-escalonador do Timer 1
O contador pré-escalonador é apagado quando são escritos valores para os registradores TMR1He TMR1L.Registrador de controle do Timer 1 – T1CON
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