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cours_vhdl(trés important)

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06/08/2013

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Modélisationde Systèmes Numériques IntégrésIntroduction à VHDL
Alain VachouxXemics S.A.alain.vachoux@xemics.chNotes de cours à option 2ème cycleHiver 1998-1999
 
 Modélisation de systèmes numériques intégrés iii© A.Vachoux, 1999
2.1. Flot de conception basé sur VHDL . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 232.2. Environnement de travail VHDL . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 252.3. Modèle sémantique de VHDL . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 272.4. Organisation d’un modèle VHDL . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 29Unités de conception . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 29Entité de conception . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 292.5. Modèles VHDL d’un registre 4 bits . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 31Déclaration d’entité . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 31Architecture comportementale . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 31Architecture structurelle . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 33Environnement de test . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 35Déclaration de configuration . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 37Instanciation directe . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 39Spécification de configuration . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 39Remarque . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 392.6. Modèles génériques . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 41Paramètres génériques . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 41Objets d’interface non contraints . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 43Instruction generate . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 452.7. Concurrence et modélisation du temps . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 47Processus et signaux . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 47Initialisation et cycle de simulation . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 49lai delta . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 51Délai inertiel . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 53Délai transport . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 53Transactions multiples . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 55Signaux résolus . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 572.8. VHDL pour la synthèse . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 59Types (et sous-types) supportés . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 59Objets supportés . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 61Valeurs initiales . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 65Opérateurs . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 65Groupement d’opérateurs . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 67Partage de ressources . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 67Utilisation de processus et de l’instruction wait . . . . . . . . . . . . . . . . . . . . . . . . . . 71Instructions séquentielles supportées . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 73
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