Adec - Cap 4

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###################ARQUITECTURA DE COMPUTADORAS CAPITULO IV UNIDAD DE
ENTRADA/S ALIDAAO 2012IV .1 - INTRODUCCIN:
Las unidades de
entrada y de salida, que a veces se agrupan en una sola, denominada unidad de
entrada/salida, canal de e/s o mdulo para el intercambio de informacin, tiene
o tienen la misin de conectar los mdulos de la mquina con los dispositivos
externos de la misma, denominados PERIFRICOS .
Podemos preguntarnos porqu
no se conectan los perifricos directamente al bus del sistema, y as nos
evitamos una serie de problemas. En mquinas muy pequeas, evidentemente as se
lo hace, pero los perifricos que pueden ser as conectados deben tener un alto
grado de inteligencia, y no todos permiten una operacin de este tipo, sino que
en general, si bien poseen cierta lgica de control, son conducidos de diversas
maneras, poseen diferentes longitudes de palabra y diferentes formatos de datos.
Por otra parte, la velocidad de los perifricos es mucho menor que
la del procesador, por tanto es necesario interponer algn tipo de amortiguador
(buffer) que contenga los datos el tiempo necesario para que ellos los acepten.
Entonces, se requiere siempre un mdulo de E/S , que tiene dos
funciones primordiales:- Interconectar la UCP y la memoria externa va los buses
del sistema o va un conmutador central.- Interconectar varios dispositivos
perifricos mediante enlaces de
datos "hechos a medida".
Por
lo tanto, es razonable estudiar un poco el funcionamiento de los perifricos,
para despus pasar a la estructura y funcionamiento del mdulo de E/S .
En
la figura I.23, tenemos el esquema general del mdulo de E/S , que en caso de
pequeas mquinas puede convertirse en el esquema de la figura IV .1.
La
principal diferencie entre ambos, es que en el segundo se suponen que la memoria
central es externa al procesados, y est conectada a los buses de la UCP
mediante el mdulo de E/S . En el primer caso en cambio, se supone que la memoria
es interna al computador, y los mdulos de entrada y de salida son los que
conectan a todo el computador con el mundo externo a l, entendiendo que la
memoria central forma parte integrante del mismo.IV .2 - DIS POS ITIV OS EXTERNOS :
Ya dijimos que tambin son denominados perifricos, y conforman toda
una plyade de equipos para entrada o salida de informacin, entre otros podemos
citar:- unidades de discos rgidos- unidades de discos flexibles- unidades de
discos pticos- unidades de cinta magntica- impresoras- escaneadoresgraficadores- pantallas- sensores - actuadores- modems- sistemas de audiosistemas de video- sistemas para interconexin a redes
Dispositivos
estos que pueden clasificarse en cinco grupos:- memorias de masa (discos,
disquettes, cintas)- lebles por el hombre (pantallas, impresoras)- lebles por
la mquina (escaneadores, sensores)- comunicaciones (modems, sistemas para
redes)- accionamientos (actuadores, graficadores)
En la figura IV .2,
tenemos el diagrama genrico de un perifrico, en el cual, los bloques indicados
corresponden a:-S eales de Estado: indican el estado del
dispositivo
(LIS TO, OCUPADO, DES CONECTADO)-S eales de Control: determinan la funcin que el
perifrico debe desempear (LEER, ES CRIBIR, TRANS MITIR, RECIBIR)-Lgica de
Control: controla la actuacin del dispositivo de acuerdo con las indicaciones
dadas.-Trasductor: convierte los datos tanto a la forma de energa necesaria
para el dispositivo, como en tamao y/o formato. Lleva asociado el buffer para
poder almacenar los datos durante el tiempo necesario para realizar su funcin.
IV .2.1 - TECLADOS Y MONITORES :
El modo de interaccin ms comn entre
el hombre y la mquina, es la combinacin teclado-monitor. El operador provee
una entrada oprimiendo las teclas, lo que provoca una salida desde el teclado en
forma de seales elctricas en cdigo AS CII o CCITT Alfabeto Internacional n 5
(Comit Consultatif Intrernationale de Tlgraphie et Tlphonie - Comit Asesor
Internacional de Telegrafa y Telefona que actualmente ha cambiado a la
denominacin UIC, o Unin Internacional de Comunicaciones) donde cada caracter
est representado por un conjunto de 7 bits (8 cuando se considera el bit de
paridad), lo que posibilita representar 128 caracteres distintos.#Figura IV .1 Mdulo de entrada/salida.
Estos caracteres son de dos tipos,
imprimibles y de control, los primeros a su vez son los alfabticos, numricos,

de puntuacin y especiales y pueden ser representados en una pantalla. Los
caracteres de control permiten el ordenamiento de los imprimibles en renglones,
pginas etc. as como para su transmisin.
La seal elctrica es
interpretada por un codificador incorporado al teclado, y entregada a la mquina
a travs de la unidad de entrada. En la misma, el caracter puede ser almacenado
en el mismo cdigo AS CII, y cuando es entregado mediante la unidad de salida, el
transductor del dispositivo convierte las seales electrnicas al formato
requerido por el para su presentacin o almacenamiento.
Existe una
amplia variedad de teclados, pueden tener desde unas 15 o 20 hasta ms de cien
pulsadores, dispuestos en la forma convencional de una mquina de escribir, la
distribucin de los mismos y los caracteres que codifican pueden variar de pas
en pas. El utilizado por nosotros es denominado qwerty por las primeras seis
letras de la primera fila de letras.
El principio de funcionamiento de
cada pulsador puede ser de diferente ndole, los hay por contactos, por
variacin de capacidad, por variacin de reluctancia y por variacin de
resistencia.#Figura IV .2 - Dispositivo externo.
En cuanto respecta a las
pantallas de video, tambin existe una amplia variedad, pudiendo ser
monocromticas o policromticas, con barrido simple o entrelazado y con tamaos
que van desde las 12 pulgadas en adelante. Los ms empleados actualmente son los
monitores color, con barrido entrelazado, de 15 pulgadas de dimetro y un paso
de punto de 0,28 mm.
El paso de punto es la separacin que hay entre
los centros de dos puntos sucesivos en la pantalla, lo cual tambin indica el
tamao (dimetro) de cada punto.
Otro factor a tener en cuenta es la
definicin del sistema grfico, lo cual es una asociacin del paso de punto con
la cantidad de puntos que puede almacenar la memoria de pantalla. En general,
para un sistema color de 256 colores, y una memoria de pantalla de 1 Megabyte,
se tiene una resolucin de 1024 x 768 pixel. Un pixel es el punto mnimo
direccionable y representable en pantalla.
Para sistemas grficos, se
utilizan pantallas de mayores dimensiones, de 17, 19, 21 y hasta 23 pulgadas de
dimetro, con paso de punto de 0,27 mm, barrido no entrelazado, y placas de
IV deo tipo 3D, con memorias superiores a 8 Megabytes.
En los ltimos
tiempos se han desarrollado pantallas de cristal lquido, tambin monocromticas
o policromticas, que son de muy bajo consumo, y elevado brillo. Estas pueden
ser iluminadas de dos maneras, o mediante lmparas de descarga gaseosa (tubos
fluorescentes) o mediante LEDs, o sea diodos emisores de luz,
que son ms
brillantes y de menor consumo y ms duracin.V .2.2 - DRIV ERS DE DIS COS :
Como tercer elemento infaltable en toda computadora, estn los discos,
tanto el rgido como por lo menos uno flexible, anque estos ya han sido
desplazados por los discos pticos compactos y los DV D o sea los discos
digitales verstiles. S u mecanismo de arrastre y lectura/escritura, es conocido
como drive. El drive contiene toda la electrnica necesaria para el control, el
intercambio de datos y la emisin de seales de estado, ms los mecanismos
elctricos necesarios no solo para hacer girar el disco, sino tambin para mover
las cabezas de lectura/escritura.
El transductor en este caso es capaz
de convertir las seales elctricas binarias, representativas de cada bit, en
pulsos de corriente aptos para excitar las cabezas durante la escritura, y
adems para convertir las seales ledas en cdigos binarios.V .3 - MODULOS DE
ENTRADA/S ALIDA:
Ya dijimos al comienzo que un mdulo de entrada/salida
es la entidad que dentro de una computadora, es responsable del intercambio de
datos con los perifricos. Estos mdulos tambin pueden tener una interfase
interna, hacia el resto de la mquina, y una o varias interfaces externas,
dirigidas a distintos dispositivos.V .3.1 - FUNCIONES DE LOS MDULOS DE E/S .
Las principales funciones caen dentro de las siguientes categoras:
Control y Atiempamiento - Comunicacin con la UCP
- Comunicacin con los
perifricos - Almacenamiento y adecuacin de datos. - Deteccin de errores
En cualquier momento la UCP puede comunicarse con uno o mas perifricos,
de forma no predecible, dependiendo de las necesidades de E/S que tenga el
programa. Los recursos internos, tales como memoria principal y bus del sistema,
pueden ser compartidos entre un gran nmero de actividades, incluyendo
entrada/salida de datos. Adems la entrada/salida de datos incluye
requerimientos de atiempamiento y control, para coordinar el trfico entre las
fuentes internas y los dispositivos externos.
Por ejemplo, el control de
la transferencia de datos desde un perifrico a la UPC necesita de la
realizacin de los siguientes

pasos:1 - La UCP interroga al mdulo de E/S para
averiguar el estado del dispositivo externo.2 - El mdulo responde entregando su
estado.3 - S i el dispositivo est operacional y
preparado
para transmitir, la UCP solicita la transferencia de datos, mediante un comando
dado al mdulo de E/S .4 - El mdulo obtiene una unidad de datos (una
palabra) del perifrico.5 - Los datos son transferidos desde el mdulo de
E/S a la UCP.
S i el sistema emplea un bus, cada una de las
transacciones entre la UCP y el mdulo de E/S necesita la realizacin de uno o
ms arbitrajes del mismo.
Este listado simplificado de eventos,
tambin ilustra sobre la necesidad que tiene la unidad de E/S , de poseer la
capacidad de acoplar comunicaciones entre la UCP y el dispositivo externo. Las
comunicaciones de la UCP con el perifrico necesitan:- Decodificacin de
comandos: el mdulo de E/S acepta los comandos de la UCP, comandos que son
enviados por el bus de control. Por ejemplo, para un drive de discos, se
necesitan los siguientes comandos: LEER S ECTOR, ES CRIBIR S ECTOR, BUS CAR NMERO
DE PIS TA, Y BARRER LA IDENTIFICACIN DE LA GRABACIN. - Datos: Los datos son
intercambiados entre la UCP y el mdulo de E/S , por medio del bus de datos.Reporte de Estados: Debido a que los perifricos son bastante lentos, es
importante conocer el estado del mdulo de E/S . Por ejemplo, si se le solicita a
un mdulo de E/S que enve un dato a la UCP, este puede no estar listo para su
transmisin, por cuanto todava est trabajando sobre un pedido anterior. Esto
es reportado mediante una seal de estado. Las seales de estado ms comunes
son: OCUPADO y LIS TO, pero puede haber otras para indicar varias condiciones de
error.- Reconocimiento de la direccin: Dado que toda palabra tiene su
direccin en memoria, y lo mismo ocurre con cada perifrico, el mdulo de E/S
deber reconocer una nica direccin para cada perifrico que controle.
Por otra parte, el mdulo de E/S debe ser capaz de de llevar a cabo
todas las "comunicaciones con el dispositivo" que incluyen comandos,
informacin de estado, y datos.
Una tarea esencial del mdulo de E/S ,
es el "tamponamiento de datos". Lo cual es evidente al observar la tabla
siguiente, y que es debido a la diferente velocidad de transferencia entre el
interior y el exterior de la mquina.
Finalmente, el mdulo de E/S es
responsable de "detectar errores" y el subsiguiente aviso de los mismos la UCP.
Algunos de estos errores pueden deberse a fallas mecnicas o elctricas,
reportadas por el perifrico (pista daada en el disco, atascamiento del papel
en la impresora, etc)
Otras clases de consiste en el cambio no
intencional del patrn de bits, durante la transmisin, los que pueden ser
detectados, por ejemplo, por un control de paridad.DIS POS ITIV O#ACCION# AS OCIADO
A# V ELOCIDAD
(Kbytes/seg)##Teclado#Entrada#Humano#0,01##Ratn#Entrada#Humano#0,02##Entrada
por voz#Entrada#Humano#0,02##S canner#Entrada#Humano#200.00##S alida por
voz#S alida#Humano#0,6##Impresora de Lnea#S alida#Humano#1.00##Impresora
Lser#S alida#Humano#100.00##Presentacin Grfica#S alida#Humano#30.00##UCP a
Buffer de S alida#S alida#Humano#200.00##Terminal de Red#Entrada o
S alida#Mquina#0,05##Red a LAN#Entrada o S alida#Mquina#200.00##Disco
ptico#Almacenamiento#Mquina#500.00##Cinta
Magntica#Almacenamiento#Mquina#2000.00##Disco
Magntico#Almacenamiento#Mquina#2000.00##
IV .3.2 - ES TRUCTURA DEL MDULO DE
E/S :
La Unidades de Entrada y de S alida, o el mdulo de E/S , varan mucho
en complejidad, as como tambin es variable la cantidad de perifricos
conectados, por lo que solo tratar de hacer una descripcin general. En la
figura IV .3, se tiene un diagrama de bloques que responde a lo indicado.
El mdulo se conecta con el resto de la mquina mediante un conjunto de
lneas de seales (por ejemplo el bus del sistema). Los datos transferidos desde
y hacia el mismo, son soportados por varios registros buffer. Tambin puede
haber uno o varios registros de estados, que proveen la informacin del estado
actual.
El/los registros de estados, tambin pueden funcionar como
registros de control, pues puede aceptar una detallada informacin de control
remitida por la UCP.
La lgica interna del mdulo interacta con la UCP
mediante un conjunto de lneas de control. Estas seales de control pueden se
utilizadas por el mismo mdulo, o puede servir para direccionar dispositivos
externos, para lo cual el mdulo deber reconocer y generar las direcciones
correspondientes.
Finalmente, cada mdulo debe contener la lgica
especifica para interconectarse con cada dispositivo que el controla.

Algunas de estas unidades de E/S , funcionan en modo tal que la UCP
prescinde del tipo de dispositivo conectado, de sus seales elctricas o
componentes mecnicos, y an de su funcionamiento, como para remitir solamente
seales de lectura y escritura, por lo cual puede acelerar su velocidad de
operacin.
Tal mdulo, es conocido ms bien como procesador de E/S , dado
que se hace cargo de la mayor parte de las tareas de ese tipo. El ms simple y
primitivo, en cambio es el que controla un solo dispositivo, y es conocido como
controlador de E/S , o controlador de dispositivos.
El primero se utiliza
en grandes computadores, mientras que el segundo es tpico de las
microcomputadoras.IV .4 - ENTRADAS Y S ALIDAS PROGRAMADAS :
Hay tres
tcnicas posibles para realizar las operaciones de E/S :- Entrada/S alida
Programada: La UCP ejecuta un programa que le otorga el control total de la
operacin, incluyendo el sensado del estado del dispositivo, enviar un comando
de lectura o escritura, y transferir los datos. Este mtodo es el que menos se
aplica, por ser un derrochador del tiempo de la UCP, que no puede hacer ninguna
otra operacin durante esta ejecucin.- Entrada/S alida manejada por
interrupciones: Aqu la UCP entrega un comando para ejecutar una operacin de
E/S , y continua ejecutando las restantes instrucciones del programa. Una vez
terminado el mismo, y el mdulo de E/S ha realizado su trabajo
previo, la UCP
se encargar de entregarle los datos, o de recibirlos y almacenarlos.Entrada/S alida por Acceso Directo a Memoria: S uele referirse a ste mtodo como
el DMA (Direct Memory Access). En este caso, la memoria y el mdulo de E/S
intercambian datos, sin intervencin de la UCP.#Figura IV .3 - Diagrama de
bloques de un mdulo de E/S .IV .4.1 - LINEAMIENTOS GENERALES :
Mientras
la UCP est corriendo un programa y encuentra una instruccin relativa a la E/S ,
la ejecuta enviando un comando al mdulo de E/S adecuado. Con E/S programadas,
el mdulo puede llevar a cabo la accin requerida y dispone los bits adecuados
en el registro de estados. El mdulo no toma acciones que avisen a la UPC, en
particular no la interrumpe, por tanto la responsabilidad a cargo de sta, es la
de controlar peridicamente el estado del mdulo de E/S , hasta que se asegure de
la finalizacin de la operacin.
La figura IV .4.a, muestra el diagrama
de flujo de la aplicacin de una operacin de E/S programada, para leer un
bloque de datos desde un perifrico, tal como una cinta magntica, y pasarlo a
la memoria.
Los datos son ledos de una palabra (por ejemplo 16 bits) por
vez, y por cada lectura, la UCP debe quedar en un ciclo de prueba del estado,
hasta que reciba la seal que los datos pueden ser tomados en el registro
correspondiente del mdulo de E/S , este diagrama muestra claramente la prdida
de tiempo que implica este tipo de transferencia para la UCP.IV .4.3 INS TRUCCIONES DE E/S :
Con la E/S programada, hay una fuerte
correspondencia entre la instruccin relativa a la E/S que la UCP ha recibido de
la memoria, y los comandos de E/S que la misma UCP entrega a un mdulo de E/S a
fin de ejecutar la instruccin. En consecuencia la instruccin es fcilmente
traducida a comandos, a veces en forma tan simple como una relacin uno a uno, o
sea que cada bit de la instruccin significa un comando especfico. El formato
de la instruccin depende del modo en el cual son direccionados los perifricos.
# Figura IV .4 - Diagrama de flujo de tres tcnicas para la entrada de un bloque
de datos.
Normalmente hay varios dispositivos de E/S conectados al
sistema mediante mdulos de E/S . Cada dispositivo es direccionado mediante un
nico identificador, que es contenido en el comando remitido por la UCP. En
consecuencia, los mdulos deben interpretar las lneas de direccin para
determinar a quien corresponde ese comando.
Cuando la UCP, la memoria
principal y la E/S comparten el mismo bus, hay dos modos posibles de
direccionamiento, por mapeo de memoria y aislado.
1 - Direccionamiento de e/s
por mapeo de memoria: en este caso existe un solo espacio de direcciones tanto
para las locaciones de memoria como para los dispositivos de E/S , por lo que la
UCP considera como posiciones de memoria los registros de estados y de datos de
los mdulos de E/S , utilizando las mismas instrucciones de mquina para acceder
a ellos que a las posiciones de memoria. Consecuentemente un bus de direcciones
de 10 lneas, es capaz de direccionar 1.024 posiciones, combinando as memoria
con dispositivos de E/S . Con ste tipo de direccionamiento, se necesita una
sola lnea de lectura escritura.
2 - Direccionamiento de E/S aislado: S i a
la lnea de lectura y escritura se le agrega otra para seleccionar la memoria
interna o el dispositivos de E/S , en un sistema de 10 lneas de direccin,
quedarn las 1.024 posibilidades tanto para direccionar la memoria central, como
para dispositivos externos. Es as que resulta aislado el espacio de
direccionamiento de E/S del correspondiente al de la memoria, de all el nombre.
En general en ste caso se recurre a registros que son los que conectan
directamente al dispositivo externo.En la figura IV .5, tenemos contrastadas
ambas tcnicas, en la parte a, vemos como aparece el sistema mapeado para un
programador, y para un simple dispositivo deentrada, tal como un teclado.
S uponiendo el mismo sistema de 10 lneas de direccin, con 512 locaciones de
memoria de 1 bit (0-511) y hasta 512 direcciones para dispositivos de E/S (5121023). Dos de ellas son dedicadas a la entrada del teclado. La 516 se refiere al
registro de datos y la 517 al registro de estados, el que tambin funciona como
registro de control para la recepcin de comandos de la UPC. El programa
mostrado debe leer un byte de datos proveniente del teclado y con destino un
registro acumulador de la UPC. Notemos que sta permanece en un lazo hasta que
el dato est disponible.
Con el direccionamiento aislado, parte b de
la misma figura, los puertos de E/S solo son accesibles mediante comandos
especiales, que activan las lneas de comando del bus.
Para diversos
tipos de UPC, hay un gran conjunto de instrucciones diferentes para referenciar
la memoria, si se utiliza el direccionamiento aislado, solo habrn unas pocas
instrucciones. En consecuencia, la ventaja de los sistemas mapeados es que puede
utilizarse un largo repertorio de instrucciones, permitiendo una programacin
ms eficiente. La desventaja, es que se usa un espacio de direcciones grande en
memoria. Ambos sistemas son de uso comn.IV .5 - ENTRADA/S ALIDA POR INTERRUPCIN:
El inconveniente de la E/S programada, es el tiempo que pierde la
UPC, lo cual disminuye la performance de todo el equipo.
Una
alternativa es que sta, luego de enviar los comandos para una E/S , siga
operando hasta que reciba un aviso de que la unidad direccionada est lista para
realizar el intercambio solicitado.#
DIRECCION#
INS TRUCCION# OPERANDO#
COMENTARIO##
200#
CARGAR AC#
"1"###
#ALMACENAR AC#
517#INICIAR LECTURA TECLADO##
202#
CARGAR AC#
517#OBTENER BYTE DE ES TADO### RAMIFICAR S I
<S IGNO> = 0#
202#HACER LAZO DES PUS DE LEER###
CARGAR AC#
516#CARGAR EL BYTE DE
DATOS ##
a) E/S por mapeo de memoria. DIRECCIN#
INS TRUCCIN# OPERANDO#
COMENTARIO##
200#COMENZAR E/S #
5#INICIAR LECTURA TECLADO##
201#PROBAR E/S #
5#CONTROLAR
TERMINACIN##
#RAMIFICACIN NO PREPARADA#
201
#HACER LAZO
DES PUS DE LEER###ENTRADA#
5#CARGAR EL BYTE DE DATOS ##
b) E/S aislada.Figura IV .5 - E/S por memoria mapeada y E/S aislada.
Esto funciona as: Desde el punto de vista del mdulo de E/S ,
el ha recibido un comando de LEER de parte de la UCP, por lo que proceder a la
lectura del dato en el perifrico direccionado. Una vez que el dato est en
registro de datos del mdulo, sgte enva una seal a la UCP (interrupcin), por
una lnea de control, y espera hasta que el dato le sea requerido.
Cuando la UCP realiza el requerimiento, el mdulo le entrega el dato en
bus de datos, y queda a la espera de una nueva operacin.
Desde el punto
de vista de la UCP, el proceso es como sigue: la UCP entrega un comando de
Lectura, y sigue con la ejecucin de ese u otro/s programa/s. Al final de cada
ciclo de instruccin, controla la presencia de interrupciones, cuando encuentre
una, la UCP guardar el contexto (o sea los contenidos del contador de programa
(CP) y de sus registros) correspondientes al programa en ejecucin, y pasa a
procesar la interrupcin.
En nuestro caso, la UCP leer el contenido
del bus de datos y lo almacenar en la memoria. Luego proceder a restaurar el
contexto del programa en el que estaba trabajando, o de algn otro, y reasume su
ejecucin.
En la figura IV .5.b, se muestra el uso de una interrupcin de
E/S para leer un bloque de datos. En comparacin con lo mostrado en la figura
IV .5.a, la interrupcin acta ms eficientemente que la E/S programada, debido a
que elimina las demoras por espera. Pero sin embargo, el procedimiento tambin
insume una gran cantidad de tiempo, por cuanto cada palabra dato debe pasar por
la UCP en su camino desde la unidad de entrada hasta la memoria.IV .5.1 PROCES AMIENTO DE INTERRUPCIONES :
La presencia de una interrupcin
dispara cierta cantidad de eventos, tanto en el hardware del procesador como en
el software. La figura IV .6, muestra una secuencia tpica.
Cuando un
dispositivo de E/S completa una operacin, ocurre la siguiente secuencia de
eventos de hardware:
1 - El perifrico enva una seal de interrupcin al
procesador. 2 - El procesador termina la ejecucin de la presente instruccin

antes de responder a la interrupcin.
3 - El procesador interroga por si
hay interrupciones, al determinar que hay una en espera, emite una seal de
reconocimiento al dispositivo que realiz la solicitud. Esto hace que el
dispositivo retire la seal de interrupcin.
4 - El procesador ahora necesita
prepararse para transferir el control a la rutina de interrupcin. Para empezar,
debe guardar la informacin necesaria para reasumir la ejecucin del programa
que tena en curso. El mnimo de informacin re querido para ello es el estado
actual del procesador, que se va actualizando en un registro denominado PS W
(Present S tatus Word - Palabra del Estado Actual), y la ubicacin de la prxima
instruccin que debe ser ejecutada, la que es contenida en el Contador de
Programa (CP). Ambas pueden ser guardadas en Pila de Control del S istema (PCS )
(S ystem Control S tack).
5 - El procesador ahora carga el CP con la
locacin de inicio de la rutina de manejo de interrupciones. En forma
dependiente de la arquitectura y del sistema operativo, puede haber un nico
programa, o un programa por cada dispositivo de E/S , o un programa por cada
dispositivo de E/S y por cada tipo de interrupcin. Al haber ms de una rutina,
la UCP debe primero determinar cual de ellas utilizar, por tanto en cada
solicitud de interrupcin puede estar incluida la informacin correspondiente, o
el procesador puede tener que interrogar al dispositivo que emiti la seal de
interrupcin, para que le indique sus necesidades.#
Figura IV .6 Procesamiento de interrupciones.
Una vez que ha sido cargado el CP, el
procesador prosigue con el prximo ciclo de instruccin, el que comienza con una
bsqueda, dado que la direccin buscada es dada por el nuevo contenido del CP,
el resultado es una transferencia del control al programa de manejo de las
interrupciones, lo cual lleva a la realizacin de las siguientes operaciones:
6 - En este momento, la informacin relativa al CP y a la PS W del
programa interrumpido, ha sido guardada en la pila del sistema, sin embargo, hay
mas informacin que es considerada parte de la ejecucin del programa, tal como
el contenido de los registros del procesador, cuyo contenido tambin debe ser
salvado, dado que pueden ser utilizados por la rutina de manejo de las
interrupciones. En consecuencia, losmismo son tambin guardados en la pila del
sistema. En la figura IV .8 se muestra un ejemplo simple, un programa es
interrumpido, luego de la instruccin ubicada en la locacin N. El contenido de
todos los registros, mas el de la prxima instruccin N+1 es ubicado en el
S tack. El puntero del mismo es actualizado para que apunte a la nueva entrada, y
el CP es actualizado parfa apuntar a la primera instruccin de la rutina de
interrupciones.7 - El manejador de interrupciones puede ahora llevar adelante su
procedimiento. Esto puede incluir un examen de la informacin del estado con
relacin a la operacin de E/S o a cualquier otro evento provocado por la
interrupcin. Tambin puede involucrar el envo de comandos o seales de
reconocimiento al dispositivo solicitante.8 - Cuando el proceso de la
interrupcin ha sido cumplido. los valores de los registros salvados son tomados
de la pila del sistema y vueltos a sus depositarios originales.9 - El acto final
es la restauracin de la PS W y del valor del CP. Como resultado se ejecutar la
prxima instruccin del programa previamente interrumpido.
Debe notarse la
importancia de salvar toda la informacin referente al programa en ejecucin al
momento de presentarse la interrupcin, a fin de que el mismo pueda ser
reasumido integralmente.IV .5.2 - RECOMENDACIONES PARA EL DIS EO:
Cuando se
presenta una interrupcin, la UCP debe averiguar ante todo de donde proviene,
luego si hay ms de una solicitud, determinar a cual atender primero, para ello
hay cuatro tcnicas en uso actualmente: 1 - Mltiples lneas de interrupcin
2 - V otacin por software.3 - Encadenado margarita (V otacin por Hardware
vectorizada)
4 - Arbitraje del bus (vectorizado)
La solucin ms
directa es la de proveer varias lneas de interrupcin entre la UCP y los
mdulos de E/S , pero no es prctico utilizar mas de unas pocas lneas del bus
para ste propsito. En consecuencia, cuando esto sucede, se dedica cada una de
las lneas posibles a varios dispositivos, y se utilizar alguna de las otras
tcnicas en cada una de ellas.
S obre la alternativa de la V otacin
por S oftware, al detectar la UCP una interrupcin, pasa a una rutina de servicio
de la interrupcin, la que tiene por objeto consultar a cada uno de los mdulos
a fin de determinar cual emiti la solicitud. Esta consulta puede ser en forma
de una lnea separada de comando, en cuyo caso, cuando la UCP detecta una seal
de interrupcin, emite una seal de Prueba (TES T I/O), colocando la
identificacin de cada uno de los perifricos, en forma secuencial, sobre las

lneas de direccin, hasta que uno conteste afirmativamente.
Una forma
alternativa, es la de disponer un registro de estados direccionable en cada
mdulo de E/S , que son ledos por la UCP a fin de determinar cual ha emitido el
pedido de interrupcin, con lo que el procesador carga la rutina especfica para
ese dispositivo.
La desventaja de este sistema es el consumo de tiempo,
siendo
a tal efecto mucho ms efectivo el encadenamiento margarita, que provee, de
hecho, una votacin por hardware. Un ejemplo de esta configuracin es dada en la
figura IV .7, donde est aplicado al arbitraje de un multibus.
La lnea
de pedido de interrupciones es compartida por todos los mdulos de E/S . Cuando
la UCP detecta una interrupcin, enva una seal de reconocimiento que se
propaga en serie por todos los mdulos hasta que detecta el causante. El mdulo
contesta disponiendo una palabra en las lneas de datos, esta palabra es
considerada como un vector y es el identificador del dispositivo, que es
utilizado por la UCP para apuntar a la rutina de servicio adecuada al
perifrico. Esta tcnica tambin es denominada "interrupcin vectorizada".
La otra tcnica que hace uso de interrupciones vectorizadas, es el
arbitraje del bus, donde un mdulo de E/S primero gana el control del bus, antes
de que pueda alcanzar la lnea de interrupcin requerida. En consecuencia, solo
un mdulo por vez puede tener la lnea, y cuando la UCP detecta el pedido,
responde por la lnea de reconocimiento, entonces el mdulo puede entregar su
vector en las lneas de datos.
Las tcnicas indicadas sirven para
reconocer al mdulo que realiz el requerimiento, pero tambin pueden proveer la
forma de asignar prioridades cuando se superponen los pedidos. En un sistema con
mltiples lneas, la UCP tomar primero la de mayor prioridad. Con votacin por
software, el orden en el cual son consultados los mdulos puede indicar su
prioridad, y el orden en el cual estn dispuestos los mdulos en el
encadenamiento margarita acta tambin como asignacin de prioridad. Finalmente,
en el arbitraje del bus se puede emplear un esquema de prioridades, tal como se
indic anteriormente.IV .5.3 - CONTROLADOR DE INTERRUPCIONES INTEL 8259A:
Este controlador provee una sola lnea para el requerimiento de
interrupcin (INTR) y una sola para su reconocimiento (INTA). A fin de hacer que
el procesador 8086 pueda manejar una amplia variedad de dispositivos, y posea
estructuras de priorizacin, se lo configura con un arbitrador de interrupciones
externo de este tipo. En la figura IV .8 se tiene un diagrama de bloques del
mismo.
En la figura IV .9, se muestra el uso del circuito para
conectar hasta ocho mdulos. S i es necesario conectar una mayor cantidad, se
debe emplear una disposicin en cascada del mismo, que puede manejar hasta 64
mdulos.#Figura IV .7 - Cambios en la memoria y en los registros debidos a una
interrupcin.#Figura IV .8 - Manejador de interrupciones Intel 8259A.
El
circuito solo tiene por misin el manejo de las interrupciones, para ello,
acepta pedidos desde los mdulos agregados, determina cual es el de mayor
prioridad, y luego lo indica a la UCP mediante la lnea INTR. El procesador
acepta la interrupcin, dando aviso mediante la lnea INTA.
El
controlador coloca el vector de informacin adecuado sobre las lneas de datos,
y la UCP puede proceder a ejecutar el proceso de interrupcin, comunicndose
directamente con el mdulo de E/S para leer o escribir datos.
El
controlador 8259A es programable, por lo que el procesador puede determinar el
esquema de prioridades aplicable, de entre los que siguen: 1 - Totalmente
anidado: Los pedidos de interrupcin son ordenados entre 0 (IR0 y 7 (IR7). 2 Rotativo: En algunas aplicaciones algunos de los dispositivos son de igual
prioridad, en este caso, luego de haber servido a un perifrico, se le otorga la
menor prioridad dentro del grupo.
3 - Mascara especial: esto permite a la
UCP inhibir selectivamente las interrupciones generadas por algunos
dispositivos.#Figura IV .9 - Uso del controlador de interrupciones Intel 8259A
IV .5.4 - EL INTERFACE PERIFRICO PROGRAMABLE (PPI) INTEL 8255A:
Como
ejemplo de mdulo de entrada/salida, utilizado para E/S programadas y manejadas
por interrupciones, podemos considerar al 8255A de Intel, que es mdulo de
propsitos generales, diseado para ser utilizado con la UCP 8086, integrado en
un solo chip. En la figura IV .10 tenemos el diagrama de bloques del mismo.
El costado derecho del diagrama es la interfase externa, que posee 24
lneas de E/S programables desde el registro de control del 8086.
Las
24 lneas son divididas en tres grupos (A, B y C) de un byte, cada uno de los
cuales puede funcionar como puerto de 8 bits. Adems, el grupo C puede ser
subdividido en dos de 4 bits (CA y C B), los que pueden ser utilizados
conjuntamente con los puertos A y B llevando seales de control y de estados.
En el costado izquierdo, tenemos la interfase interna con el bus del
8086, e incluye un bus de datos bidireccional (D0 a D7), utilizado para la
transferencia de datos e informacin al registro de control. Las dos lneas de
direccin especifican uno de los tres puertos de E/S o el registro de control.
S e produce una transferencia cuando se habilita la lnea CHIP S ELECT
conjuntamente con alguna de las seales de LECTURA o ES CRITURA. La lnea de
RES ET es utilizada para inicializar el mdulo.
El registro de control es
cargado por el procesador para controlar el modo de operacin y definir las
seales. En el modo de operacin "0", los tres grupos de 8 lneas externas
funcionan como tres puertos de E/S . Cada uno de ellos puede ser definido como de
entrada o de salida. De otra forma, el grupo A y el grupo B funcionan como
puertos de E/S y las lneas del grupo C como lneas de control para Ay B.
Las seales de control tienen dos propsitos definidos, el "handshaking"
(que en este caso puede interpretarse como coordinacin) y para el pedido de
interrupciones. La coordinacin est basada en un simple mecanismo de tiempo,
una lnea de control se usa por el emisor como lnea para el aviso de "DATOS
PREPARADOS ", a fin de indicar que los datos estn presentes en las lneas de
datos de E/S . La otra lnea sirve al receptor para que emita la seal de
reconocimiento, indicando que los datos han sido ledos y que las lneas de
datos pueden ser desactivadas. Otra lnea puede ser asignada a la solicitud de
interrupciones y vuelta atrs al bus del sistema.
Dado que el 8255A es
programable mediante el registro de control, puede ser usado para controlar una
amplia variedad de perifricos simples. La figura IV .11 ilustra su uso como
controlador de teclado y display. El teclado provee 8 bits a la entrada, dos de
los cuales, S HIFT y CONTROL, tienen un significado especial para el programa de
manejo del teclado. De cualquier forma, su interpretacin es transparente al
8255A, el cual simplemente acepta los 8 bits de datos y los presenta en el bus
de datos del sistema. S e agregan dos lneas para el control de la coordinacin
con el teclado.
La presentacin tambin es enlazada por un puerto de 8
bits de datos, dos de los cuales tienen tambin un significado especial que es
transparente al circuito, y en adicin se agregan dos lneas de coordinacin,
que proveen un control adicional.IV .6 - ACCES O DIRECTO A MEMORIA:
Los
modelos de transferencia vistos, siempre hacen uso del procesador para pasar
datos de la memoria a un dispositivo externo, o viceversa, con lo cual se le
hace perder tiempo en lo que debera ser su fuerte, la elaboracin de datos. El
acceso directo a memoria tiende a evitar este desperdicio, tratando de que el
procesado no pierda tiempo en estas transacciones.#Figura IV .10 - Interfase para
perifricos programable Intel 8255A (PPI).
Una operacin de Acceso
Directo a Memoria (DMA) es inicializada por la UCP, luego de lo cual sigue con
su trabajo, con lo que se puede transferir una gran cantidad de informacin sin
afectar seriamente su performance.
IV .6.1 - FUNCIONAMIENTO DEL DMA:
Este mtodo de acceso involucra un mdulo adicional en el bus del sistema,
mdulo que es capaz de mimetizar a la UCP, y tomar el control para la
realizacin de las transacciones.
El sistema trabaja de la siguiente
manera, cuando la UCP desea leer o escribir un bloque de datos, enva un comando
al mdulo DMA, conteniendo la siguiente informacin:
- Que tipo de
operacin (lectura o escritura) se debe realizar.
- La direccin del
dispositivo.- La locacin de memoria de arranque para la lectura o la escritura.
- La cantidad de palabras que deben ser escritas o ledas.#Figura IV .11 Interfase de teclado y display con 8255A.
La UCP continua con otra tarea,
delegando la operacin de E/S en el mdulo DMA, y ste es el que la tomar a su
cargo. Dicho DMA transfiere el bloque de datos palabra por palabra, directamente
tomndola o entregndola a la memoria, sin intervencin de la UCP.
Una
vez concluida la transferencia, el mdulo DMA advierte de ello a la UCP mediante
una seal de interrupcin. En consecuencia el procesador solo toma parte en el
comienzo y la finalizacin del proceso. Lo que ya haba indicado en la figura
IV .6.c.
El DMA necesita adquirir el control del bus para transferir
los datos desde y hacia la memoria, por lo cual debe usar el bus solamente
cuando la UCP no lo hace, o debe forzar a esta para que suspenda temporalmente
la operacin. Esta ltima tcnica es mas comn, y se la conoce como de "robo de
ciclo", dado que el DMA accede furtivamente a un ciclo de bus.
En la
figura IV .13, tenemos indicado en que lugar del ciclo de instruccin puede
suspenderse la operacin de la UCP. En cada caso esta es suspendida justo antes
de que necesite usar el bus, el DMA no interrumpe la operacin de la UCP, esta
no debe salvar el contexto del programa que est ejecutando, ni hacer ninguna
otra cosa, solo sehace hacer una pausa de un ciclo de bus. S i bien esto retarda
la operacin, su efecto total en caso de tener que realizar muchas
transacciones, es de mucho mejor rendimiento que las otras dos formas, por
programa o por interrupcin.#
Figura IV .12 - Diagrama de bloques de
una DMA tpica.#Figura IV .13 Puntos de ruptura para la DMA y para las interrupciones.#Figura IV .14 Configuraciones posibles con DMA.
El mecanismo del DMA puede ser
configurado en una amplia variedad de maneras, algunas de las cuales se indican
en la figura IV .14.
En el primer ejemplo, todos los mdulos
comparten el mismo bus del sistema. El mdulo DMA acta como un subordinado de
la UCP, utilizando una E/S programada para el intercambio de datos entre la
memoria y un mdulo de E/S , a travs del mdulo DMA. Esta configuracin, que
puede ser muy econmica, es claramente ineficiente, dado que tal como en la E/S
programada, cada transferencia de una palabra, insume dos ciclos de bus.
El tiempo, medido en ciclos de bus, puede ser reducido sustancialmente si
se integran las funciones de la DMA con las de E/S . Tal como se indica en la
figura IV .14.a, ello ocurre cuando se intercala el mdulo DMA entre los mdulos
de E/S y el bus del sistema.
An ms se mejora el sistema, si se dispone
un bus de E/S , conectado al bus del sistema mediante un mdulo de DMA, tal como
se indica en la figura IV .14.c.IV .7 - CANALES DE ENTRADA Y S ALIDA Y
PROCES ADORES :
S egn ya comentramos anteriormente, a medida que las
computadoras evolucionaron, tambin lo hicieron las unidades de entrada y
salida, en forma tal de ir integrando funciones, hasta convertirse en verdaderos
canales de entrada/salida.IV .7.1 - EV OLUCION DE LAS FUNCIONES DE ENTRADA Y
S ALIDA:
Los pasos evolutivos pueden resumirse en la siguiente forma:
1 - La UCP directamente controla los perifricos, lo que es notable
en dispositivos controlados a microprocesador.
2 - S e agrega un
controlador o un mdulo de E/S . La UCP utiliza un sistema de E/S programada, sin
interrupciones. Con este paso la UCP se independiza de los detalles especficos
de la interfase del dispositivo externo.
3 - S e usa la misma configuracin
anterior, pero se agregan las interrupciones. La UCP no gasta tiempo en esperar
la realizacin de una operacin de E/S , lo cual mejora la eficiencia.
4 El mdulo de E/S alcanza directamente la memoria mediante un mdulo de DMA, por
tanto puede mover un bloque de datos desde o hacia la memoria sin que la UCP
intervenga, excepto en el comienzo y final de la transferencia.
5 - El
mdulo de E/S es mejorado para convertirse el mismo en un procesador, con un
conjunto especfico de instrucciones. La UCP indica al procesador de E/S que
ejecute un programa de E/S que est almacenado en la memoria. El procesador los
busca y ejecuta sin intervencin de la UCP. sta puede indicar una secuencia de
actividades, y ser interrumpida solamente cuando todo ha sido realizado.
6 - Los mdulos de E/S tienen tambin una memoria local, por lo que ya no
necesitan buscar su programa de actividades en memoria central, por lo que de
hecho estos mdulos se convierten en computadoras destinadas a procesar las
transacciones de la mquina principal. Esto hace que aumente notablemente la
cantidad de dispositivos que pueden conectarse a la mquina. Un uso comn de
esta arquitectura, lo podemos encontrar en los sistemas de comunicaciones entre
terminales interactivas, donde los procesadores de E/S toman a su cargo la
mayora de las tareas involucradas en el control de las terminales.IV .7.2 CARACTERS TICAS DE LOS CANALES DE E/S :
El canal de E/S representa una
extensin del concepto DMA. Un canal tiene la habilidad de ejecutar
instrucciones de E/S , con control total sobre las mismas.
En un sistema
de computacin donde se utilizan estos dispositivos, la UCP no ejecuta
instrucciones de E/S , sino que ellas son almacenadas en la unidad de memoria
principal, para ser ejecutadas por un procesador de propsitos particulares,
dedicado al canal de E/S . La UCP inicia la operacin instruyendo al canal para
que ejecute el programa almacenado en la memoria, programa que contendr todas
las instrucciones necesarias referentes a los perifricos, sus prioridades,
lugar donde deben dejarse los datos, etc.
Hay dos tipos de canales de E/S
de aplicacin masiva, los que se ilustran en la figura IV .15, y son los que
actan mediante selector o mediante multiplexor. El primero puede controlar la
transaccin con un solo perifrico por vez, mientras que el segundo puede actuar
sobre varios al mismo tiempo. En este ltimo caso, el multiplexor se encarga de
intercalar la informacin correspondiente a cada dispositivo, en forma tal que
cada uno recibe o entrega la informacin correspondiente.IV .8 - LA INTERFACE
EXTERNA:
Como su denominacin lo indica, la interfase externa es la que
tiene en cuenta la interconexin entre el mdulo de E/S y el perifrico.IV .8.1 TIPOS DE INTERFAS E:
La interfase con un perifrico debe ser "hecha a
medida" de acuerdo con la naturaleza y la operacin del dispositivo, la
principal caracterstica es su tipo de conexin, que puede ser serie o paralelo,
ambas de acuerdo al esquema mostrado en la figura IV .16. En el caso a, se tiene
la conexin paralelo, en la cual se transfiere una cierta cantidad de bits en
forma simultnea, siendo conveniente que la cantidad sea igual a la longitud de
palabra utilizada.
En la interfase serie, la transferencia se realiza
bit a bit, por tanto el mdulo debe hacer la conversin correspondiente.
El primer tipo se utiliza en sistemas de alta velocidad, tales como discos
o cintas, en cambio el segundo se reserva para aquellos perifricos de menor
velocidad, tal como impresoras y terminales.
#
Figura IV .15 - Arquitectura de canal para E/S .
En ambos casos,
el mdulo de E/S debe establecer una "conversacin" con los perifricos, en
trminos generales, el dilogo para una operacin de escritura es el siguiente:
1 - El mdulo de E/S enva una seal de control solicitando
autorizacin
para mandar datos.
2 - El perifrico reconoce
el pedido.
3 - El mdulo de E/S transfiere los datos (una palabra o
bloque de
palabras, de acuerdo al perifrico).
4 - El
perifrico reconoce la aceptacin de los datos.
Una operacin de lectura,
se produce de manera similar.#
Figura IV .16 Entradas/salidas paralelo y serie.
La clave de la operacin del mdulo de
E/S es un registro que puede almacenar datos y entregarlos a la velocidad del
perifrico, y en la forma requerida por l, en serie o paralelo.IV .8.2 CONFIGURACIONES PUNTO A PUNTO Y CONFIGURACIONES
MULTIPUNTO:
La conexin entre un mdulo de E/S y un perifrico puede
acontecer en cualquiera de dos formas, punto a punto o multipunto. En el primer
caso, la interfase provee lneas dedicadas entre el mdulo de E/S y el
dispositivo externo. En sistemas pequeos (Computadoras Personales, estaciones
de trabajo).
Los enlaces dedicados tpicos son los correspondientes
al teclado, la impresora, y el mdem externo. El ejemplo caracterstico de tales
interfases es la especificacin EIA-232, tambin conocida como RS -232.
Al
aumentar la importancia, aparecen las interfases externas multipunto, utilizadas
para soportar dispositivos de almacenamiento masivo (discos y cintas) y los
perifricos multimedia (CD-ROM, video, audio). Estas interfases son
efectivamente buses externos, y exhiben el mismo tipo de lgica de los buses.###
#Celeste O.F. DInca - Arquitectura de Computadoras - Capitulo 4 - Pgina N
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Adec - Cap 4

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imprimibles y de control, los primeros a su vez son los alfabticos, numricos,

realizacin de los siguientes

especifica para interconectarse con cada dispositivo que el controla.

procesador. 2 - El procesador termina la ejecucin de la presente instruccin

identificacin de cada uno de los perifricos, en forma secuencial, sobre las

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