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TV A0402

Televisores de Plasma

ndice 3.3. Scan Converter...................................................................32


3.3.1. Perfil....................................................................... 32
1. TECNOLOGA DEL PLASMA....................................... 3 3.3.2. Configuracin ........................................................ 32
3.3.3. Bloque de interfase de CPU................................... 34
1.1 Funcionamiento del plasma................................................ 3 3.3.4. Bloque de interfase de memoria para
almacenamiento de imagen.............................................. 34
1.2. Dentro de la pantalla........................................................... 4 3.3.5. Bloque de entrada/reduccin de imagen ................ 34
3.3.6. Bloque de salida/expansin de imagen .................. 34
2. PERFIL .......................................................................... 7 3.3.7. Bloque de control de bus interno ........................... 34

2. PERFIL .......................................................................... 7 4. TARJETA Q .................................................................35

4.1 Descripcin de la operacin del circuito de la


3. TABLETA B................................................................... 8 tarjeta Q.....................................................................................35

3. TABLETA B................................................................... 8 4.2 Diseo del bloque Q ............................................................37


4.2.1 Configuracin del circuito de la tarjeta Q............... 37
3.1. Operacin y descripcin de la tableta B............................ 8 4.2.2 Diagrama a bloques de la tarjeta Q. ........................ 37
3.1.1. Perfil .........................................................................8
3.1.2. Bloque relacionado a la descodificacin de color..10 4.3 Operacin del circuito, descripcin de cada
3.1.3.- Circuito de imagen dinmica ................................12 bloque.........................................................................................38
3.1.3.1. Caractersticas del circuito de imagen AGC .......13 4.3.1 Interfase de entrada y Salida ................................... 38
3.1.4.- Conversor A/D ......................................................15 4.3.2. Bloque de video ..................................................... 38
3.2.5.- IC del sistema........................................................17 4.3.2.1 Entrada se seal compuesta de video................... 39
3.1.6.- Scan Converter......................................................19 4.3.2.2 Seal de entrada Y(C (terminal S). ...................... 40
3.1.7.- Circuito de separacin de sincrona ......................21 4.3.2.3.Entrada de seal por componentes....................... 40
3.1.8.- PLD .......................................................................23 4.3.3 Bloque de Audio. .................................................... 41
3.1.9.- Seales de tiempo tales como reloj o seal de sincrona 4.3.3.1 Circuito de seleccin de entrada. ......................... 43
..........................................................................................25 4.3.3.2 Circuito de salida de Audio.................................. 43
4.3.3.3. Circuito de TruSurround. .................................... 43
3.2.- Funciones de la microcomputadora ............................... 27 4.3.3.4. Procesador de Audio. .......................................... 44
4.3.3.5 Amplificador de Audfonos. ................................ 44

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4.3.3.6 Amplificador de Audio.........................................44 7.5 Remocin de la tableta H1 .................................................58


4.3.3.7 Salida de Sub_Woofer..........................................45
4.3.3.8 Circuito de control de silenciamiento...................45 7.6 Remocin de la tableta H2 .................................................58
4.3.4 Circuito de control de Ventilador............................45
4.3.5 Control S. ................................................................45 7.7 Remocin de la pantalla de Plasma...................................58

5. TARJETA DE TU......................................................... 48

5.1 Bloque de proceso de video................................................ 48


5.1.1 Diagrama a bloques del circuito de proceso de video.48
5.1.2 Circuito para el proceso de la Sincrona Horizontal.49
5.1.3 Circuito para el proceso de sincrona Vertical. .......49
5.1.4. Circuito de procesamiento de video. ......................49

5.2 Circuito de proceso de audio ............................................. 51


5.2.1 Diagrama a bloques del circuito de audio. ..............51
5.2.2 Circuito de procesamiento de Audio.......................51

5.3. Bloque del Microcontrolador para control del Tuner. .. 51

6. ADVERTENCIAS DEL DISPLAY. ............................... 55

7.- DESENSAMBLE ........................................................ 56

7.1. Cubierta trasera ................................................................ 56

7.2. Remocin de las tabletas Q, Q2 y TU .............................. 56

7.3. Remocin del blindaje principal ...................................... 57

7.4. Remocin de la tableta B .................................................. 57

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1. Tecnologa del Plasma 1.1 Funcionamiento del plasma

Durante los ltimos 75 aos, la gran mayora de los televisores se El elemento central en una luz fluorescente es el
han construido con la misma tecnologa, el tubo de rayos plasma, un gas formado por iones libres (tomos
catdicos (CRT). En una televisin de CRT, una pistola dispara elctricamente cargados) y electrones (partculas
un haz de electrones (partculas cargadas negativamente) dentro negativamente cargadas). Bajo condiciones normales,
de un tubo largo de vidrio. Los electrones excitan tomos de el gas es principalmente formado de partculas sin
fsforo a lo largo del lado ancho del tubo (la pantalla), lo cual carga. Esto es que los tomos individuales del gas
causa que los tomos de fsforo se iluminen. La imagen en la incluyen igual nmero de protones y electrones. Los
televisin se produce al iluminar distintas reas de la capa de electrones cargados negativamente forman un
fsforo con distintas intensidades. balance perfecto con los protones cargados
positivamente, con lo cual el tomo tiene una carga
Los tubos de rayos catdicos producen imgenes precisas, pero de cero.
tienen un serio inconveniente: Son voluminosos. Para aumentar
el tamao de la pantalla en un CRT, tambin se tiene que Al introducir muchos electrones libres en el gas al
aumentar la longitud del tubo (para dar a la pistola de scanneo de establecer un voltaje elctrico a travs de el, la
electrones la distancia para alcanzar toda la pantalla). situacin cambia rpidamente. Los electrones libres
Consecuentemente, cualquier televisin con un gran CRT va a chocan con los tomos, forzndolos a perder otros
pesar mucho y ocupar un gran espacio en un cuarto. electrones. Con electrones faltantes, un tomo pierde
su balance. Este tiene una carga positiva,
Recientemente, una nueva alternativa ha empezado a aparecer en convirtindolo en un ion.
el mercado: los televisores de pantalla plana de plasma. Estos
televisores tienen pantallas anchas, comparables con los equipos En un plasma con una corriente elctrica corriendo a
de CRT ms grandes, pero con solo 6 de ancho. travs de el, las partculas cargadas negativamente se
precipitan contra el rea cargada positivamente del
La idea bsica de las pantallas de plasma es iluminar pequeas plasma y las partculas cargadas positivamente se
luces fluorescentes de colores para formar imgenes. Cada pxel precipitan contra el rea cargada negativamente.
esta formado por tres luces fluorescentes (RGB), al igual que en
los televisores de CRT, las pantallas de plasma varan la
intensidad de las diferentes luces para producir un rango
completo de colores.

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1.2. Dentro de la pantalla

El gas xenn y neon en una televisin de plasma esta


contenido en cientos de miles de pequeas celdas
posicionadas entre dos platos de vidrio. Largos
electrodos estn tambin entre las placas de vidrio.
Los electrones de la pantalla transparente, los cuales
estn rodeados por un material dielctrico aislado y
cubierto por una capa protectora de oxido de
magnesio, estn montadas encima de la celda, delante
de la placa frontal de vidrio.

Estos conjuntos de electrones se extienden a lo largo


de la pantalla. Los electrodos de la pantalla estn
ordenados en filas horizontales a lo largo de la
pantalla y los electrodos de direccin estn ordenados
en columnas verticales. Como se puede ver en el
diagrama a continuacin, los electrodos verticales y
horizontales de una cuadricula bsica.
En esta precipitacin, las partculas estn constantemente
chocando entre ellas. Estas colisiones excitan los tomos de gas
en el plasma, causando que se liberen fotones de energa.

Los tomos de Xenn y Neon, tomos usados en las pantallas de


plasma liberan fotones de luz cuando estn excitados. La mayora
de estos tomos son fotones de luz ultravioleta, la cual es
invisible para el ojo humano. Pero los fotones ultravioletas
pueden ser usados para excitar fotones de luz visible.

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se calienta. Cuando el electrn regresa a su nivel normal,
este libera energa en forma de un foton de luz visible.

Para ionizar el gas en alguna celda en particular, la computadora de la


pantalla de plasma carga los electrodos que se intersectan en esa
celda. Haciendo esto miles de veces en una pequea fraccin de
segundo, cargando cada celda en turno. El fsforo en una pantalla de plasma emite luz de
color cuando es excitado. Cada pxel esta formado de
Cuando los electrodos que se intersectan estn cargados (con una 3 celdas separadas, cada una de un color diferente.
diferencia de voltaje entre ellos), una corriente elctrica fluye a travs
del gas en la celda. Como vimos en la ltima seccin, la corriente crea Un subpxel tiene fsforo de luz roja, otro verde y
un rpido flujo de partculas cargadas, el cual estimula los tomos de otro azul. Estos colores se mezclan para crear en
gas para soltar fotones ultravioletas. conjunto el color del pxel.
Los fotones ultravioleta desprendidos interactan con el material de Al variar los pulsos de corriente fluyendo a travs de
fsforo revestido en la pared interna de la celda. El fsforo es una
sustancia que emite luz cuando esta expuesto a otra luz. Cuando un las distintas celdas, el sistema de control puede
foton ultravioleta golpea un tomo de fsforo en la celda, uno de los incrementar o decrementar la intensidad del color de
electrones del fsforo salta a un nivel superior de energa y el tomo cada subpixel para crear cientos de distintas
combinaciones de rojo, verde y azul. De esta manera

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el sistema de control puede producir colores a travs del espectro


entero.

La principal ventaja de la tecnologa de pantallas de plasma es


que se puede producir una pantalla muy ancha usando materiales
extremadamente delgados. Y debido a que cada pxel es
iluminado individualmente, la imagen es muy brillante y se ve
bien desde casi cualquier ngulo. La calidad de la imagen no es
muy superior a la de la mayora de los equipos estndares de
tubos de rayos catdicos, pero ciertamente alcanza las
expectativas de la mayora de la gente.

La mayor desventaja de esta tecnologa es el precio. Con precios


de hasta $200,000.00 no son muy comerciales. Pero con los
precios cayendo y la tecnologa avanzando, empezaran a sustituir
a los televisores de CRT. En el futuro cercano, acomodar una
televisin va a ser tan fcil como colgar un cuadro.

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2. Perfil

Las pantallas de plasma de 32 y 42 pulgadas son prcticamente


iguales en cuanto a circuiteria a pesar de tener distinta resolucin en el
PDP (Plasma Display Panel).
Las tabletas principales son la Q, B y TU.
Las funciones principales de la tableta Q son un selector de
audio/video, preamplificador de audio, amplificador de poder,
amplificador de audfonos y control de ventilador.
Las principales funciones de la tableta B son el procesamiento de
video tales como decodificador de color, separacin de sincrona,
convertidor A/D, conversin IP, scan converter, interfase de PDP y
sintetizacion de OSD.
Las principales funciones de la tableta TU son el sintonizador de TV y
CATV y un circuito de reduccin de fantasmas.

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pasa por el convertidor IP y luego convertida en una seal
3. Tableta B progresiva de 31.5 Khz. En el IC del sistema, la seal
RGB es directamente entregada sin ser convertida. La
seal procesada usando una seal YUV es procesada en
color, tinte, mejora de croma transitoria, y nitidez,
3.1. Operacin y descripcin de la tableta B finalmente convertida en una seal de RGB, y entregada
en el scan converter de la siguiente etapa.
En el scan converter, la resolucin es convertida de
3.1.1. Perfil acuerdo a la resolucin de la PDP. Para una pantalla de
32 pulgadas, la resolucin es entregada usando una seal
El diagrama a bloques general de la tableta B se muestra en la figura. progresiva de 852 x 1024 puntos. Para una pantalla de 42
Hay seales YUV/RGB y compuestas/Y/C como seales de entrada de pulgadas, es entregada usando una seal progresiva de
la tableta B. La seal YUV/RGB es una seal de DTV o PC. La seal 1024 x 1024 puntos.
de el sistema convencional de color para NTSC, PAL y SECAM es la Debido a que el PDP es un panel entrelazado basado en
seal compuesta/Y/C. la seal compuesta/Y/C es decodificada a una un sistema Alis, la seal progresiva del scan converter es
seal YUV usando un decodificador de color. Las seales YUV/RGB y convertida a PI usando el PLD en la siguiente etapa. En
compuestas/Y/C son seleccionadas usando un switch en un PLD, el OSD es insertado y una seal de prueba es
convertidos A/D. generada, en adicin a la conversin PI.
En el convertidor A/D, las seales YUV y RGB pueden ser usadas. En La interfase de seal con el PDP es LVDS. Por lo tanto, la
la etapa anloga, por lo tanto no es necesario convertir la seal YUV seal de salida del PLD es introducida al transmisor
en RGB. La seal convertida a digital usando el convertidor A/D es LVDS, convertida a LVDS y entregada al PDP.
entregada a el IC de sistema, donde una seal de interfase de 15 kHz

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Diagrama a Bloques de la tableta B

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3.1.2. Bloque relacionado a la descodificacin de color

El decodificador de color usa el CXA2163Q (IC2) el cual puede


decodificar NTSC, PAL, SECAM, NTSC443, PAL-M, PAL-N y PAL60.
El diagrama a bloques relacionado al decodificador de color es
mostrado en la figura. Hay varios switches en la figura. Las funciones
de estos switches son las siguientes:

SW1 y SW2 : Selecciona una seal de video compuesta y


seal Y/C. (a: Seal de video compuesta, b: seal Y/C)

SW3 y SW4 : Selecciona si separar las seales usando


una interrupcin interna y un filtro pasa banda o el comb filter externo.
(a: interrupcin interna y filtro pasa banda, b: Comb filter externo)

SW5 y SW6: :Selecciona un comb filter 3D y un comb filter


de 3 lneas (a:comb filter 3D, b:comb filter 3 lneas)

SW7, SW8 y SW9 : selecciona seales compuestas, Y/C y por


componentes (YCbCr). (a: compuesta y Y/C, b: componentes)

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Diagrama a bloques de decodificador de color

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El estado de estos switches para cada seal de entrada se muestra en 3.1.3.- Circuito de imagen dinmica
la tabla.
Por ejemplo una seal compuesta en el caso de NTSC es descrita a Incluso en una imagen de bajo contraste, un circuito de
continuacin. SW1 y SW2 son puestos en posicin a. La seal que imagen dinmica es instalado para mejorar los blancos y
entra en el pin 1 del IC2 sale por el pin 3 y pasa a travs de un negros y reproduce una imagen ms clara y ms obscura
amplificador a 6 dB y de un filtro pasa bajas al comb filter 3D (IC206) y con alto contraste. Esta funcin era realizada a travs del
el comb filter de 3 lneas (IC205). Para NTSC, un comb filter 3D es uso combinado de un circuito de extensin de negro con
usado. Por lo tanto las seales de salida de Y y C del comb filter 3D un decodificador de color y un circuito de imagen AGC.
son enviadas a travs de un filtro pasa bajas nuevamente al El circuito de imagen AGC consiste de IC5, Q15, Q16,
decodificador con los switches (SW5 y SW6) para la seleccin de Q18, Q20, y Q22 a Q27. Este circuito detecta la
comb filter se pone la posicin a (la seal Y es enviada de el pin 5 y luminancia promedio de la imagen y dinmicamente
la seal Y de el pin 7). La seal de C es despus decodificada usando cambia una curva de gamma para que la luminancia de
un bloque de proceso de croma para producir las seales Cb y Cr. La un medio tono se incremente cuando la luminancia
seal de Y es enviada al bloque de proceso Y en el IC, y promedio es baja. La curva de gamma es obtenida
simultneamente, tambin entregado por el pin 11 a la salida de IC. La controlando la inclinacin de una lnea poligonal y el punto
seal resultante pasa a travs del SW9 (IC3) puesto en posicin a y de rizo.
enviado al decodificador de closed caption IC4. una seal de RGB con La figura muestra las caractersticas del circuito de
caracteres y su marco salen del decodificador de closed caption y imagen AGC.
entran a los pines del 33 al 36 del decodificador de color. La seal de
caracteres en RGB es convertida en una seal TCbCr e insertada en
la seal de video.

SW1,2 SW 3,4 SW 5,6 SW


7,8,9
Y/C b a X a
NTSC a b a a
PAL a b b a
SECAM a a X a
NTSC443 a a X a
PAL-M a b b a
PAL-N a b b a
PAL60 a a X a
YCbCr X X X b

Estados de los switches para seales de entrada (X significa no


importa).

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3.1.3.1. Caractersticas del circuito de imagen AGC tiene suficiente luz. El voltaje de control de un comparador
de voltaje es enviado al circuito de control de lnea
La operacin del circuito de imagen AGC se describe a continuacin. poligonal el cual consiste de Q25, Q26 y Q27. el punto de
La seal de entrada Y de el decodificador de color es ingresada a al rizo de una lnea poligonal se vuelve bajo cuando la
pin de entrada (pin 1) de el amplificador de control de ganancia IC5 y luminancia promedio decrece. Como resultado, las
sacado de el pin 3. La seal de entrada es sujeto al pedestal por caractersticas mostradas en la figura son obtenidas al
medio de Q23 y pasado a travs de de el seguidor del emisor Q24. La controlar el amplificador de control de ganancia y el
seal de salida de el Q24 es integrado usando R89 y C57 para circuito de control de lnea poligonal usando un voltaje de
producir un voltaje de luminancia promedio y enviado a el comparador luminancia promedio.
de voltea usando Q22, Q20 y Q16. la seal es entonces enviada a
travs de Q15 al pin de control de ganancia (pin 2) del IC5. en el ciclo
de campo trasero, la ganancia se incrementa cuando la luminancia
promedio decrece. La ganancia es 1 cuando la luminancia promedio

Diagrama Esquemtico de AGC

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Las caractersticas del circuito de extensin de negro en un Las caractersticas de un circuito de imagen dinmica en
decodificador de color se muestran en la figura. el cual el circuito de extensin de negros y el circuito
AGC son combinados se muestra en la figura.

Caractersticas del circuito de imagen dinmica


Caractersticas del circuito de extensin de negros.

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3.1.4.- Conversor A/D

El diagrama de bloque del convertidor A/D (IC403) es mostrado en la


figura. El convertidor A/D tiene 2 rutas de entrada. Este incorpora
switches de video de banda ancha. La seal de video que pasa a
travs de un decodificador de color es enviada a la entrada 1 (pines
124, 133 y 139), y la seal RGB/YUV es enviada a la entrada 2 (pines
126, 136 y 141). Los amplificadores que pueden cambiar la ganancia o
la discriminacin estn incorporados en la etapa final de los switches
de video. Durante los ajustes de calibracin AD, la ganancia y la
discriminacin de los tres amplificadores son ajustados para que los
datos digitales de RGB en la etapa final PLD sean ordenados
correctamente. Las seales de video y RGB/YUV son convertidas A/D
despus de pasar a travs de estos amplificadores. En los 3 canales
hay salidas en 2 fases para producir datos digitales de 48 bits en total.
El convertidor A/D tiene un circuito interno PLL. Un reloj es generado
usando el circuito interno cuando el pulso de HD en una seal de video
es metido en los pines 111 y 112. ya que los datos digitales salen en 2
fases, un pulso de 1/ CLK es entregado por el pin 101 a el IC de
sistema en la etapa siguiente como un reloj.

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Diagrama a bloque del Convertidor A/D

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3.2.5.- IC del sistema

El diagrama de bloques del IC de sistema (IC601) es mostrado en la


figura. IC 601 ejecuta procesos tales como conversin IP, control de
color, control de matiz, control de detalle y separacin digital de
sincrona. La seal digital de entrada es sujetada y enviada al circuito
de matriz de entrada, donde la seal digital no es convertida y
enviada al circuito de mejora de croma transitorio en la siguiente
etapa.
Si la seal de entrada es una seal RGB, esta no es procesada en el
circuito de mejora de croma transitoria e ingresado en el circuito
selector de detalle en la siguiente etapa. La seal de entrada tampoco
es procesada en el selector de detalle horizontal e ingresa en el
circuito de matriz de salida en la siguiente etapa. Adems, la seal
de entrada no es procesada en la salida del circuito de matriz y es
entregada directamente. Para una seal de entrada RGB, en otras
palabras, ningn proceso es llevado fiera del IC del sistema, y las
seales son entregadas directo sin ningn procesamiento.
Si la seal de entrada es una seal YUV, el transitorio de croma es
mejorado. Una seal entrelazada de 15 KHz es ingresada en el
circuito convertidor de entrelazado a progresivo/detalle V para la
conversin IP y el detalle V y despus ingresada en el circuito de
detalle horizontal/selector en la siguiente etapa para detalle H.
Las seales de entrada distintas a una entrelazada de 15KHz son
inmediatamente ingresadas al circuito de detalle horizontal/selector
para el detalle horizontal sin pasar por el circuito convertidor de
entrelazado a progresivo/detalle V.
La seal YUV que sale del circuito de detalle horizontal/selector es
convertida a RGB usando un circuito de salida de matriz en la
siguiente etapa. La matriz en el circuito matriz es una matriz de 3 x 3,
consultando 9 registros en total. El color y matiz puede ser controlado
calculando y cambiando estos valores usando una microcomputadora.

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Diagrama a bloques de IC del sistema

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3.1.6.- Scan Converter

En el scan converter (IC801), la resolucin es convertida dependiendo


de la resolucin del PDP. Para una pantalla de 32, la resolucin es
entregada usando una seal progresiva de 852 x 1024 puntos. Para
una pantalla de 42, es presentada usando una seal progresiva de
1024x1024 puntos. El scan converter es controlado por muchos
registros internos y una microcomputadora.
Una seal de entrada es abastecida desde el IC del sistema en 2 fases
(42 bits). Sin embargo, la seal de salida del scan converter es
enviada al PLD de la siguiente etapa en una fase (42 bits). El reloj de
punto es de 65 MHz para una pantalla de 32 y 80 MHz para una de
42.
El diagrama a bloque del scan converter se muestra en la figura.

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Diagrama a Bloques del Scan converter

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3.1.7.- Circuito de separacin de sincrona

el diagrama de bloques del circuito de separacin de sincrona se


muestra en la figura. El circuito de separacin de sincrona IC404
(M52347) tiene un pin de entrada CS/HS externa (pin 6), pin de
entrada VS (pin 8) y un pin de entrada de sincrona encendida G/Y (pin
4). Para la seal de sincrona de salida (pines 13 y 14), una seal
externa tiene prioridad sobre una seal de encendido de sincrona G/Y
durante la salida. En IC404, la funcin de la separacin de sincrona
de la seal de entrada de encendido de sincrona G/Y es ligeramente
baja para una seal de sincrona baja de 1080i o 720p. La
sincronizacin puede ser en algunas ocasiones desestabilizada. Por
eso, un circuito para reforzar el desempeo es insertado en la etapa
anterior. En este caso, la punta de sincrona es amarrada para corregir
el nivel DC. Adems, la amplitud es ligeramente amplificada para
cortar la porcin de video, y solamente la seal de sincrona es
ingresada en el circuito de separacin de sincrona. Esto previene la
influencia de la fluctuacin de APL de una seal de video o de una
macro-visin de 480p y permite una separacin de sincrona estable.
Seales de sincrona externas de H y V corresponden a una amplitud
de 1 a 5 V, pero son ingresadas en el circuito de separacin de
sincrona despus de que la amplitud es establecida a
aproximadamente 0.6 V usando un circuito recortador.
En esta unidad, una seal de video compuesta puede ser usada como
una seal de sincrona. En este caso, una seal de video compuesta al
pin de H externa.
SW1, SW2 y SW3 se ponen en posicin b cuando el modo de
sincrona es establecido en seal de video. Una seal de video
compuesta es entonces ingresada en el pin de encendido de sincrona
G/Y, unas seales de entradas externas CS/HS y VS se conectan a
tierra y no hay salida. En el circuito de separacin de sincrona, las
seales de entrada de la seal de encendido de sincrona G/Y es
separada en sincrona y entregada.

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Diagrama a bloques del circuito de separacin de sincrona

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3.1.8.- PLD

El diagrama a bloques del PLD (IC203) es mostrado en la figura. La


entrada de la seal de RGB es primero PI (Progresiva a Entrelazada)
usando un circuito [intl] e ingresado a un circuito [solo_azul] para
seleccionar solo el azul.
En la siguiente etapa en un circuito [siggen], una seal de prueba es
generada en el PLD y switcheada a una seal ordinaria.
La seal resultante e entregada al circuito [osd_ins], donde la seal de
OSD del OSD (IC205) es insertada. Finalmente, la seal es
blanqueada usando un circuito [blank_d1] y entregada a travs de un
slip-flop tipo D. Un circuito [relieve] se comunica con la
microcomputadora. Este realiza cada operacin de control de acuerdo
con la instruccin de la microcomputadora o lee el nivel de la seal de
RGB para enviar datos a la microcomputadora.
Un circuito [c_blk] genera una seal compuerta de blanqueo y pulsos
de blanqueo V.
Un circuito [osd_sync] genera una seal de tiempo de sincrona HV
requerida en el OSD.

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Diagrama a bloques del PLD

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3.1.9.- Seales de tiempo tales como reloj o seal de sincrona Hay X802 (80 MHz: 32, 100 MHz: 42) y X801 (65 MHz:
32, 80 MHz: 42) como un oscilador subministrado para
El flujo de las seales de tiempo tales como reloj o seal de sincrona el scan converter. El oscilador X802 es usado para el reloj
se muestran en la figura. de memoria, y el oscilador X801 es usado para la
En el bloque relacionado al decodificador de color, IC2 genera un reloj generacin de la seal de salida de tiempo.
Fsc basado en todos los sistemas de color usando el oscilador X1 La seal de oscilacin de salida del X801 es directamente
(16.2 MHz). enviada al pin 91 del PLD de la siguiente etapa como el
El reloj Fsc generado es enviado al comb filter 3D (IC 206) y el comb reloj de salida del scan converter. Debido a que, en el
filter de 3 lneas (IC205). PLD, la seal progresiva del scan converter es convertida
Un circuito automtico de ancho de banda (IC6) requiere un reloj 4Fsc en una seal entrelazada, el reloj y la seal de sincrona
basado en NTSC. El reloj 4Fsc es suministrado por el oscilador X2 horizontal son divididas en frecuencia. En otras palabras,
(14.3 MHz). Para PAL, IC6 tambin opera usando un reloj idntico. la frecuencia de una seal PCLK se es la mitad de la
Las seales de tiempo de un convertidor A/D (IC403) son generadas frecuencia de la seal POCLK, y la frecuencia de la seal
usando un PLL en un convertidor A/D y un DSS (Digital Sync PHS es la mitad de la frecuencia de la seal POHS. PLD
Separador) en el IC de sistema. Una seal de sincrona RGB/YUV (en tambin genera una seal de tiempo para el OSD (IC1205
los pines 17 y 18) y una seal de sincrona de video/Y/C (en los pines y la suministra.
14 y 15) son entregadas al DSS para seleccin. Las seales En el bloque relacionado al CPU, la seal de tiempo es
resultantes son separadas en seales H y V de sincrona puras suministrada del oscilador X1002 (12.3 MHz) como un
cuando una seal de entrada HCS (sincrona Horizontal o Compuesta) reloj de CPU. El oscilador X1001 (32.8 KHz) es usado
es una seal compuesta. Como resultado un pulso de amarre para un para la oscilacin del reloj de un contador interno.
convertidor A/D es generado, entregado por el pin 3, y enviado al pin
113 de un convertidor A/D (IC403). Adems, un pulso HD (PLLHD)
para PLL es generado, entregado en la salida del pin 4, y enviado a los
pines 111 y 112 del convertidor A/D (IC403 a el PLL interno. El reloj de
punto (CLK) del convertidor A/D es generado en este PLL. Como fue
descrito anteriormente, los datos son enviados en 2 fases, entonces el
reloj (DATACK) enviado al IC del sistema es entregado por el pin 101
como un 1/2CLK.
En el DSS, las seales de sincrona (SYS_HS y SYS_VS) para la
discriminacin del sistema son tambin generadas, saliendo de los
pines 29 y 30 y enviados a la microcomputadora.
El reloj del IC del sistema (IC601) es suministrado usando un oscilador
X601 (70 MHz).
Este reloj es tambin usado como el reloj de un SDRAM externo. En el
generador de salida de la seal de tiempo en el IC de sistema, un reloj
(PICLK), seal de sincrona horizontal (PIHS), seal de sincrona
vertical (PIVS), y el pulso de discriminacin de campo (PIFLD) son
generados e ingresados al scan converter en la siguiente etapa.

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3.2.- Funciones de la microcomputadora

H8S/2633 Ref IC1004 (Fabricado por Hitachi)

Funciones
Las funciones de control de una microcomputadora estn
principalmente clasificados en 6 bloques.
1) Control de cada dispositivo por la salida I/O
2) Control del circuito de ventilador por la salida PWM
3) Deteccin del estado por la entrada A/D
4) Control del LED por la salida D/A

5) Control de cada dispositivo en el bus I2C


6) Control del scan converter por el bus serial de cuatro cables

La informacin requerida para cada control descrito a continuacin es


leda desde un bus o in control de entrada y procesada por software.

La asignacin de pines de la microcomputadora es mostrada en la


tabla a continuacin.

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# Puerto Funcin Nombre Explicacin


1 PC0/A0 O PDP_CPU Panel del pin de seal de salida del panel CPU-GO H: On, L: Off
2 PC1/A1 O PDP_ACT Panel del pin de seal de salida del panel PDP-GO H: On, L: Off
3 PC2/A2 O SYSTEM_RESET Pin de salida de la seal de reset del equipo L:Reset
4 PC3/A3 O VIDE_MUTE Pin de seal de salida de la seal de mute de video H:Mute
5 Vss - Vss GND
6 PC4/A4 - - Sin Uso
7 Vcc - Vcc 3.3V
8 PC5/A5 - - Sin Uso
9 PC6/A6/PWM0 O PWM0 Pin del pulso de salida PWM para el drive de ventilador
10 PC7/A7/PWM1 - PWM1 Sin Uso
11 Vss - Vss GND
12 PB0/A8/TIOCA3 I POWER SW Pin receptor de la seal de encendido/apagado H:On, L:Off
13 PVcc1 - PVcc1 5V
14 PB1/A9/TIOCB3 O INPUT SELECT Pin de salida de seleccin de entrada H: pin RCA, L: pin D4
15 PB2/A10/TIOCC3 O LINE MUTE Pin de salida de la seal mute para una salida de audio externa
H: Mute
16 PB3/A11/TIOCD3 O AMUTE Pin de salida de la seal de mute de audio H: Mute
17 PB4/A12/TIOCA4 O LPF_SW Pin de salida de la seal de eleccin LPF H: A travs, L: LPF
activo
18 PB5/A13/TIOCB4 I SIRCS Pin de recepcin de cdigo Sircs
19 PB6/A14/TIOCB5 O SC PLL SW Pin de la seal de entrada de Encendido/Apagado del PLL en el
scan converter H: On L: Off
20 PB7/A15/TIOCB5 - NC Sin Uso
21 PA0/A16 - - Sin Uso
22 PA1/A17/TxD2 O TXD2 (FWR) Pin de salida de datos (usado para escribir el software)
23 PS2/A18/RxD2 I TXD2 (FWR) Pin de entrada de datos (usado para escribir software)
24 PS3/A19/SCK2 - NC Sin uso
25 Vss - Vss GND
26 P10/PO8/TIOCA0 DACK0/A20 I - Pin de entrada de la seal de discriminacin del panel
27 P11/PO9/TIOCB0 DACK1/A21 I - Pin de entrada de la seal de discriminacin del panel
28 P12/PO10/TIOCC0 TCLKA/A22 O POWER Sin Uso
29 P13/PO11/TIOCD0 TCLKB/A23 I H:SYNC Pin receptor de sincrona H
30 P14/PO12/TIOCA1 IRQ0 I V.BLK Pin receptor de blanqueo V
31 P15/PO13/TIOCB1 TCLCKC I - Pin de seal de entrada de discriminacin de modelo

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32 P16/PO14/TIOCA2 PWM2/IRQ1 I - Pin de seal de entrada de discriminacin de modelo
33 P17/PO15/TIOCB2 PWM3/TCLKD I V.SYNC Pin receptor de sincrona V
34 PE0/D0 I/O - Pin de prueba
35 PE1/D1 I/O - Pin de prueba
36 PE2/D2 I/O - Pin de prueba
37 PE3/D3 I/O - Pin de prueba
38 PE4/D4 O - Pin de salida se la seal de discriminacin de 15 KHz durante la
entrada de RGB. Alto en 15 KHz.
39 PE5/D5 O - Pin de salida para habilitar la transmisin y recepcin del bus
I2C. H: Habilitado
40 PE6/D6 O - Pin de salida de seleccin de la seal de modo de sincrona H:
video L: H/Comp
41 PE7/D7 O - Pin de salida de activacin de Decodificador L: Activado
42 Vss - Vss GND
43 D8 O CC VID/YUV Pin de salida de seleccin de seal de closed caption H: vides L:
YUV
44 PVcc1 - PVcc1 5V
45 D9 O PICTURE AGC Pin de salida de Encendido/Apagado de la seal de imagen
dinmica H: OFF, L: On
46 D10 O NTSC/PAL Pin de salida de la seal de discriminacin NTSC/PAL H: NTSC
L: PAL
47 D11 O COL SYS N/M Pin de salid ad e la seal de discriminacin de color H: NT/PAL
L: N/M
48 D12 O VEH1 Pin de salida de la seal de control del comb filter de tres lneas
49 D13 O VEH2 Pin de salida de la seal de control del comb filter de tres lneas
50 D14 O VEH3 Pin de salida de la seal de control del comb filter de tres lneas
51 D15 O COMF SW Pin de salida de seleccin de comb filter H: 3D, L: 3L
52 P30/TxD0/IrTxD - - Sin Uso
53 P31/RxD0/IrRxD I/O SDA_LS Pin de envo/recepcin de los datos del bus I2C (usado para
baja velocidad)
54 PVcc2 - PVcc2 5V
55 P32/SCK0/SDA1 IRQ4 O SCL_LS Pin de salida del reloj del bus I2C (usado para baja velocidad)
56 Vss - Vss GND
57 P33/TxD1/SCL1 I/O SDA_HS Pin de envo/recepcin de datos del bus I2C (usado para alta
velocidad)
58 P34/RxD1/SDA0 O SCL_HS Pin de salida de reloj del bus I2C (usado para alta velocidad)
59 P35/SCK1/SCK4 SCL0/IRQ5 O TU_CLK Pin de salida del reloj serial para el tuner de la

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microcomputadora
60 P36/RxD4 I TU_RX Pin de recepcin de datos seriales para el tuner de la
microcomputadora
61 P37/TxD4 O TU_TX Pin de envo de datos seriales para el tuner de la
microcomputadora
62 PG0/CAS/IRQ6 O . Pin de envo de seal de interrupcin para el tuner de la
microcomputadora
63 PG1/CS3/OE/IRQ7 O SOG DUTY2 Pin de salida de la seal de control de deberes de la seal de
sincrona
64 PG2/CS2 O SOG DUTY1 Pin de salida de la seal de control de deberes de la seal de
sincrona
65 PG3/CS1 I H STATUS Pin de discriminacin de la polaridad de sincrona H
66 PG4/CS0 I V STATUS Pin de discriminacin de la polaridad de sincrona H
67 WDTOVF O WDTOVF Pin de salida de sobre flujo de la seal de WDT
68 PLLVCC - PLLVCC Pin de poder para el oscilador interno PLL (3.3V)
69 PLLCAP - PLLCAP Pin de capacidad externa para el oscilador PLL interno
70 PLLVSS - PLLVSS Pin de aterrizaje para el oscilador PLL interno
71 RES I RES Pin de entrada de la seal reset L: Reset
72 NMI I NMI Sin Uso
73 STBY I STBY Sin Uso
74 FWE I FWE Pin de entrada de habilitacin de escritura flash
75 XTAL I XTAL Pin de entrada de la seal del cristal de oscilacin
76 Vcc - Vcc 3.3 V
77 EXTAL I EXTAL Pin de entrada de la seal del cristal de oscilacin
78 Vss - Vss GND
79 OSC1 - OSC1 Sin Uso
80 OSC2 - OSC2 Sin Uso
81 PVcc1 - PVcc1 5V
82 PF7/ - - Sin Uso
83 Vss - Vss GND
84 AS/LCAS O TUNER RESET Pin de salida la seal de reset del tuner de la microcomputadora
L: Reset
85 RD O RGB3 Sin Uso
86 HWR O CONT1 Sin Uso
87 PF3/LWR/ADTRG IRQ3 I NC Pin de deteccin instantnea de 5V digitales
88 PF2/LCAS/WAIT BREQ0 - NC Sin Uso
89 PF1/BACK/BUZZ NC Pin de deteccin de ventilador detenido H: Stop

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90 PF0/BREQ/IRQ2 O RTC-IRQ Pin de salida de la seal de interrupcin de reloj de tiempo real
91 AVcc - AVcc 5V
92 Vref I VREF Pin de entrada del voltaje de referencia para los convertidores
A/D y D/A (5V)
93 P40/AN0 A/D - Sin Uso
94 P41/AN1 A/D - Sin Uso
95 P42/AN2 A/D - Pin de deteccin de aspecto del pin D
96 P43/AN3 A/D - Sin Uso
97 P44/AN4 A/D - De deteccin del switch de control
98 P45/AN5 A/D - Sin Uso
99 P46/AN6/DA0 D/A - Pin de control del LED Verde
100 P47/AN7/DA1 D/A - Pin de control del LED Rojo
101 P90/AN8 A/D - Sin Uso
102 P91/AN9 A/D - Pin de deteccin del voltaje de drive del ventilador
103 P92/AN10 A/D - Pin de deteccin de 5V digital
104 P93/AN11 A/D - Pin de deteccin de 3.3V digital
105 P94/AN12 A/D - Pin de deteccin de 6V anlogos
106 P95/AN13 A/D - Pin de deteccin de temperatura en la tableta de fuente
107 P96/AN14/DA2 - - Sin Uso
108 P97/AN15/DA3 - - Sin Uso
109 A vss - A vss GND
110 P70/TMRI01/TMCI01/DREQ0 CS4 - - Sin Uso
111 P72/TMTI23/TMCI23/DREQ1/CS5 O RTC_CS Pin de seleccin del chip de reloj de tiempo real
112 P72/TMO0/TEND0 CS6/SYNCI O OSD_CS Pin de seleccin del chip OSD
113 P73/TMO1/TEND1 CS7 O PLD_CS Pin de seleccin del chip PLD
114 P74/TMO2/MRES O SC_CS Pin de seleccin del chip de scan converter
115 P75/TMO3/SCK3 O 4W_CLK Pin de salida del reloj de bus de datos serial de cuatro cables
para SC
116 P76/RxD3 I 4W_RX Pin receptor de datos del bus serial de cuatro cables para SC
117 P77/TcD3 O 4W_TX Pin de envo de datos del bus serial de cuatro cables para SC
118 MD0 I MD0 Pin de seleccin de modo de operacin MPU
119 MD1 I MD1 Pin de seleccin de modo de operacin MPU
120 MD2 I MD2 Pin de seleccin de modo de operacin MPU

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3.3. Scan Converter

IP00C714 Ref IC801 (Fabricado por i-chips)

3.3.1. Perfil

Este Scan Converter es un LSI que expande y reduce el color de la


imagen en tiempo real. Un controlador de memora que usa SDRAM
como un marco de memoria, un filtro interpolado de cuatro smbolos
usado para expansin y reduccin, y una memoria lineal estn
integrados en un chip.

Las seales de entrada y salida de imagen contienen un reloj


independiente y una seal de sincrona. Estos operan de forma
independiente y asincrona. Una interfase serial de cuatro alambres es
usada para controlar el scan converter.

3.3.2. Configuracin

Este Scan converter esta dividido en un bloque de interfase con el


CPU, un bloque de interfase de memoria para almacenamiento de
imagen, un bloque de reduccin de entradas de imagen, un bloque de
expansin de salidas de imagen, y un bloque de control de bus interno.

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3.3.3. Bloque de interfase de CPU


3.3.6. Bloque de salida/expansin de imagen
El bloque de interfase de CPU recibe seales (SCLK al pin 252, SS al
pin 253, SI al pin 254, y SO al pin 1) desde una microcomputadora y El bloque de salida/expansin de imagen las solicita al
controla el acceso a un registro interno. Este bloque es usado como bloque interno de bus de control, de acuerdo al estado de
una interfase serial de cuatro cables. Esto hace un registro de acceso una salida del buffer de datos, cuyos datos a la salida son
en sincronizacin con un reloj SCLK (reloj serial) cuando el pin SS transferidos a la memoria de almacenamiento de
(seleccin de chip) es establecido en bajo. imgenes al puerto de salida y luego expande los datos
de salida. Este bloque opera con la seal PLOCK (pin
109) como un reloj. El bloque de entrada y salida de
3.3.4. Bloque de interfase de memoria para almacenamiento de imagen pueden operar simultneamente.
imagen
Bloque de ajuste de calidad de imagen.
El bloque de interfase de memoria para almacenamiento de imagen El bloque de ajuste de calidad de imagen enfatiza los
entrega datos al bus de memoria de almacenamiento de imgenes de lmites de las imgenes (en direccin horizontal) con
acuerdo con las instrucciones de un control de bus interno o lee una respecto a la calidad de la imagen.
seal de entrada del bus de memoria de almacenamiento de
imgenes. Este bloque opera con la seal MCLK (pin 97) como reloj.
El SDRAM K4S161622D (IC802, IC803, e IC804)(Samsung) es usado 3.3.7. Bloque de control de bus interno
como memoria, y una memoria de marco de 6 Mb en total es
constituida en unidades de 2 Mb por color (R,G,y B). El bloque de control de bus interno alinea el bus de
almacenamiento de memoria de imagen de acuerdo a la
salida de seal de demanda del bus de cada bloque y
3.3.5. Bloque de entrada/reduccin de imagen genera la direccin de memoria de almacenamiento de
imagen requerida.
El bloque de entrada/reduccin de imagen lee los datos de un puerto En el circuito de alineacin del bus, el buffer de
de entrada de imagen en unidades de campos de acuerdo al comando entrada/salida de imagen no llega a sobre flujo ni a
del CPU y los reduce. Despus de eso, este bloque los solicita al subflujo incluso si los puertos de entrada y salida operan
bloque de bus de control interno, de acuerdo con una entrada de buffer simultneamente. En este caso, no es necesario aplicar
de datos, cuyos datos de entrada son transferidos a la memoria de peso a la entrada y salida de datos de imagen de cada
almacenamiento de imagen. Este bloque opera con la seal PICLK puerto de imagen.
(pin 248) como un reloj. Este bloque opera con la seal MCLK (pin 97) como reloj.

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4. Tarjeta Q Las seales del canal Izquierdo y derecho que salen del
preamplificador, son enviadas hacia los amplificadores de
4.1 Descripcin de la operacin del circuito de la tarjeta Q. poder IC2002 y IC2001. Estos amplificadores de poder
son clase D. Las seales L y R son moduladas de PWM a
El diagrama a bloques de la tarjeta Q se muestra en la figura. una seal triangular de aproximadamente 100KHz y
despus son sacadas. Estas mismas seales, son
El selctor de funcin de RGB /YUV es el primer bloque se describe. pasadas a travs de un filtro pasa bajos en la siguiente
Las seales componente 1 y componente 2/RGB entran y son etapa como una seal anloga de audio para que pueda
seleccionadas por medio del IC3001 selector de video y son enviadas manejar las bocinas.
a una filtro pasa bajos por la limitacin de banda de las seal YUV. Las seales L y R que salen del amplificador son
Las seales que pasan y las que no pasan a travs del filtro pasa enviadas simultneamente hacia el amplificador de seal
bajos son seleccionadas por medio del selector de video IC3011 y para audfonos IC3010, y la seal de salida es conectada
enviadas hacia la tarjeta B. a la terminal para los audfonos.
La seal de sincrona externa de una seal RGB/YUV es montada Adems una suma del canal izquierdo y el canal derecho
usando D3003 y D3004 y es sacada hacia la tarjeta B para solo una de proveniente del amplificador es conectada a la terminal de
las seales componentes 2/RGB usando un interruptor de sincrona salida del sub-woofer a travs de un filtro pasa bajos
en la siguiente etapa. IC3016. El circuito de control de giro del ventilador esta
tambin montada en la tarjeta Q.
El selector de funcin, de una seal de video de 25 Khz. es descrito a
continuacin. Las seales de Sintonizacin, video 1/YC1 y video YC2
son seleccionadas usando un interruptor de AV IC3014 y son enviadas
a la tarjeta B.

En el selector de funciones de seal de audio, las tres seales de


audio contenidas en 15khz de la seal de video son seleccionadas
usando un interruptor de AV IC3014 y son enviadas al interruptor de
audio IC3016. En el IC 3016 la seal COMP1, COMP2/RGB y las tres
seales de audio contenidas en la seal de video de 15khz son
seleccionadas.
La seal de salida de audio sale a travs de un reforzador IC3015 y
despus es enviada desde el IC3006.
La seal de audio seleccionada usando el IC3006 es enviada la
IC2003. La seal es procesada como trusurround cuando le modo de
surround es puesto en TS. La seal procesada es enviada hacia el
preamplificador IC2002, en donde se controlan tanto el volumen ,
balance, bass y treble y en donde los modos hall y simulate son
procesados en el modo surround.

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Diagrama a Bloques de la tableta Q

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4.2 Diseo del bloque Q ejecuta todas las funciones de audio desde que se
selecciona una seal de entrada hasta que se saca esta.

4.2.1 Configuracin del circuito de la tarjeta Q 4.2.2 Diagrama a bloques de la tarjeta Q.


El bloque Q de la KZ42TS1, consiste en una interfase de entrada y La figura muestra el diagrama a bloques funcional de la
salida bloque de audio, bloque de video y control de FAN. La tarjeta Q tarjeta Q.
selecciona una seal de entrada como el bloque de video. Esta es
completada en el bloque Q como en el bloque de audio. La tarjeta Q

Diagrama a bloques funcional de la tableta Q

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4.3 Operacin del circuito, descripcin de cada bloque.

La operacin del circuito es descrita a continuacin.

4.3.1 Interfase de entrada y Salida

La tarjeta Q es tambin usada como tarjeta terminal. Esta contiene


tolas las terminales de entrada y salida. Las terminales de entrada de
Audio y video tienen dos canales de video compuesto con una terminal
S, un canal por componentes( terminal CA) y una por componentes
separadas (RCA). Una salida de audio( Mezclada)y la terminal de
salida de Sub woofer y esta destinada para usarse como salida. Una
terminal bidireccional de control S esta tambin presente. La figura
muestra la ubicacin de cada terminal en la tarjeta.

Arreglo de terminales

4.3.2. Bloque de video

En el bloque de video la tarjeta Q tiene la funcin de seleccionar las


seales de entrada.
La figura tres muestra el diagrama a bloques del proceso de video. En
esta unidad, la ruta de la seal varia dependiendo de las seales de
entrada ya sea compuesta, S video o por componentes separadas
como lo muestra la figura 4.La operacin del circuito de video es
descrita abajo para cada ruta.

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Diagrama a bloques de la seal de video

del IC3014. El IC 3014 tiene internamente un amplificador


4.3.2.1 Entrada se seal compuesta de video. de video a 6 bB.
La seal que sale por la terminal 40 es amplificada en 6
Una de las seales compuestas de video (Video1 y video 2) que entra dB. Por tanto, la seal que sale por la terminal 40 es
por J3000 y la seal compuesta TUNER-VID(Introducida por el atenuada en 6dB usando un divisor de voltaje formado
CN3004) proveniente de la tarjeta del tuner es seleccionada usando el por R3205 y R3206 para dar una ganancia total de 0dB.la
interruptor IC3014. La seal seleccionada es sacada por la terminal 40 seal atenuada es reforzada usando el emisor seguidor

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Q3027 y esta es sacada por le conector CN3001(VID_SIG en la
terminal 10) hacia la tarjeta B. 4.3.2.3.Entrada de seal por componentes.
El IC 3014 es un interruptor de TV de Audio / video de 5 entras dos
salidas que es de acuerdo al estndar de 2S. En esta unidad, EL En esta unidad, la entrada de seal compuesta esta
IC3014 es usado para la seccin de la seal de entrada de video1/2 conformada por 2 entradas Y /Cb / Cr y R/G/B/H/VD, esta
seal compuesta, seal Y/S(Terminal de entrada S), salida de tuner y tambin corresponde a la sincrona en la seal G.
la seal de audio como se muestra en la figura 3. tambin el IC 3014se La seal seleccionada, es sacada por la terminal 31. La
comunica con la microcomputadora IC1004 en la tarjeta B usando para conmutacin del IC 3001 es controlada por la seal
esto el bus I2C para operaciones de control. INPUT_SEL( Que entra por la terminal 23 del CN3003)
El funcionamiento del circuito de seal Y/C y audio ser descrita mas desde la microcomputadora.
adelante. Como se muestra en la figura 3 la seal seleccionada
usando el IC 3001 se comparte en dos rutas diferentes.
4.3.2.2 Seal de entrada Y(C (terminal S).
Una es directamente introducida al seleccionador de
Una de las entradas de seal de video1/2 Y/C provenientes del video IC 3011 en la siguiente etapa. La otra es introducida
conector S terminal de conector J3000, es seleccionado usando el al IC3011 a travs de un Filtro pasa bajos constituido por
selector de AVIC3014. La seal y seleccionada, es sacad por la el Q3015.
terminal 43, y la seal seleccionada C es sacada por la terminal 45. Cuando la seal de entrada es Y componente de color por
las salidas son amplificadas 6dB y despus atenuadas 6dB de la diferencia pasa por un filtro pasa bajos es seleccionada
misma manera que la seal compuesta de video. La seal Y es usando IC3011. La conmutacin del IC3011 es controlada
reforzada usando un emisor seguidor Q3026, y la seal c es reforzada por medio de por la seal de control LPF( Introducida por
usando Q3025. Despus de esto las seales obtenidas son sacadas la terminal 20 del CN3003) proveniente de la
por le conector CN3001(Y_SIG por la terminal 8 para Y y por la microcomputadora. La seal seleccionada es sacada por
terminal 6 C_SIG para la seal C) hacia la tarjeta B. la terminal 31 del IC 3011 y despus es sacada por la
terminal 4 (G/Y) del conector CN3002 hacia la tarjeta B.
La seal de salida es abierta cuando la termina S no esta conectada. Las seales de sincrona (HD y VD) introducida por el
Una seal en la terminal 7 del IC3014 es internamente llevada a 5V.la J3011 es metida al selector IC3007 y sacada desde el
seal es detectada como una seal del tipo S(Y/C) cuando esta es CN3002(DSUB_H por la terminal 8 y DSUB_V en la
menor que 3.5V. esta es detectada como una seal compuesta de terminal 10) hacia la tarjeta B durante la entrada del la
video cuando el voltaje es a mayor que 3.5V. La deteccin que resulta, seal RGB y seleccin.
es escrita en un registro de estado y es enviada a travs del Bus I2C
hacia la microcomputadora.
La seal de DC, conforme al estndar 2S, sumada la seal C es
detectada en la terminal 6 del IC3014. el resultado de la deteccin es
escrita en un registro de estado y enviado a travs del bus I2C hacia la
microcomputadora en la tarjeta B.

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4.3.3 Bloque de Audio.

En esta unidad, otras funciones como la terminal de salida audfonos


es completada en la tarjeta Q como si fuera el bloque de Audio. El
bloque de audio ejecuta tambin todas las seales de audio desde
que entra hasta que sale esta. La figura muestra el diagrama a
bloques del seguimiento de una seal de audio.

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Diagrama a bloque de la seal de audio

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Una de las seales de audio que viene de un equipo externo, y la La base de los transistores silencia con un nivel alto (
seal de audio del sintonizador es seleccionado por medio de dos aproximadamente 10V). La seal que viene de la terminal
selectores. La seal seleccionada es compartida por dos rutas. Una de de salida, es sacada sin la conversin del nivel de la seal
estas es reforzada y sacada por la terminal de audio. La otra es seleccionada.
introducida al circuito de surround como las seales de las bocinas y La seal que se encuentra en la terminal de salida es
los audfonos. La seal de salida que viene del circuito de surround es silenciada cuando la seal de control de la
ajustada en volumen y calidad usando el procesador de audio. microcomputadora(LINE_MUTE) es puesta en nivel alto
Compartindolo en las rutas de las bocinas, sub_woofer y audfonos. cuando el voltaje de alimentacin (AN_+12V) cae o se
La seal que sale del procesador de Audio, es reforzada o amplificada incrementa. LINE_ MUTE y AN_+12V son introducidas a
y despus es sacada. Los bloques son descritas para cada funcin en un circuito de silenciamiento formado por Q3028 y Q3029.
la parte de abajo. La seal de entrada que viene del D3075, es puesto en
alto para silenciar la seal de salida de audio, cuando la
4.3.3.1 Circuito de seleccin de entrada. seal de silenciamiento LINE_MUTE es puesta en alto y
cuando la alimentacin AN_12V cae o se incrementa.
La seal entrada de video es introducida por J3000 y la seal
sacada proveniente del sintonizador es introducida al interruptor de AV 4.3.3.3. Circuito de TruSurround.
IC3014 con el fin de seleccionar una de las seales. La seal
seleccionada (VID_L) es introducida la selector de Audio IC3006. La seal de audio que es introducida, seleccionada y
La seal de entrada componente de entrada 1 que se introduce por sacada por la terminal 12 t 13 del IC3006, es sacada a
J3004 y la seal de audio de entrada de componentes 2 introducida travs del circuito de la seccin de volumen del
por J3002 son introducidas el IC3006. El IC 3006 selecciona una de procesador de TruSurround el IC2003. La seal de audio
las seales de audio componentes de entrada y la seal resultante se introducida en el IC2003, es procesada en Surround en el
saca por lC3014. La seal Seleccionada se comparte en dos rutas. IC2003 cuando el modo de Surround es puesto en
Una es sacada hacia las bocinas y los audfonos y la otra es sacada TruSurround. Cuando un modo que no sea TruSurround
hacia un canal de salida de audio. El Seleccionador de audio IC3006 es puesto, la seal de entrada es solo pasada en el
es controlado a travs del Bus I2C por medio de la microcomputadora IC2003.
que se localiza en la tarjeta B. El IC2003, el sonido se incrementa mas acsticamente
que en otro modos cuando una seal de entrada es
4.3.3.2 Circuito de salida de Audio. amplificada en modo de TruSurround y es sacado
directamente.
La seal que sale por las terminales 14 y 15 del conmutador de audio Por lo tanto el sonido es atenuado causando un circuito
IC3006, es reforzado usando el IC3015 es sacada por medio de la de seleccin de sonido (Formado por Q2004 y Q2005).
terminal de salida de Audio (J3008). Los transistores Q3032 y Q3033 En la etapa de formacin del IC2003 de esto el volumen
en la seccin de salida del IC3015 son el circuito de silenciamiento de del sonido en el modo TruSurround es el mismo que en
las terminales de audio. otros modos.
La seleccin del modo de Trusurround del IC2003 es
controlado usando la seal de salida del DAC(de la

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terminal 24 del IC2000) y es introducida en la terminal 2. El modo del En la tarjeta Q, la seal en la tarjeta fuente en el
TruSurround es seleccionado cuando la terminal 2 es puesta en alto amplificador de audfonos es silenciada. Q3037 y Q3038
(9V). El circuito de seleccin del volumen de sonido es tambin son encendidos y silenciados usando la seal de salida
controlado usando el la seal de salida del DAC ( Terminal 24 del desde un circuito de control de silenciamiento. La
IC2000) y se introduce al Q2004 y Q2005. operacin del circuito de control silenciamiento se
describir despus.
4.3.3.4. Procesador de Audio.
4.3.3.6 Amplificador de Audio.
El IC2000 es un procesador de audio. El procesador de audio ajuste el
volumen, tone y balance. Esto tambin tiene muchos circuitos de Las seales Izquierda y derecha sacadas del IC2000 son
surround internos. En esta unidad, el proceso de Surround es introducidas al amplificador principal de audio IC2001 y
realizado en el IC 2000, cuando simula y cuando pone los modos de IC2002. Las seales de los canales Izquierdo y derecho
saln (Hall). IC2000 es controlado por medio del bus I2C por medio de son amplificadas usando cada amplificador. Las seales
la microcomputadora en la tarjeta B. Una seal en la terminal 24 es la son entonces sacadas a travs de un filtro LC del CN3007
salida del DAC (colector abierto) seal de I2C. En esta unidad , esta hacia las bocinas de los canales Izquierdos y Derechos.
seal de salida es usada para controlar el procesador de TruSurround Los amplificadores principales de Audio IC 2001 e
IC2003 y la seccin de volumen. IC2002 son amplificadores digitales. La seal anloga
Las seales Izquierda y derecha que se sacan del IC2003 son proviene de la terminal 11 y es una seal interna
introducidas a los pines 6 y 7 del IC2000. La entrada de seales de modulada en PWM y es amplificada a una seal PWM de
audio son procesadas en volumen tono y balance y surround usando aproximadamente 26 VP-P y aproximadamente sobre una
IC 2000 es son sacadas por las terminales 20 y 19. Las seales de portadora de 120KHz. La seal amplificada es sacada por
salida son introducidas al amplificador de salida de Audfonos y al la terminal 4. Las seales que salen del amplificador son
amplificador de Audio en la siguiente etapa. Las seales L+R enviadas al filtro LC que es un filtro pasa bajos en la
procesadas en volumen es sacada por la terminal 22 parta el siguiente etapa para eliminar la componente portadora y
Sub_Woofer. es introducida hacia las bocinas para reproducir el
sonido.
4.3.3.5 Amplificador de Audfonos. Los amplificadores de poder tiene un circuito de
silenciamiento interno. El silenciamiento es cancelado
Las seales Izquierda y Derecha sacadas del IC 2000 son introducidas cuando en la terminal 12 existe un voltaje mayor a 4V. El
a travs de un circuito de Silenciamiento al amplificador de audfonos modo de silenciamiento es activado cuando en la terminal
IC3010. La seal amplificada usando IC3010 es sacada por 12 se tienen de 1.8V a 2.5V. La seal de silenciamiento.
CN3010(terminal 1 HP_L, y terminal 2 HP_R) hacia la tarjeta H1, SP_MUTE es sacada desde el circuito de control de
donde la seal de salida es introducida a travs de un circuito de silenciamiento y en la seccin de deteccin de seal de
Silenciamiento desde del conector de salida de los audfonos. audfonos HP_SW de la tarjeta H1 es introducida a la
La seal de audfonos es silenciada en la tarjeta fuente de la seal y terminal 12. La terminal 12 del IC2001 e IC2002 son
secciones anteriores al amplificador de Audfonos. puestas a nivel de tierra cuando la terminal SP_MUTE
que viene del circuito de control es puesta en
alto(Aproximadamente 10V). La seal de salida de las

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bocinas es en este momento silenciada. La terminal 12 llega silenciada cuando la seal de deteccin de audfonos
aproximadamente a 2.5V cuando la seal de deteccin de audfonos HP_SW es puesto en alto o cuando SP_MUTE es puesta
es puesta en alto (5V). Y despus de esto las bocinas son silenciadas. en estado alto.

4.3.3.7 Salida de Sub_Woofer. 4.3.4 Circuito de control de Ventilador.

La seal izquierda y derecha que es sacada por la terminal 22 del El circuito de control del ventilador esta formado por
IC2000 es filtrada y reforzada usando un filtro pasa bajos formado por IC3012 y Q3022. En este bloque el circuito de control del
IC3016 que es un amplificador operacional. La seal reforzada del ventilador realiza procesos tales como control de
sob-woofer es sacada a travs del circuito de silenciamiento Q3036 y velocidad, deteccin de paro del ventilador y deteccin del
Q3039 proveniente de la terminal de salida de Sub-woofer en J3011. voltaje de control del ventilador. El voltaje de control del
Q3036 es controlado por medio de la seal de salida SP_MUTE ventilador es gobernado por medio de una seal llamada
proveniente del circuito de silenciamiento. Esta es silenciada cuando la FAN_DRV proveniente de la tarjeta B con el fin de
seal SP_MUTE es puesta en alto. Q3039 es controlado por medio de controlar la velocidad del ventilador. El voltaje del
la seal de deteccin de entrada de audfonos HP_SW la que se pone ventilador es atenuada y retroalimentada hacia el
en un estado alto cuando los audfonos son insertados en su terminal microcontrolador(FAN_FB). La seal de deteccin de paro
de entrada. de ventilador que viene del ventilador es Ored usando
IC3017 i es sacado hacia el microcontrolador hacia la
4.3.3.8 Circuito de control de silenciamiento. terminal (FAN_DET).

El silenciamiento es controlado a travs de seales como LINE_MUTE


y A_MUTE provenientes de un microcomputadora y de la lnea de 4.3.5 Control S.
alimentacin AN+12V.
A_MUTE y la lnea de alimentacin AN+12V son introducidas al Esta unidad tiene terminales de Entrada / Salida de
circuito de silenciamiento conformado por Q3034 y Q3035 de esta control S. En la figura se muestra el flujo de la seal S.
forma la seal de silenciamiento SP_MUTE es sacada de Como se muestra en la figura, la seal SIRCS que viene
D3064.SP_MUTE es puesta en alto (Aproximadamente 10V) cuando del receptor del control remoto no esta habilitada cuando
la seal de silenciamiento A_MUTE que viene de la microcomputadora la seal de control S es usada. Solo la seal de SIRCS
es puesta en alto y cuando la lnea de alimentacin de audio AN+12V proveniente del la entrada de Control S es recibida en
cae o se incrementa. este caso. La terminal de salida de control S saca la
seal que viene de la entrada Control s cuando el
Una terminal de salida de audio es silenciada por LINE_MUTE y conector S es insertado en la terminal de entrada Control
AN+12V( ver seccin 2.3.2). S. La salida del Control S saca la seal SIRCS1 que viene
del bloque del foto sensor del control remoto siempre y
La seal de salida es silenciada cuando la terminal SP_MUTE es cuando no este insertada la terminal S . La figura muestra
puesta en nivel alto. Las salidas Las bocinas y Sub_woofer es el flujo de la seal del control S.

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Seales SIRCS y de control S

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Diagrama a bloques de la tableta Q

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5. Tarjeta de TU.

5.1 Bloque de proceso de video.

5.1.1 Diagrama a bloques del circuito de proceso de video.

La figura muestra el diagrama a bloques del proceso de video.

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GR6001 reduce le fantasma usando el interruptor en


5.1.2 Circuito para el proceso de la Sincrona Horizontal. encendido de la microcomputadora del tuner y enva una
seal compuesta al reforzador GR6011 con un voltaje
Una seal compuesta de video con un voltaje de 2.0 Vpp sale de la 1.8Vpp.
terminal 22 (DET OUT) del TU6001 cuando una seal al 100% blanca La seal compuesta es convertida a otra de 0.8Vpp
es introducida. La seal de sincronismo horizontal es detectada usando Q6011 y se enva al tarjeta Q. La descripcin de
proveniente de esta seal usando el Q6004. los pines del TU6001 y GR6001 es mostrada a
continuacin.
La seal de sincronismo H detectada es introducida la
microcomputadora del tuner como una forma de onda ECE-Phase-
shifted de 0 a 5V. La microcomputadora del tuner cuntale pulse en
intervalos de 2 milisegundos cuatro veces i confirma que se este
recibiendo una seal cuando la Cantidad de pulsos es de 104 a 255.

El modo de servicio puede ser cambiado cuando la microcomputadora


del tuner reconoce la recepcin de una seal.

5.1.3 Circuito para el proceso de sincrona Vertical.

Una seal compuesta de video de 1.8 Vpp sale de la terminal 21 (DET


OUT2) del TU6001 todo esto cuando una seal 100% blanca es
introducida. La seal de sincronismo V es detectada en la seal
compuesta de video usando Q6001 y el Q6002. La seal de
sincronismo vertical detectada es introducida ala microcomputadora
del Tuner como una seal ECE-Phase-shifted en forma de diete de
sierra de 0 a 5V. La microcomputadora del Tuner detiene el enfoque
de una imagen usando esta forma de onda.

5.1.4. Circuito de procesamiento de video.

Una seal compuesta de video de 1.8 Vpp sale de la terminal 21 (DET


OUT) del TU6001 y es introducida a travs del un reforzador Q6005 al
GR6001 con un voltaje de 1.8Vpp cuando una seal 100% blanca es
introducida.

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NO Nombre I/O Funcin


1 9v I Alimentacin del Tuner
2 30v I
3 5v I
4 SCL I/O Datos seriales para sintona
5 SDA I/O
6 AS I Fixed 5V
11 RF AGC I Terminal RF AGC
12 VIF - Verificacin VIF
13 +B (9v) I Alimentacin de IF /MPX
14 AFT OUT O Salida anloga de AFT
15 GND - Tierra ( GND)
21 DET OUT2 O Salida de ajuste de video 1.80.1V
22 DET OUT O Salida de Video 2.0 0.2 V
23 ST IND O Salida de indicador estereo PLL ON
24 SAP IND O Salida del indicador SAP (NPN
colector
abierto)
25 MODE I Interruptor de modo para audio multiplexado H: 3.5V-9.0V, L: 0V 1.5V
26 F MONO I Terminal para forzado de monoaural
H:8.5V-9.0V, M: 2.0V-7.0V L:0V-0.8V
27 NC -
28 MUTE I Terminal de Silenciamiento de Audio
ON: 4V-9V; OFF: 0V-0.8V
29 NC -
30 R OUT O Salida de audio canal derecho
31 L OUT O Salida de Audio Canal Izquierdo

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5.2 Circuito de proceso de audio

5.2.1 Diagrama a bloques del circuito de audio.


La siguiente figura muestra el circuito a bloques del procesamiento de
audio.

2. Control del TU6001 a travs de bus bidireccional


5.2.2 Circuito de procesamiento de Audio. I2C
3. Conmutacin del modo dual de audio.
El circuito de procesamiento de audio amplifica la seal de audio 4. Control de silenciamiento de Audio
incluyendo la componente de DC que proviene del TU6001 usando 5. Modo forzado de recepcin monoaural durante
IC6008 (Amplificador operacional) se elimina la componente de CD recepcin estereo.
usando C6075 y C6080 y despus se enva la seal de audio a la 6. AGC Control durante el ajuste automtico.
tarjeta Q.
La informacin requerida para cada uno de los diferentes
5.3. Bloque del Microcontrolador para control del Tuner. procesos referidos arriba, es leda por medio del Bus, de
un Convertidor A/D o I (Puerto de entrada) mostrados en
Las funciones de la microcomputadora para control del Tuner se la lista siguiente y es procesada por medio de Software.
pueden clasificar en 6 principales: La asignacin de terminales para el microprocesador del
1. Interruptor para el modo de computadora externa (Tarjeta de tuner es mostrada en la siguiente tabla.
ajuste).

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No Puerto Nombre I/O Funcin


1 PA1 O_CNCT
2 PA0 I_CNCT I Deteccin de falla en el convertidor de alimentacin: L: Anormal; H: normal
3 PB7 I_MLOCK I Terminal de salida de deteccin de amarrado de AFC. L:Ordinaria H: Muse Lock (Seal de
MUSE provista).
4 PB6 O_SMUTE
5 PB5 O_YCMUTE
6 PB4 O_RECSW1
7 PB3 I_NSYNC I Terminal de entrada para deteccin de sincrona de trama BS.L:Seal de referencia BS, H:
Seales excepto 0(Sin seal y con seal Muse)
8 PB2 O_PCMRST
9 PB1 O_DECSW1
10 PB0 O:DECSW2
11 PC7 I_BINTN I Puesta para el modo de computadora externa (Tarjeta de ajuste) en bajo. L: Modo de
computadora externa, H:Ordinario
12 PC6 O_2SAP
13 PC5 O_BSPCNT
14 PC4 O_MASW
15 PC3 O_SUBSW
16 PC2 O_MUTE
17 PC1 O_AFCSW
18 PC0 O_SMUSE
19 EC/PD7 I_2HS I Entrada de sincrona Horizontal para sintonizacin de la sub-pantalla U/V.
20 RMC-PD6 I_2STRN I Terminal de entrada para deteccin transmisin estereofnica para la sub-pantalla. H:otros
L:Estereo
21 ACI/PD5 I_2BILN I Terminal de entrada para deteccin transmisin audio dual para la sub-pantalla. H: otros L: Audio
Dual.
22 HS0/PD4 I_HS I Terminal de entrada para la sincrona Horizontal para la sintona de la pantalla Maestra U/V
23 SI/PD3 I_SI I Terminal de entrada del puerto serial tri-alambrado (SIO BUS)
24 SO/PD2 O_SO O Terminal de salida del puerto serial tri-alambrado (SIO BUS)
25 SCK/PD1 IO_SCK I/O Terminal de entrada de reloj del puerto serial tri-alambrado (SIO BUS)
26 VSS VSS
27 INT2/PD0 I_2VPN
28 XTAL O_XTAL O Conexin del oscilador cermico
29 EXTAL I_EXTAL I Conexin del oscilador cermico

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30 RST I_RSTN I Entrada de reset
31 TO/PE7 O_SEP
32 PWM/PE6 Terminal de entrada del SW GR
33 PE5/AN3 I_DECIN I Terminal de entrada del decodificador, terminal de entrada para deteccin de conectado o
desconectado: L: conectado H: desconectado
34 PE4/AN2 I_ANTL I Terminal de entrada para la inversin de DC para medir el nivel de entena.
35 PE3/AN1 I_AFT I Terminal de entrada del voltaje de AFT para la sintonizacin U/V de la pantalla maestra
36 PE2/AN0 I_2AFT I Terminal de entrada del voltaje de AFT para la sintonizacin U/V de la sub-pantalla
37 PE1/INT1 I_VPN I Terminal de entrada de sincrona vertical para la sintona de la pantalla maestra.
38 PE0/INT0 I_CPSL I Terminal de entrada del puerto l tri-alambrado seria para seleccin del chip (SIO BUS
39 XLC O_XLC
40 EXLC I_EXLC
41 R O_R
42 G O_G
43 B O_B
44 I I
No Puerto Nombre I/O Funcin
45 YS YS
46 YM YM
47 PF7/PWM7/ IO_SDA1 I/O I2C bus 1 lnea de datos.
SDA1
48 PF6/PWM6/ IO_SDA0 I/O I2C bus 0 lnea de datos.
SAD0
49 PF5/PWM5/ IO_SCL1 I/O I2C bus 1 lnea de reloj.
SCL1
50 PF4/PWM4/ IO_SCL0 I/O I2C bus 0 lnea de reloj.
SCL0
51 PF3/PWM3 O_AGRD O Tuner para U/V AGC con salida variable PWM para la pantalla maestra.
52 PF2/PWM2 O_MONO O U/V control PWM para modo forzado monoaural para la pantalla principal
53 PF1/PWM1 O_2MONO U/V control PWM para modo forzado monoaural para la Sub-pantalla.
54 PF0/PWM0 O_MMUTE O Terminal de salida de silenciamiento de audio para la pantalla maestra.
55 MP I_MP I Tierra (GND)
56 NC NC 5V
57 VDD VDD 5V
58 VSS VSS Tierra (GND)
59 PA7/HSYN I_HP I Terminal de entrada Pulso del horizontal del P y P.
C

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60 PA6/VSYN I_VP I Terminal de entrada Pulso del Vertical del P y P.
C
61 PA5 O_RECSW2
62 PA4 I_STRN I Terminal de entrada para deteccin transmisin estereofnica para la sub-pantalla. H:otros
L:Estereo
63 PA3 I_BILN I Terminal de entrada para deteccin transmisin audio dual para la sub-pantalla. H: otros L:
Audio Dual.
64 PA2 O_SAP O Seleccin del audio U/V de la pantalla maestra

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Power Off Error de acceso del PDP panel
6. Advertencias del Display. durante la secuencia de apagado.

La KZ 42TS1 despliega mensajes de advertencia cuando el led de


standby/sleep de la unidad principal destella. *APAGADO
Si uno de los errores anteriores ocurre, la unidad entra a
un modo de Standby y el led correspondiente comienza a
*ADVERTENCIAS destellar. Le led repetidamente destella a intervalos de
A fin de cuentas, uno de los errores mostrados abajo ocurre cuando el 0.3 seg muchas veces.
led de Standby/Sep destella continuamente en intervalos de 0.4 seg.
Un error puede ser confirmado por el Desplegador NG(NO GOD) que Numero de destellos y errores que representa.
aparece abajo del men de servicio.
Estatus de servicioFan & estatus de la temperatura/ Estatus de Dos veces: Un error de cdigo es detectado proveniente
advertencias del panel

Nota: El desplegador NG no se inicializa hasta que el cordn de AC es Tres veces: Se apago el equipo debido a un incremento
desconectado. de la temperatura(Un mensaje de emergencia es
desplegado antes de que se apague)
*Estatus de servicio / Ventilador & estatus de temperatura. Para la TS42, el apagado por temperatura ocurre a 85
Driver del ventilador Falla en le circuito driver del ventilador. grados Centgrados o mas.
Fan Deteccin de parada del ventilador
Temperatura P/S Error en incremento de temperatura Cuatro Veces: falta de voltaje en la lnea de 5V digital o
un sobre voltaje.
Para el TS42 un mensaje de advertencia es desplegado a 80
grados ms. Cinco Veces: falta de voltaje en la lnea de 3.3V digital o
un sobre voltaje.
*ESTATUS DE SERVICIO/ ESTATUS DE ADVERTENCIAS
EEP ID EEPROM Error al Verificar ID Seis Veces: falta de voltaje en la lnea de 6V anloga o
EEP Save EEPROM Error de salvado un sobre voltaje.
EEP load EEPROM Error de carga
RTC INIT RTC(Real Time Clock) error de inicializacin.
RTC VDET RTC IC error falta de voltaje
RTC XSTOP RTC error por paro de la oscilacin
PDP Init Error de inicializacin del PDP panel.
DEC INIT Error de inicializacin del decodificador de
color
DC INIT Error por inicio con un voltaje B bajo.

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7.- Desensamble
7.2. Remocin de las tabletas Q, Q2 y TU
Antes de iniciar el desensamble se debe recostar el equipo sobre
la pantalla para evitar daos en la pantalla.

7.1. Cubierta trasera

La cubierta trasera esta sujetada por 18 tornillos. Retirarlos y


levantar la cubierta.

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7.3. Remocin del blindaje principal 7.4. Remocin de la tableta B

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7.5 Remocin de la tableta H1 7.7 Remocin de la pantalla de Plasma

7.6 Remocin de la tableta H2

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