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Laboratorio de Circuitos Digitales II UNMSM

UNIVERSIDAD NACIONAL MAYOR DE SAN MARCOS


(Universidad del Per, DECANA DE AMRICA)
FACULTAD DE INGENIERA ELECTRNICA Y ELCTRICA

Profesor:
Oscar Casimiro Pariasca

Tema:
Lab 2: Circuitos latch y flip-flops

Curso:
Lab. de Circuitos Digitales II

Alumnos:
Changanaqui Torres Brandol 15190141
Colla Muoz No
15190004
Lizonde Peredo James
15190167
Villanueva Arquinigo Jesus Angel 15190172

2017

Laboratorio de Circuitos Digitales II UNMSM


Laboratorio de Circuitos Digitales II UNMSM

LAB 2: CIRCUITOS LATCH Y FLIP-FLOPS


Objetivos:
Analizar el principio de funcionamiento de los flip-flops RS, D, JK y T
utilizados comercialmente.

Identificar las diferencias entre un Flip-Flop y un latch de tipo D.

Observar el efecto del reloj en los Flip Flop temporizados y la sincrona de


las entradas y salidas.

Implementar circuitos utilizando estos dispositivos de almacenamiento.

Materiales y equipos:
Protoboard, cables de conexin.

CI. TTL :7400, 7402, 7404, 7408, 7474, 7475, 7476 (x 2) , otros flip-flops
(74112).

Resistencias = 4 x 120 ohm watt; 4 x 1K ohm; leds x 4.

Fuente de c.c. +5 voltios, generador de pulsos, osciloscopio, VOM.

Procedimiento experimental:
1. Latch SR con puertas NOR y NAND Comprobar la tabla de verdad de
los circuitos mostrados. Utilizar compuertas 74LS02 y 74LS00 . Coloque
LEDs (polarizados adecuadamente) a las salidas . Verifique siempre las
condiciones iniciales.

Compare los resultados obtenidos en ambos circuitos.

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2. Latch y Flip-Flop

Los conceptos de latch y Flip-Flop a veces son tomados (errneamente)


como sinnimos. La principal diferencia radica en que un latch responde
al nivel (ya sea alto o bajo) de una seal de reloj, mientras que un Flip-Flop
solo lo hace nicamente en las transiciones (ascendentes o descendentes).

- Verificar el funcionamiento del flip flop 74LS74 - tipo D. Verificar las


entradas de PRESET y CLEAR.

Mostrar un diagrama de tiempos para las seales D, CK y Q.

- Verificar el funcionamiento del latch 74LS75 - tipo D. Mostrar un diagrama


de tiempos para las seales D, EN y Q.

- Generador de combinaciones: Para verificar el funcionamiento de los flip-


flops, utilizar el siguiente

circuito generador de reloj, con el CI 7476 (flip flop JK), con la conexin de
terminales indicada:

- Observar y graficar las formas de onda en los terminales A, B y C, en su


relacin correcta de tiempos.

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Conectar el circuito siguiente . En el circuito generador de combinaciones,


aplique con el generador de pulsos una seal TTL de 10 KHz y con la ayuda
del osciloscopio, elabore el diagrama de tiempos que contenga las salidas
del generador (entradas D, E y CLK) y las salidas Qs del latch y del
Flip-Flop. Dibjelas mostrando la escala adecuada.

3. Flip-Flop JK

- Verificar la operacin del flip flop 74LS76 y del 74LS112.

Conectar el siguiente circuito: con ayuda del osciloscopio, obtenga un


diagramas de tiempo con CLK, J, y Q; dibuje las seales adecuadamente.

NOTA: Recuerde verificar en estos circuitos, la presencia de los flancos y


no el pulso. Intercambiar las entradas J y K realice un nuevo diagrama de
tiempos. Analizar los resultados.

- Cmo es la frecuencia de la seal de salida respecto a la seal de


entrada?

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4. Obtener un flip-flop tipo T a partir del circuito anterior. Conecte la salida


B del generador de combinaciones a la entrada T del flip-flop. Con el nuevo
circuito, obtenga el diagrama de tiempos. Verificar su tabla de verdad.

Invertir las entradas T y CLK y obtenga un nuevo diagrama de tiempos.


Analizar los resultados.

5. Implementar el circuito mostrado, con los CI y seales de entrada


adecuadas, y obtener las seales de salida correspondientes.

Cuestionario final:
1. Qu es un circuito secuencial?

2. Analizar el circuito generador de combinaciones. Qu tipo de circuitos


utiliza? En qu estado trabaja?

3. Explique el funcionamiento de un latch como eliminador de rebote de los contactos


de un interruptor.

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4. Cul es la finalidad de un latch? Y un flip-flop?

5. Explique el funcionamiento de los flip-flops como divisores de


frecuencia.

6. Muestre una tabla resumen con las ecuaciones caractersticas obtenidas


a partir de las tablas de verdad para los biestables SR, JK, D , T.

7. Cmo construira un flip-flop J-K utilizando flip-flop T y otras


compuertas lgicas?. Explique.

8. Utilice los manuales de especificaciones de TTL y CMOS y haga una lista


de dos flip-flops con seal de reloj disparado por flanco de subida y otros
dos flip-flops con seal de reloj disparado por flanco de bajada. Dibuje el
diagrama de terminales de estos circuitos.

9. Se prueba el flip flop de la figura bajo todas las posibles combinaciones


de entrada. Est funcionando correctamente?. Si no es as, cul es la
causa de fallo ms probable?

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