Professional Documents
Culture Documents
03 B Fetovi 01
03 B Fetovi 01
(FET tranzistori)
• Fet – tranzistori (Field - effect) su tranzistori sa efektom
polja
• To su elektronske komponente sa tri elektrode, kod kojih
struju između izlaznih priključaka source - a (izvor) i drain
– a (slivnik) kontroliše napon između treće elektrode gate –
a (kapije) i source – a
• Prostor u poluprovodničkoj komponenti između elektroda
source – a i drain – a naziva se kanal
• Kanal se izrađuje od poluprovodnika samo jednog tipa, ili
samo šupljina ili samo elektrona
• Zato se FET tranzistori još nazivaju i unipolarni tranzistori
ili spojni (junction FET - ovi)
Konstrukcija JFET - a
GEJT
p+
w
G
Rad JFET – a se analizira pod
pretpostavkom da:
• Napon gejt – sors inverzno polariše PN spoj, a da pri tom napon
između gejta i sorsa VGS ne bude niži od napona uštinuća VP koji
za N kanalni JFET iznosi tipično od
-0,3 do -10V.
• Postoji potencijalna razlika između drejna i sorsa.
3 3
V 1 VDS VGS VGS
I D I DSS 3 GS
2
VP 2 VP VP
VGD>VP D
G p+ p+
N KANAL
VDS relativno malo
Oblast
VGS>VP prostornog
tovara
S
U oblasti zasićenja:
• VGS>VP i VGD=VGS-VDSVP
• Stvara se uzani provodni kanalić (vrat, eng. neck) u blizini drejna,
koji se neznatno spušta ka sorsu sa porastom napona VDS
• Može se reći da tada struja drejna praktično ne zavisi od napona
VDS (slično kao što u aktivnom režimu rada bipolarnog tranzistora
struja kolektora praktično ne zavisi od napona VCE, uz
zanemarenje uticaja Erlijevog napona)
• Na granici omske oblasti i oblasti zasićenja je
• VGD=VGS – VDS=VP
• Uvrštavanjem VGD=VP u strujno – naponsku karakteristiku dobija
se
VGS
3
VGS
I D I DSS 1 3 2
VP VP
Geometrija provodnog kanala u oblasti
zasićenja JFET - a
VGD≤VP D
Uštinuće,
vrat (neck)
G p+ p+
VDS relativno veliko
Oblast
VGS>VP prostornog
tovara N KANAL
S
Strujno naponska karakteristika JFET u oblasti
zasićenja:
VGS
• Ako se uvede oznaka x
VP
• U oblasti zasićenja x<1
• Aproksimacijom 3
trascedentne funkcije 1 3x 2 x
2
polinomom drugog 9
reda u okolini tačke x0 0,5625
16
Dobija se pregledan izraz
2
VGS Kako u oblasti zasićenja struja ID
I D I DSS 1
aproksimativno ne zavisi od napona
VP VDS, izraz se može usvojiti kao strujno
– naponska karakteristika u celoj
oblasti zasićenja
Izlazna karakteristika JFET -a
• Uštinućam kanala, tj. povećanje napona VDS ipak dovodi
do smanjenja dužine neuštinutog dela kanala i tako da se
izlazne karakteristike u izvesnoj meri iskose
• Ova pojava može se modelovati po ugledu na bipolarne
tranzistore sa erlijevim naponom VA, data izrazom
2
V V
I D 1 DS I DSS 1 GS
VA VP
OMSKA ZASIĆENJE
OBLAST
ID VGS=0
IDSS VGS=-0,5
VGS=-1,0
VGS=-2,5
-VA VP VDS
Izlazna karakteristika JFET -a
• Idealizovana izlazna karakteristika, kao i kod
bipolarnog tranzistora, ima paralelne izlazne
karakteristike
OMSKA ZASIĆENJE
OBLAST
ID
IDSS
VGS=0
VGS=-0,5
VGS=-1,0
VGS=-2,5
VP VDS
Prenosna karakteristika JFET - a
ID
IDSS
VGS
VP
Primena JFET – a u omskoj oblasti
• Pod pretpostavkom da je
VDS VP
3 3
V 1 VDS VGS VGS
izraz I D I DSS 3 GS 2
VP 2 VP VP
3I DSS
ID 1 VDS VDS
VP VP
Primena JFET – a u omskoj oblasti
• Prema tome, JFET se može koristiti kao naponom
kontrolisani otpornik čija je otpornost data
VDS VP 1
Rx
R R
I D 3I DSS V
1 GS
VP
VP
R0
3I DSS
VGS
VP