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第1章 嵌入式系统基础知识 - 1.3嵌入式微处理器的结构和类型1
第1章 嵌入式系统基础知识 - 1.3嵌入式微处理器的结构和类型1
3 嵌入式微处理器的结构和类型
嵌入式微处理器的字长宽度可分为 4 位、 8 位、 16 位、 32 位和 64 位。
根据用途,可以分为嵌入式微控制器、嵌入式微处理器、嵌入式 DSP 处理
器、嵌入式片上系统、双核或多核处理器等类型。
1.3.1 嵌入式微控制器
16 位及以下的嵌入式微控制器又称为单片机。
嵌入式微控制器具有单片化、体积小、功耗和成本低,可靠性
高等特点,约占嵌入式系统市场份额的 70 %。
1.3.2 嵌入式微处理器
只保留和嵌入式应用紧密相关的功能硬件,去除其他的冗余功
能部分,以最低的功耗和资源实现嵌入式应用的特殊要求。
ARM 微处理器体系结构目前被公认为是嵌入式应用领域领先的 32 位嵌
入式 RISC 微处理器结构。
ARM 处理器系列中的各种处理器,虽然在实现技术、应用场合和性能方
面都不相同,但只要支持相同的 ARM 体系版本,基于它们的应用软件
是兼容的。
版本 ARM 处理器 特点
系列
ARMv1 ARM1 该版体系结构只在原型机 ARM1 出现过,没
有用于商业产品。基本性能:
• 基本的数据处理指令(无乘法)
• 26 位寻址
ARMv2 ARM2 和 该版体系结构对 ARMv1 版进行了扩展,版本
ARM3 ARMv2a 是 v2 版的变种, ARM3 芯片采用了
ARMv2a 。 ARMv2 版增加了以下功能:
• 32 位乘法和乘加指令
• 支持 32 位协处理器操作指令
• 快速中断模式
ARMv3 ARM6 、 AR ARMv3 版体系结构对 ARM 体系结构作了较大
ARMv3M M7DI 、 的改动:
ARM7M • 寻址空间增至 32 位( 4GB )
• 独立的当前程序状态寄存器 CPSR 和程序状态
保存寄存器 SPSR ,保存程序异常中断时的程序状
态,以便于对异常的处
• 增加了异常中断( Abort )和未定义两种处理
器模式
• 增加了 MMU 支持
• ARMv3M 增加了有符号和无符号长乘法指令
ARMv4 StrongARM ARMv4 版体系结构是目前应用最广的 ARM 体
ARMv4T 、 系结构,在 v3 版上作了进一步扩充,指令集中增
ARM7TDMI 加了以下功能:
、 ARM9T • 增加了系统模式
• 增加了 16 位 Thumb 指令集
• 完善了软件中断 SWI 指令的功能
• 不再支持 26 位寻址模式
ARMv5 ARM9E 、 ARMv5 版体系结构在 ARMv4 版基础上增加了
TE ARM10E 、 X 一些新的指令,包括:
ARMv5 scale 、 • 增加 ARM 与 Thumb 状态之间切换的指令
TEJ ARM7EJ 、 • 增强乘法指令和快速乘累加指令
ARM926EJ • 增加了数字信号处理指令( ARMv5TE 版)
• 增加了 Java 加速功能 (ARMv5TEJ 版)
其机制是尽量利用软件办法避免流水线中的数据相关问题。
内核 特点
采用超标量处理器设计和调整内存缓冲器,修改了指令处理设计,它完成
一个操作所需的指令数比 CISC 处理器要多,但完成操作的总时间却减少
了。
采用独特分支处理单元可以让指令预取效率大大提高。
设计了多级内存高速缓冲区,以便让那些正在访问(或可能会被访问)的
数据和指令总是存储在调整内存中。
这种内存分层和内存管理设计,令系统的内存访问性能非常接近调整内存
,但其成本却与低速内存相近。
还引入了独立的分支处理器来进一步解决这个问题。
PowerPC 内核采用超标量( Superscale )设计。
在 PowerPC 内部,集成了多个处理器,这些处理器可以并行独
立工作,这样就可以在一个时钟周期执行多条指令。
一个标准的 601 处理器中便集成了一个定点处理器、一个浮点处
理器和一个分支处理器,这种超标量设计提供了允许多条指令同
时运行的多处理流水线。
1.3.3 嵌入式 DSP 处理器
芯片内部采用程序和数据分开存储和传输的哈佛结构
具有专门硬件乘法器
采用流水线操作
最大的特点:软硬件无缝结合,直接在处理器片内嵌入操作系统的代码模块
。
在芯片内部运用 VHDL 等硬件描述语言,即可实现一个复杂的系统。
绝大部分系统构件都是在系统内部,系统简洁,体积和功耗小,可靠性高。
SOC 多是专用的,比较典型的 SOC 产品如 Philips 公司的 Smart XA ,少数
通用系列如 Siemens 公司的 TriCore 、 Motorola 公司的 M-Core 、某些
ARM 系列器件、 Echelon 和 Motorola 联合研制的 Neuron 芯片等。
1.3.4 嵌入式片上系统
电路综合和时序仿真等设计环节,一般以门级电路网表的形式提供
给用户
硬核( Hard IP Core ):基于物理描述,并经过工艺验证,具有可
保证的性能,提供给用户的形式是电路物理结构掩模版图和全套工艺
文件。
IP 软核以源代码的形式提供,知识产权不易保护。
IP 硬核易于实现 IP 保护,但灵活性和可移植性差。
1.3.5 多核处理器