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双 Σ-Δ ADC、Flash/EE、ARM7TDMI
ADuC7060/ADuC7061
特性 封装和温度范围
工作温度范围:−40°C 至+125°C 完全性能指标保证
模拟输入/输出
32 引脚 LFCSP 封装(5 mm×5 mm)
双(24 位)ADC
48 引脚 LFCSP 和 LQFP
单端和差分输入
衍生产品
可编程 ADC 输出速率(4 Hz 至 8 kHz)
32 引脚 LFCSP(ADuC7061)
可编程数字滤波器
48 引脚 LQFP 和 48 引脚 LFCSP(ADuC7060)
内置系统校准
低功耗工作模式
主(24 位)ADC 通道
应用
两个差分对或四个单端通道 工业自动化和过程控制
PGA(1 至 512)输入级 智能、精密传感系统、4 mA 至 20 mA 环路智能传感器
可选输入范围:±2.34 mV 至±1.2 V
30 nV 均方根噪声 概述
辅助(24 位)ADC:四个差分对或七个单端通道
片内精密基准电压源(±10 ppm/°C) ADuC706x 系列是完全集成的 8 kSPS、 24 位数据采集系统,
可编程传感器激励电流源 在单芯片内集成高性能多信道 Σ-Δ 模数转换器(ADC)、
200 μA 至 2 mA 电流源范围 16 位/32 位 ARM7TDMI® MCU 和 Flash/EE 存储器,
单 14 位电压输出 DAC
微控制器 它由内置两个差分对或四个单端通道的主 ADC 和内置七
16 位/32 位 RISC 架构 ARM7TDMI 内核 个通道的辅助 ADC 组成,可以工作在单端模式或差分输入
JTAG 端口支持代码下载和调试 模式下。片内集成一个单通道缓冲电压输出 DAC。通过编
多个时钟选项
内存 程可以将 DAC 输出范围设置为四种电压范围之一。
32 kB(16 kB×16)Flash/EE 存储器,包括 2kB 内核 这些器件通过一个片内振荡器和锁相环(PLL)产生最多
4 kB(1 kB×32)SRAM
10.24 MHz 的 内 部 高 频 时 钟 信 号 。 微 控 制 器 内 核 为
工具
在线下载,基于 JTAG 调试 ARM7TDMI、16 位/32 位 RISC 机器,峰值性能高达 10
低成本 QuickStart 开发系统™ MIPS;片内集成 4 kB SRAM 和 32 kB 非易失性 Flash/EE
通信接口 存储器。ARM7TDMI 内核将所有存储器和寄存器视为一个
SPI 接口(5 Mbps)
线性阵列。
4 字节接收和发送 FIFO
UART 串行 I/O 和 I2C(主/从) ADuC706x 包括四个定时器。定时器 1 为唤醒定时器,具
片内外设 有使器件离开省电模式的功能。定时器 2 可配置为看门狗
包括 4 个通用(捕捉)定时器
唤醒定时器 定时器。同时提供了一个带 6 个输出通道的 16 位 PWM。
看门狗定时器 ADuC706x 内置一个高级中断控制器。该矢量中断控制器
用于 FIQ 和 IRQ 的矢量中断控制器 (VIC)可以为每个中断分配一个优先级。它还支持嵌套中
每类中断支持 8 种优先级
断,每个 IRQ 和 FIQ 最多允许 8 级嵌套。如果将 IRQ 和
边沿或电平中断外部引脚输入
16 位,6 通道 PWM FIQ 中断源合并,则可以支持总计 16 级嵌套中断。片内出
通用输入/输出 厂固件支持通过 UART 串行接口端口进行在线下载,同时
最多 14 个完全兼容 3.3V 的 GPIO 引脚 也支持通过 JTAG 接口进行非介入仿真。这些器件采用
电源
2.375 V 至 2.625 V 电源供电,工作温度范围为−40°C 至
AVDD/DVDD 额定电压 2.5 V(±5%)
主动模式:2.74 mA(@ 640 kHz, ADC0 主动) +125°C 工业温度范围。
10 mA(@ 10.24 MHz,两个 ADC 主动)
Rev. B
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ADuC7060/ADuC7061
目录
特性 ........................................................................................ 1 寄存器接口...................................................................55
应用 ........................................................................................ 1 DAC的用法 ..................................................................56
概述 ........................................................................................ 1 非易失FLASH/EE存储器 ....................................................57
修订历史 ................................................................................ 3 FLASH/EE存储器可靠性 ............................................57
功能框图 ................................................................................ 4 编程...............................................................................57
技术规格 ................................................................................ 5 处理器相关外设...................................................................58
电气规格 ........................................................................ 5 中断系统.......................................................................58
时序规格 ...................................................................... 10 IRQ................................................................................58
绝对最大额定值 .................................................................. 14 快速中断请求(FIQ).................................................59
ESD警告....................................................................... 14 可编程中断...................................................................60
ADC电路信息...................................................................... 37 I2C寄存器......................................................................86
修订历史
2010 年 2 月—修订版 A 至修订版 B 更改表 15 的编码 0x04 描述 .............................................24
更改表 16 的位 31 描述 .....................................................25
更改特性部分 ...................................................................... 1
更改表 17............................................................................27
更改表 1 ............................................................................... 4
更改表 19 T0CLRI 和表 20................................................28
更改数字 I/O 电压至 DGND 参数.................................... 14
更改表 21 的尾注 ...............................................................29
更改引脚 19、引脚 20 和引脚 45 的描述(表 8)......... 16
更改表 25 的 SPITX 默认值 ..............................................30
更改引脚 13、引脚 14 和引脚 29 的描述(表 9)........... 8
更改外部时钟选择部分 .....................................................33
更改表 14 的位 8 ............................................................... 23
更改 ADC 电路信息部分...................................................36
更改表 20 ......................................................................... 28
更改表 35 的列标题 ...........................................................37
更改电源控制系统部分 .................................................... 34
更改表 39 的位 6 描述 .......................................................40
增加表 32 ........................................................................... 35
更改表 43 的位 12 描述 .....................................................44
更改表 34 中尾注 2 和尾注 3 ........................................... 36
更改“主通道 ADC 数据寄存器”部分和“辅助通道 ADC 数据
更改表 42 ........................................................................... 42 寄存器”部分 .......................................................................48
更改表 43 中位 12 和位[3:0]............................................. 44 更改表 59 和图 17 ..............................................................51
更改表 44 的位 12 ............................................................. 45 更改使用 DAC 部分 ..........................................................55
更改表 45 的尾注 2 ........................................................... 47 更改“非易失 Flash/EE 存储器”部分和“编程”部分..........56
更改表 63 的位 5 ............................................................... 55 更改矢量中断控制器(VIC)部分 ..................................59
更改串行下载(在线编程)部分 .................................... 57 更改优先级寄存器部分 .....................................................60
更改优先级寄存器部分 .................................................... 61 更改表 73............................................................................61
更改 GPxPAR 寄存器部分 ............................................. 101 更改图 23............................................................................65
2009 年 6 月—修订版 0 至修订版 A 更改表 78............................................................................66
更改图 24 和表 79 ..............................................................68
增加 ADuC7061............................................................. 通用
更改定时器 2 接口部分和图 25 ........................................69
增加新封装 CP-32-4...................................................... 通用
更改定时器 3 捕捉寄存器部分 .........................................71
更改特性部分 ...................................................................... 1
更改表 81 的位[16:12]描述 ...............................................72
更改概述部分 ...................................................................... 1
更改表 82 和图 26 的“脉宽调制器概述”部分..................73
更改图 1 ............................................................................... 4
更改表 84 的列标题 ...........................................................75
更改表 1 ............................................................................... 7
更改表 92............................................................................82
更改表 2 的尾注 ................................................................ 10
更改表 102 的位 1 ..............................................................90
更改表 3 和表 4 的尾注 .................................................... 11
更改表 105 的位 11 描述 ...................................................95
更改表 5 的尾注 ................................................................ 12
更改表 106 的 SPIMDE 位描述 ........................................97
更改表 6 的尾注 ................................................................ 13
更新外形尺寸...................................................................103
更改图 7 和表 8 ................................................................. 15
更改订购指南...................................................................104
增加图 8 和表 9,重新排序 ............................................. 18
更改 Flash/EE 控制接口部分............................................ 23 2009 年 4 月—版本 0:初始版
功能框图
07079-001
ADuC7061
图 1.
表 1. ADuC706x 规格
参数 测试条件/注释 最小值 典型值 最大值 单位
ADC 技术规格 对于所有 ADC 规格,除非另有说
明,否则假定处于正常工作模式。
转换速率 1 斩波关闭,ADC 正常工作模式 50 8000 Hz
斩波开启,ADC 正常工作模式 4 2600 Hz
斩波开启,ADC 低功耗模式 1 650 Hz
主通道
无失码1 斩波关闭(fADC≤ 1 kHz) 24 位
斩波开启(fADC≤ 666 kHz) 24 位
积分非线性(INL)1,2 增益=4 ±15 FSR 的 ppm
失调误差 3,4 斩波关闭,校准之后,失调误差 −27 ±8 +27 μV
与选定的编程增益和更新速率所
对应的噪声相当。
失调误差1,3,4 斩波开启 −2.7 ±0.5 +2.7 μV
失调误差漂移与温度的关系 5 斩波关闭(增益 ≤ 64) 650/PGA_GAIN nV/°C
斩波开启(增益 ≤ 64) 10 nV/°C
满量程误差1,6,7,8 正常模式 −1 ±0.5 +1 mV
满量程误差6,8 低功耗模式 −2 ±1.0 +2 mV
增益漂移与温度的关系 9 5 ppm/°C
PGA 增益不匹配误差 ±0.1 %
电源抑制1 斩波开启,ADC=1 V 65 dB
(增益= 1)
斩波开启,ADC=7.8mV 84.7 113 dB
(增益= 128)
斩波关闭,ADC=1 V 56 65 dB
(增益= 1)
辅助通道
无失码1 斩波关闭(fADC≤ 1 kHz) 24 位
斩波开启(fADC≤ 666 kHz) 24 位
积分非线性(INL)1 ±15 FSR 的 ppm
失调误差4 斩波关闭 −120 ±30 +100 μV
失调误差1,4 斩波开启 −1.5 ±0.5 +3.2 μV
失调误差漂移与温度的关系5 斩波关闭 200 nV/°C
斩波开启 10 nV/°C
满量程误差1,6,7,8 正常模式 −1 ±0.5 +1 mV
满量程误差1,6,8 低功耗模式 −2 ±1.0 +2 mV
增益漂移与温度的关系9 3 ppm/°C
电源抑制1 斩波开启,ADC=1 V 55 65 dB
斩波关闭,ADC=1 V 53 65 dB
I2C 时序
表 2. 标准模式下 I2C®时序(100 kHz)
从机
参数 描述 最小值 最大值 单位
tL SCLOCK 低电平脉冲宽度 4.7 μs
tH SCLOCK 高电平脉冲宽度 4.0 ns
tSHD 起始条件保持时间 4.0 μs
tDSU 数据建立时间 250 ns
tDHD 数据保持时间 0 3.45 μs
tRSU 重复起始建立时间 4.7 μs
tPSU 结束条件建立时间 4.0 μs
tBUF 一个结束条件和起始条件之间的总线空闲时间 4.7 μs
tR CLOCK 和 SDATA 上升时间 1 μs
tF CLOCK 和 SDATA 下降时间 300 ns
tBUF
tR
SDATA (I/O)
MSB LSB ACK MSB
tDSU tF
tDSU
tDHD tDHD
tPSU
tSHD tR
tH tRSU
P S
tL S(R)
tF
07079-029
STOP START REPEATED
CONDITION CONDITION START
图 2. I2C 兼容接口时序
SCLOCK
(POLARITY = 0) tSH
tSL
SCLOCK tSR tSF
(POLARITY = 1)
tDAV
tDF tDR
tDSU
07079-030
tDHD
图 3. SPI 主机定时(相位模式=1)
表 4. SPI 主机定时(相位模式=0)
参数 描述 最小值 典型值 最大值 单位
tSL SCLOCK 低电平脉冲宽度 (SPIDIV + 1)×tHCLK ns
tSH SCLOCK 高电平脉冲宽度 (SPIDIV + 1)×tHCLK ns
tDAV SCLOCK 边沿之后数据输出有效 25 ns
tDOSU SCLOCK 边沿之前数据输出建立 90 ns
tDSU SCLOCK边沿之前数据输入建立时间 1 1×tUCLK ns
tDHD SCLOCK边沿之后数据输入保持时间1 2×tUCLK ns
tDF 数据输出下降时间 30 40 ns
tDR 数据输出上升时间 30 40 ns
tSR SCLOCK 上升时间 30 40 ns
tSF SCLOCK 下降时间 30 40 ns
1
tUCLK = 97.6 ns。它对应于由PLL产生的10.24MHz内部时钟。
SCLOCK
(POLARITY = 0)
tSH
tSL
tSR tSF
SCLOCK
(POLARITY = 1)
tDAV
tDOSU
tDF tDR
tDSU
07079-031
tDHD
图 4. SPI 主机定时(相位模式=0)
表 5. SPI 从机定时(相位模式=1)
参数 描述 最小值 典型值 最大值 单位
t CS到SCLOCK边沿 1 (2×tHCLK)+(2×tUCLK) ns
CS
tSL SCLOCK 低电平脉冲宽度 (SPIDIV + 1)×tHCLK ns
tSH SCLOCK 高电平脉冲宽度 (SPIDIV + 1)×tHCLK ns
tDAV SCLOCK 边沿之后数据输出有效 40 ns
tDSU SCLOCK边沿之前数据输入建立时间 1 1×tUCLK ns
tDHD SCLOCK边沿之后数据输入保持时间 1 2×tUCLK ns
tDF 数据输出下降时间 30 40 ns
tDR 数据输出上升时间 30 40 ns
tSR SCLOCK 上升时间 1 ns
tSF SCLOCK 下降时间 1 ns
tSFS CS在 SCLOCK 边沿后变高 0 ns
1
tUCLK = 97.6 ns。它对应于由PLL产生的10.24MHz内部时钟。
CS
tCS tSFS
SCLOCK
(POLARITY = 0)
tSH
tSL
tSR tSF
SCLOCK
(POLARITY = 1)
tDSU
07079-032
tDHD
图 5. SPI 从机定时(相位模式=1)
CS
tCS tSFS
SCLOCK
(POLARITY = 0)
tSH tSL
tSR tSF
SCLOCK
(POLARITY = 1)
tDAV
tDOCS
tDF tDR
tDSU
07079-033
tDHD
图 6. SPI 从机定时(相位模式=0)
绝对最大额定值
TA=−40°C to +125°C(除非另有说明)。
表 7.
注意,超出上述绝对最大额定值可能会导致器件永久性损
参数 额定值
坏。这只是额定应力值,不涉及器件在这些或任何其它条
AGND 至 DGND 至 AVDD 至 DVDD -0.3 V 至+0.3 V
件下超出本技术规格指标的功能性操作。长期在绝对最大
数字 I/O 电压至 DGND -0.3 V 至+3.3 V 额定值条件下工作会影响器件的可靠性。
VREF±至 AGND −0.3 V 至 AVDD + 0.3 V
ADC 输入至 AGND −0.3 V 至 AVDD + 0.3 V
ESD(人体模型)额定值 ESD 警告
所有引脚 ±2 kV ESD(静电放电)敏感器件。
存储温度 125℃ 带电器件和电路板可能会在没有察觉的情况
下放电。尽管本产品具有专利或专有保护电
结温
路,但在遇到高能量 ESD 时,器件可能会损
瞬时 150°C 坏。因此,应当采取适当的 ESD 防范措施,
连续 130℃ 以避免器件性能下降或功能丧失。
引脚温度
回流焊(15 秒) 260℃
引脚配置和功能描述
P2.0/IRQ2/PWM0/EXTCLK
P2.1/IRQ3/PWM5
P0.4/IRQ0/PWM1
P1.6/PWM4
P1.5/PWM3
P1.4/PWM2
NTRST/BM
DGND
DVDD
TDO
TCK
TDI
48
47
46
45
44
43
42
41
40
39
38
37
RESET 1 36 XTALI
PIN 1
TMS 2 INDICATOR 35 XTALO
P1.0/IRQ1/SIN/T0 3 34 P0.3/MOSI/SDA
P1.1/SOUT 4 33 P0.2/MISO
P1.2/SYNC 5 32 P0.1/SCLK/SCL
P1.3/TRIP 6 ADuC7060 31 P0.0/SS
P0.5/CTS 7 30 DVDD
TOP VIEW
P0.6/RTS 8 (Not to Scale) 29 DGND
DVDD 9 28 ADC9
DGND 10 27 ADC8
DAC0 11 26 ADC7
ADC5/EXT_REF2IN− 12 25 ADC6
13
14
15
16
17
18
19
20
21
22
23
24
IEXC1
IEXC0
VREF+
VREF−
AGND
AVDD
GND_SW
ADC3
ADC2
ADC1
ADC0
ADC4/EXT_REF2IN+
07079-002
NOTES
1. THE LFCSP_VQ ONLY HAS AN EXPOSED PADDLE THAT MUST BE LEFT UNCONNECTED.
THIS DOES NOT APPLY TO THE LQFP.
表 8. ADuC7060 引脚功能描述
1
引脚编号 名称 类型 描述
0 EP 底部焊盘。可以接地或悬空。LQFP 封装没有底部焊盘。
1 RESET I 复位。输入引脚(低电平有效)。建议将该引脚与一个 1 kΩ 的外部上拉电阻相连。
JTAG 测试模式选择。输入引脚,用于调试或者下载。应在该引脚处增加一个约 100 kΩ
2 TMS I
的外部上拉电阻。
P1.0/IRQ1/SI 通用输入输出 P1.0/外部中断请求 1/串行输入/定时器 0 输入。这是一个多功能输入输
3 I/O
N/T0 出引脚,可提供四种功能。
4 P1.1/SOUT I/O 通用输入输出 P1.1/串行输出。这是一个双功能输入/输出引脚。
5 P1.2/SYNC I/O 通用输入输出 P1.2/PWM 外部同步输入。这是一个双功能输入/输出引脚。
6 P1.3/TRIP I/O 通用输入输出 P1.3/PWM 外部触发输入。这是一个双功能输入/输出引脚。
7 P0.5/CTS I/O 通用输入输出 P0.5/UART 模式下清除发送信号。
8 P0.6/RTS I/O 通用输入输出 P0.6/UART 模式下清除发送信号。
9 DVDD S 数字电源引脚。
10 DGND S 数字地。
11 DAC0 O DAC 输出。模拟输出引脚。
P2.0/IRQ2/PWM0
P0.4/IRQ0/PWM1
NTRST/BM
DGND
DVDD
TDO
TCK
TDI
25
32
31
30
29
28
27
26
RESET 1 PIN 1 24 XTALI
INDICATOR
TMS 2 23 XTALO
P1.0/IRQ1/SIN/T0 3 22 P0.3/MOSI/SDA/ADC9
P1.1/SOUT 4 ADuC7061 21 P0.2/MISO/ADC8
DAC0 5 TOP VIEW 20 P0.1/SCLK/SCL/ADC7
ADC5/EXT_REF2IN− 6 (Not to Scale) 19 P0.0/SS/ADC6
ADC4/EXT_REF2IN+ 7 18 VREF–
ADC3 8 17 VREF+
9
10
11
12
13
14
15
16
IEXC1
IEXC0
AGND
GND_SW
AVDD
ADC2
ADC1
ADC0
NOTES
07079-003
1. THE 32-LEAD LFCSP_VQ HAS AN EXPOSED PADDLE. THIS EXPOSED
PADDLE MUST BE LEFT UNCONNECTED.
图 8. 32 引脚 LFCSP 的引脚配置
表 9. ADuC7061 引脚功能描述
1
引脚编号 名称 类型 描述
0 EP 底部焊盘。可以接地或悬空。
1 RESET I 复位引脚。输入引脚(低电平有效)。建议将该引脚与一个 1 kΩ 的外部上拉电
阻相连。
2 TMS I JTAG 测试模式选择。输入引脚,用于调试或者下载。应在该引脚处增加一个
约 100 kΩ 的外部上拉电阻。
3 P1.0/IRQ1/SIN/T0 I/O 通用输入输出 P1.0/外部中断请求 1/串行输入/定时器 0 输入。这是一个多功能
输入输出引脚,可提供四种功能。
4 P1.1/SOUT I/O 通用输入输出 P1.1/串行输出。这是一个双功能输入/输出引脚。
5 DAC0 O DAC 输出。模拟输出引脚。
6 ADC5/EXT_REF2IN− I 单端或差分模拟输入 5/外部基准负输入端.这是一个双功能模拟输入引脚。
ADC5 为辅助 ADC 提供模拟输入。EXT_REF2IN−可为辅助通道提供 ADC 外部
基准负输入。
7 ADC4/EXT_REF2IN+ I 多功能模拟输入引脚。该引脚可作为单端或差分模拟输入端,为辅助 ADC 提
供模拟输入 4;另外,它还可以为辅助通道提供外部基准正输入电压。
8 ADC3 I 单端或差分模拟输入 3。为主 ADC 和辅助 ADC 提供模拟输入。
9 ADC2 I 单端或差分模拟输入 2。为主 ADC 和辅助 ADC 提供模拟输入。
10 IEXC1 O 可编程电流源模拟输出引脚。
11 IEXC0 O 可编程电流源模拟输出引脚。
12 GND_SW I 切换至内部模拟地基准。不用时,直接接到 AGND 系统地。
13 ADC1 I 单端或差分模拟输入 1。为主 ADC 提供模拟输入。为主 ADC 提供负差分输入。
14 ADC0 I 单端或差分模拟输入 0。为主 ADC 提供模拟输入。为主 ADC 提供正差分输入。
15 AGND S 模拟地。
16 AVDD S 模拟电源引脚。
17 VREF+ I 为主通道提供外部基准正输入。模拟输入引脚。
18 VREF− I 为主通道提供外部基准负输入。模拟输入引脚。
19 P0.0/SS/ADC6 I/O 通用输入输出 P0.0/SPI 从机选择(低电平有效)/辅助 ADC6 输入引脚。这是一
个多功能输入/输出引脚。单端或差分模拟输入 6。为辅助 ADC 提供模拟输入。
20 P0.1/SCLK/SCL/ADC7 I/O 通用输入输出 P0.1/SPI 时钟/I2C 时钟/辅助 ADC7 输入引脚。这是一个多功能输
入/输出引脚。单端或差分模拟输入 7。为辅助 ADC 提供模拟输入。
1
I = 输入,O = 输出,I/O = 输入/输出,S = 电源。
ARM7DMI 内核概览
ARM7®内核是一款由 ARM®公司开发的 32 位精简指令集 ARM7 异常
计算机(RISC)。ARM7TDMI 采用冯诺依曼架构,指令
ARM7 支持 5 种类型的异常,每种类型分别对应一种优先
和数据使用单 32 位总线。它支持 8 位、16 位和 32 位数据
处理模式。这 5 种异常类型为:
长度,指令字长度可为 16 位或 32 位,具体的位数取决于
第一种类型:正常中断或 IRQ。这种异常用于内、外部事
内核的工作模式。
件的通用中断处理。注意,ADuC706x 为所有 IRQ 源提供
ARM7TDMI采用ARM7 内核,具有四种附加特性,如 表
8 个可配置的优先级。
240 H
10 所列。
第二种类型:快速中断或 FIQ。这种异常用于数据传输或
表 10. ARM7TDMI 特性 低延迟通信通道处理。FIQ 的优先级高于 IRQ。注意,
特性 描述 ADuC706x 为所有 FIQ 源提供 8 个可配置的优先级。
T 支持 Thumb®指令集(16 位) 第三种类型:存储器中止(预取和数据)。
D 支持调试
第四种类型:企图执行未定义指令。
M 增强乘法器
I 包含 EmbeddedICE®模块,以支持嵌入式系统调试 第五种类型:软件中断(SWI)指令,用于调用操作系统。
一般情况下,程序员将中断定义为 IRQ,但要获得优先级
THUMB 模式(T)
更高的中断,可将中断定义为 FIQ 类型。
一条 ARM 指令的长度为 32 位。ARM7TDMII 处理器支持
异常优先级及其矢量地址见 表 11。
第二个指令集,该指令集被压缩成 16 位,称为 thumb 指令
241H
R4
R5
11)。
R6 0xFFFFFFFF
MMRs
R7
R8_FIQ 0xFFFF0000
R8
R9_FIQ
R9 RESERVED
R10_FIQ
R10
R11_FIQ R13_UND 0x00087FFF
R11 R13_IRQ FLASH/EE
R12_FIQ R13_ABT R14_UND
R12 R13_SVC R14_IRQ 0x00080000
R13_FIQ R14_ABT
R13 R14_SVC RESERVED
R14_FIQ
R14
R15 (PC) 0x00040FFF
SRAM
SPSR_UND 0x00040000
SPSR_IRQ
SPSR_ABT
CPSR SPSR_SVC RESERVED
SPSR_FIQ
07079-004
0x00007FFF
07079-005
FIQ SVC ABORT IRQ UNDEFINED REMAPPABLE MEMORY SPACE
USER MODE MODE MODE MODE MODE MODE
0x00000000 (FLASH/EE OR SRAM)
图 9.寄存器结构图
图 10.存储器映射图
中断延迟 BIT 31 BIT 0
地址: 0xFFFF0E08
默认值: 0x07
访问类型: 读、写
0x07 保留 保留。
0x08 保留 保留。
0x09 保留 保留。
0x0A 保留 保留。
0x0B 签名 处理器运行该命令后,会产生一个基于 LFSR(线性反馈移位寄存器)的 24 位签名,该签名
将被写入 FEESIGN 寄存器。此项操作需要 16,389 个时钟周期。
0x0C 保护 该命令只能执行一次。FEEPRO 的值会被保留;只有通过执行批量擦除命令(0x06)或者密
钥才能清除该值。
0x0D 保留 保留。
0x0E 保留 保留。
0x0F Ping 无操作;中断产生。
1
当任一上述命令执行完毕,FEECON寄存器立即读取0x07。
FEEPRO寄存器在寄存器复位后提供保护。它需要一个软 批量擦除命令执行序列
件密钥(见 表 16)。
256H
FEExDAT=0x3CFF
名称: FEEPRO FEEADR=0x77C3;
FEEMOD=FEEMOD|0x8; //Erase key enable
地址: 0xFFFF0E1C FEECON=0x06; //Mass erase command
默认值: 0x00000000
访问类型: 读、写
0xFFFF0D50
寄存器空间为CPU和所有片内外设提供接口。除了内核寄 GPIO
0xFFFF0D00
存器,所有的寄存器都位于寄存器区域内。图 12 内的阴影
258H
0xFFFF0A14
SPI
区域为未占用区域或保留区域,不允许用户程序访问该区 0xFFFF0A00
域。表 12 为所有寄存器存储器映像。
259H 0xFFFF0948
I2C
0xFFFF0900
读取或写入一个寄存器所需的存取时间取决于高级微控制
0xFFFF0730
器总线结构(AMBA)总线,该总线可用来访问外围设备。 0xFFFF0700
UART
0xFFFF0470 SPI/I2C
SELECTION
0xFFFF0450
0xFFFF0394 GENERAL-PURPOSE
TIMER
0xFFFF0380
0xFFFF0370 WATCHDOG
TIMER
0xFFFF0360
0xFFFF0350 WAKE-UP
TIMER
0xFFFF0340
0xFFFF0334 GENERAL-PURPOSE
TIMER
0xFFFF0320
0xFFFF0140
07079-007
INTERRUPT
CONTROLLER
0xFFFF0000
图 12.存储器映射寄存器
表 18. 系统控制基地址=0xFFFF0200
式配置位(ADCLPMCFG[1:0])的说明。
0x0534 ADC0RCR 2 R/W 0x0001 主 ADC 结果计数器/重载入寄存器。
0x0538 ADC0RCV 2 R 0x0000 主 ADC 结果计数器寄存器。
0x053C ADC0TH 2 R/W 0x0000 主 ADC 16 位比较器阈值寄存器。
0x0540 ADC0THC 2 R/W 0x0001 主 ADC 16 位比较器阈值计数器限值。
0x0544 ADC0THV 2 R 0x0000 ADC0 8 位阈值超过计数器寄存器
0x0548 ADC0ACC 4 R 0x00000000 主 ADC 累加器。
0x054C ADC0ATH 4 R/W 0x00000000 主 ADC 32 位比较器阈值寄存器。
0x0570 IEXCON 1 R/W 0x00 激励电流源控制寄存器。
1
被内核更新为特定器件校准值。
源;可由用户代码对该寄存器进行写操作, 1 看门狗超时。
以启动软件复位。 发生看门狗超时时,该位自动置 1。
通过设置 RSTCLR 寄存器内的相应位,可将该位
清 0。
0 上电复位。
发生上电复位时,该位自动置位。
通过设置 RSTCLR 寄存器内的相应位,可将该位
清 0。
1
如果RSTSTA的软件复位位已设,任何不将此位清0的RSTCLR写入操
作都会产生软件复位。
表 30. 器件复位含义
将外部引脚复 复位所有外部寄存器 复位看门 RSTSTA 状态
复位 位到默认状态 内核执行 (不包括 RSTSTA) 复位外设 狗定时器 RAM 有效 (复位事件后)
POR 是 是 是 是 是 是/否 RSTSTA[0]=1
看门狗 是 是 是 是 否 是 RSTSTA[1]=1
软件 是 是 是 是 否 是 RSTSTA[2]=1
外部引脚 是 是 是 是 否 是 RSTSTA[3]=1
振荡器、锁相环和电源控制
时钟系统 为了避免晶振失振,应该使用看门狗定时器。在初始化期
ADuC706x 系列产品内部集成了一个 32.768 kHz 振荡器 间,通常应对 RSTSTA 进行测试,以判断是否有来自看门
(误差在±3%范围内)、一个时钟分频器和一个锁相环 狗定时器的复位信号。
(PLL)。PLL 将内部振荡器或一个外部 32.768 KHz 晶振
外部时钟选择
的倍数频率锁定,为系统提供一个稳定的 10.24 MHz 时钟
(UCLK)。为了省电,内核可以工作在这个频率下,或这 如果需要使用外部时钟,必须将 P2.0 配置为模式 0。外部
个频率的 1/2n。内核的实际工作频率 UCLK/2CD,称为 HCLK。 时钟频率最高可达 20.48 MHz,容差为 1%。外部时钟在器
默认的内核时钟分频为 8 分频(CD=3),或 1.28 MHz, 件内部被 2 分频。
XCLKO
源代码示例
WATCHDOG INT. 32kHz CRYSTAL
TIMER OSCILLATOR* OSCILLATOR XCLKI T1LD=0x80;
WAKE-UP OCLK T1CON=0xC0;
TIMER
IRQEN |= 0x10; // Enable Timer1 interrupt
32.768kHz
PLLKEY1=0xAA; // Switch to external clock
10.24MHz PLLCON=0x4;
PLL P2.0/EXTCLK
PLLKEY2=0x55;
UCLK ANALOG
POWKEY1=0x1; // Enter NAP mode
I2C PERIPHERALS POWCON0=0x73;
POWKEY2=0xF4;
CD /2CD
CORE HCLK 时钟源的选择是由 PLLCON 寄存器控制的。默认情况下,
07079-008
图 13.时钟系统 电源控制系统
外部晶振选择 通过写 POWCON0 寄存器,可以改变内核时钟频率。这是
一个重要的保护寄存器;因此,在设置 POWCON0 寄存器
在用外部晶振时,用户必须遵循如下程序:
之前和之后都必须立即对寄存器 POWKEY1 和 POWKEY2
1. 使能 Timer1 中断,并将其超时周期设置为大于 120μs。 进行写操作。下面将举例说明如何将内核时钟频率设置为
2. 根据 PLLCON 寄存器的写时序要求,将 OSEL 位设置 10.24MHz:
为[10]且清除 EXTCLK 位。
POWKEY1=0x1;
3. 按照 POWCON 寄存器的正确写时序,强制器件进入 POWCON0=0x78; //Set core to max CPU
浅休眠模式。 //speed of 10.24 MHz
4. 当器件从浅休眠模式被定时器 1 中断源唤醒后,时钟 POWKEY2=0xF4;
源已经切换到外部晶振了。 ADuC706x提供了多种工作模式。表 33 描述了各个模式下
268H
上电的器件及上电时间。
源代码示例
表 34 给出了在不同时钟分频位决定的各模式的总的电流
T1LD=0x80; // 32,768 clock ticks
269H
访问类型: 写 访问类型: 写
名称: POWKEY4
地址: 0xFFFF043C
默认值: 0xXXXX
访问类型: 写
ADC 电路信息
AVDD VREF+ VREF– DAC0
INTERNAL BUF
REFERENCE DAC
IEXC0 CONVERSION
AVDD COUNTER
IEXC1
50µA O/C
DETECT AUX_REFP
ADC0 AUX_REFM OVERRANGE
Σ-Δ PROGRAMMABLE
MODULATOR FILTER
PGA
CHOP INTERFACE
MUX AND CONTROL TO ARM
0.2mA TO 1mA
0.2Hz TO 8kHz
Σ-Δ PROGRAMMABLE
BUF MODULATOR FILTER
ADC2
ADC3
ADC4
ADC5
ADC6
ADC9
CHOP
GND_SW MUX
50Ω
AGND TEMPERATURE
SENSOR
07079-009
图 14.模拟模块框图
表 37. 主 ADC-在正常状态下典型输出均方根有效位数(括号内为峰峰位)
输入电压噪声(单位:mV)
ADC 寄存 数据更
器状态 新速率 ±1.2 V ±600 mV ±300 mV ±150 mV ±75 mV ±37.5 mV ±18.75 mV ±9.375 mV ±4.68 mV ±2.34 mV
(PGA=1) (PGA=2) (PGA=4) (PGA=8) (PGA=16) (PGA=32) (PGA=64) (PGA=128) (PGA=256) (PGA=512)
斩波开启 4 Hz 21.9 20.8 21.7 21.4 20.9 20.8 20.2 19.1 18.2 17.1
(19.1 峰峰) (18.1 峰峰) (19.0 峰峰) (18.7 峰峰) (18.2 峰峰) (18.1 峰峰) (17.4 峰峰) (16.4 峰峰) (15.4 峰峰) (14.4 峰峰)
斩波关闭 50 Hz 20.2 19.3 20.0 19.6 19.1 19.0 18.2 17.3 16.6 15.5
(17.5 峰峰) (16.6 峰峰) (17.3 峰峰) (16.9 峰峰) (16.4 峰峰) (16.2 峰峰) (15.5 峰峰) (14.6 峰峰) (13.8 峰峰) (12.8 峰峰)
斩波关闭 1 kHz 18.1 17.1 17.8 17.5 17.0 16.8 16.1 15.1 14.0 13.1
(15.3 峰峰) (14.4 峰峰) (15.1 峰峰) (14.8 峰峰) (14.2 峰峰) (14.1 峰峰) (13.4 峰峰) (12.3 峰峰) (11.3 峰峰) (10.4 峰峰)
斩波关闭 8 kHz 15.4 14.4 15.4 15.2 15.0 14.9 14.4 13.4 13.3 12.3
(12.7 峰峰) (11.7 峰峰) (12.6 峰峰) (12.5 峰峰) (12.3 峰峰) (12.2 峰峰) (11.7 峰峰) (10.7 峰峰) (10.6 峰峰) (9.6 峰峰)
AVDD R1
参阅对 ADC0CON(ADC0 控制寄存器的 ADC0REF[1:0] VIN =
ADC0,
ADC1
位)的说明。 A B ADC1 (–)
R2
如需了解为辅助 ADC 设置外部基准电压源的详细说明,
07079-010
预设阈值的次数。另外,当阈值计数器的值达到预设值
主 ADC 的所有结果就绪位在 ADC0DAT 寄存器读取后即
(ADC0RCR)后,将产生 ADC 中断。
被清 0。如果主通道 ADC 处于禁用状态,那么所有 ADC
最后,还可通过控制 ADCCFG[6:5]位来设置集成的 32 位 结果就绪位将在读取 ADC1DAT 寄存器后被清 0。为了确
累加器(ADC0ACC),从而允许主 ADC 将多个采样结果 保主 ADC 和辅助 ADC 的输出数据是同步的,用户代码应
相加或相减。用户代码可直接读取累加值(ADC0ACC), 先读取 ADC1DAT 寄存器,再读取 ADC0DAT 寄存器。只
而不需要任何进一步的软件处理。 有先将对应的 ADC 结果就绪位清 0,才能将新的 ADC 转
换结果写入到 ADCxDAT 寄存器中。这条规则的唯一例外
温度传感器
情况是,数据转换结果正好在 ARM 内核断电时更新。在
ADuC706x 系列产品提供从片内带隙基准电压输出并与绝 此模式下,即使没有将就绪位清 0,ADCxDAT 寄存器仍
对温度成比例的电压。该电压还可以通过辅助 ADC 前端多 保存最近一次的 ADC 转换结果。
路复用器有效地连接到 ADC,构成一个附加的 ADC 输入
通道,这样就可以很方便地形成一个内部温度传感器通道, ADC 状态寄存器
用于测量芯片温度。 名称: ADCSTA
内部温度传感器的设计初衷不是作为绝对环境温度计算 地址: 0xFFFF0500
器。它用来作为 AduC706x 裸片温度的近似指示器。
默认值: 0x0000
典型温度系数为 0.28 mV/°C。 访问类型: 只读
140
功能: 该只读寄存器用于保存与 ADuC706x ADC
120
工作模式或电流状态相关的一般状态信息。
100
ADC OUTPUT (mV)
80
60
40
20
0
–60 –40 –20 0 20 40 60 80 100 120 140
07079-034
TEMPERATURE (°C)
名称: ADCMSKI
地址: 0xFFFF0504
默认值: 0x0000
访问类型: 读、写
功能: 该寄存器可单独使能 ADC 中断源。此寄存器的位位置与 ADCSTA 寄存器的低八位相同。若一位由用户代
码置 1,相应中断使能。默认情况下,所有位为 0,表示禁用所有 ADC 中断源。
ADC 模式寄存器
名称: ADCMDE
地址: 0xFFFF0508
默认值: 0x03
访问类型: 读、写
功能: ADC 模式寄存器是一个 8 位寄存器,用于配置 ADC 子系统的工作模式。
主 ADC 控制寄存器
名称: ADC0CON
地址: 0xFFFF050C
默认值: 0x8000
访问类型: 读、写
功能: 主通道 ADC 控制寄存器是一个 16 位寄存器。通过 ADC0CON 对主 ADC 进行重配置后,辅助 ADC 也将
复位。
ADC 滤波器寄存器
名称: ADCFLT
地址: 0xFFFF0514
默认 值:0x0007
访问类型: 读、写
功能: ADC 滤波器寄存器是一个 16 位寄存器,用于控制两个片内 ADC 的速度和分辨率。注意,修改 ADCFLT
将导致主 ADC 和辅助 ADC 复位。
用于计算Sinc3 滤波器的输出速度:
fADC=(512,000/([SF + 1]×64))Hz 2 3F
1
由于受数字滤波器内部数据路径的限制,用来产生所需 ADC 输出速率的 Sinc3 抽取系数(SF)和平均系数(AF)的组合也有限制。此约束在正常功耗
模式下将最低 ADC 更新速率限制为 4Hz,在更低功耗模式下将其限制为 1Hz。
2
在低功耗模式下,ADC由低功耗振荡器(131kHz)直接驱动,而不是由512kHz时钟驱动。计算fADC时,应(约)除以4。
无 无 无 512,000 131,072 3
[SF + 1]× 64 [SF + 1]× 64 f ADC
无 无 有 512,000 131,072 4
[SF + 1]× 64 [SF + 1]× 64 f ADC
无 有 无 512,000 131,072 1
[SF + 1]× 64 × [3 + AF ] [SF + 1]× 64 × [3 + AF ] f ADC
无 有 有 512,000 131,072 2
[SF + 1]× 64 × [3 + AF ] [SF + 1]× 64 × [3 + AF ] f ADC
有 不可用 不可用 512,000 131,072 2
[SF + 1]× 64 × [3 + AF ] + 3 [SF + 1]× 64 × [3 + AF ] + 3 f ADC
1
在进行第一次模数转换前,每个ADC需要约60 μs的额外时间。
表 47. SF 和 AF 的允许组合
AF 范围
SF 0 1至7 8 至 63
0 至 31 有 有 有
32 至 63 有 有 无
64 至 127 有 无 无
名称: ADCCFG
地址: 0xFFFF0518
默认值: 0x00
访问类型: 读、写
功能: 该 8 位 ADC 配置寄存器用于控制与片内 ADC 相关的扩展功能。
15:8 保留。 位 描述
名称: ADC0ATH 位 描述
默认值: 0x00000000
访问类型: 读、写
功能: 该 32 位寄存器用于保存主通道累加器比较
器的阈值。当 ADC0ACC 中的累加器的值大
于 ADC0ATH 中 的 值 时 , ADCSTA 中 的
ADC0ATHEX 位被置位。在此情况下,如果
ADCMSKI 的相应位也使能,则将产生中断。
INTERRUPT
(ADC0OVR)
FAST
OVERRANGE (READABLE)
ADC0 16 32
PRIMARY ADC0ACC
ADC fADC ACCUMULATOR
ADC1
≥ INTERRUPT
fADC (ADC0ATHEX)
(READABLE)
ADC0ATH
|ABSVAL|
ADC0RCV
CLEAR COUNTER
≥ INTERRUPT ≥ ADC0THV
fADC (ADC0RDY) UP/DOWN
fADC
ADC0RCR OPTION: UP/RESET INTERRUPT
ADC0TH ≥
(DEFAULT = 1) (ADC0THEX)
07079-011
ADC0THC
应用电路示例
图 18 显示了ADuC706x上的一个简单的桥式传感器接口,
278H 外部 1.2V基准器件;也可用内部基准电压源来代替它。热
包括模拟输入通道上的RC滤波器。注意,桥式传感器上的 电偶与主ADC相连,为ADC0/ADC1 提供差分输入。注意:
传感线(与基准输入端相连)分别与不同的激励线(接至 位于 VREF+ 和 ADC1 之间的电阻可将 ADC 输入信号偏置
DVDD/AVDD和地)相连。因此,共有六根线与桥式传感 100 mV以上。
器相连。六线连接是大多数现有桥式传感器(如称重传感 图 20 显示了一个简单的四线 RTD接口电路。 图 18 中显
280H 281H
器)的特性之一,借助该特性,可将由线阻抗引起的误差 示了一个桥式传感器,在此基础上,如再连接一个电源
降至最低。 且通过串口与一外部器件相连,则构成一个完整的系统
在 图 19 中,AD592 是一个外部温度传感器,用于测量热
279H (如 图 20)。 28H
电偶的冷端,其输出端与辅助通道相连。ADR280 是一个
ADuC7060/ ADuC7060/
ADuC7061 ADuC7061
+2.5V +2.5V
AVDD/DVDD IEXC1 AVDD/DVDD
VREF+
ADC0
SPI SPI
ADC0 I2C RTD I2C
UART UART
ADC1 GPIO ADC1 GPIO
VREF– VREF+
AGND/DGND
07079-012
VREF– AGND/DGND
07079-014
图 18.桥式接口电路 图 20. RTD 接口电路示例
ADuC7060/
ADuC7061
+2.5V
ADC0 AVDD/DVDD
ADC1
SPI
I2C
UART
AD592 ADC4 GPIO
ADR280 VREF+
VREF– AGND/DGND
07079-013
图 19.热电偶接口电路示例
DAC 外设
DAC 运算放大器模式
ADuC706x 集成了一个片内电压输出 DAC。在正常模式下, 作为一个选项,可禁用 DAC,它的输出缓冲器可以起到运
DAC 的分辨率为 12 位。在插值模式下,DAC 的分辨率为 算放大器的作用。
16 位(14 个有效位)。DAC 有一个轨到轨电压输出缓冲
器(驱动能力为 5 kΩ/100 pF)。 寄存器接口
DAC 的 4 个可选电压范围包括: DAC 可通过一个控制寄存器和一个数据寄存器进行配置。
和增益误差忽略不计)。图 21 中的虚线为理想的传递函数,
名称: DAC0DAT
284H
实线代表转换可能具有端点非线性(由输出放大器饱和引
地址: 0xFFFF0604
起)的传递函数。注意,图 21 仅代表输入范围为 0 至AVDD 285H
11:0 保留。
DAC 的用法
片内 DAC 架构由一电阻串 DAC 和一个输出缓冲放大器
构成。
用户可通过软件来选择 DAC 基准电压源。AVDD、VREF±
100mV
或者 ADCx/EXT_REF2IN±均可作为 DAC 基准电压源。
07079-015
0x00000000 0x0FFF0000
● 在 0 至 AVDD 模式下,DAC 输出传递函数在 AVDD
引脚上的范围为 0 V 至 AVDD; 图 21.放大器饱和引起的端点非线性
传递函数为负输入引脚电压至正输入引脚电压。注意, 大多数ADuC706x数据手册中,正常模式下的DAC输出特
上述电压不得低于 0 V 或高于 AVDD。 性指标都是在DAC输出与一个接地的 5 kΩ电阻负载相连
● 在 0 至 VREF 模式时,DAC 输出传递函数为 0 至 1.2 V 内 的条件下得到的。由于DAC输出被强制提供更多的源电流
部基准电压源 VREF。 或吸电流,图 21 中的顶部或底部非线性区域将变得更大。
287H
而当需要更大电流时,这会明显地限制输出电压摆幅。
DAC 可被配置为以下三种不同的用户模式:正常模式、
DAC 插值模式和运算放大器模式。 DAC 插值模式
RETENTION (Years)
450
成的 Flash/EE 存储器,用户可以在线更新程序代码空间,
而不必在远程操作节点处替换一次性可编程(OTP)设备。
300
ADuC706x 内置一个 32KB 的 Flash/EE 存储器阵列,其中
低 30KB 可供用户使用,高 2KB 包含永久性嵌入式固件,
150
支持在线串行下载。另外,这 2KB 嵌入式固件还包括上电
配置程序,用于将出厂标定系数下载到各种已校准的外设,
0
07079-016
30 40 55 70 85 100 125 135 150
如 ADC、温度传感器、带隙基准电压源等。用户代码不允
JUNCTION TEMPERATURE (°C)
许访问这 2KB 嵌入式固件。
图 22. Flash/EE 存储器数据保持期
FLASH/EE 存储器可靠性
编程
器件上的 Flash/EE 存储器阵列有两个关键的特性:Flash/EE
在串行下载模式或 JTAG 模式下,可对 Flash/EE 存储器中
存储器周期耐久性和 Flash/EE 存储器数据保持力。
的 30KB 区域进行在线编程。
耐久性用于衡量 Flash/EE 存储器重复多个编程、读取及擦
除周期的能力。一个单耐久性周期包括 4 个独立的、连续
串行下载(在线编程)
的事件,定义如下: ADuC706x 可利用标准 UART 串行端口下载代码。当器件
● 初始页面擦除时序 复位或上电时,如果 NTRST/BM引脚的电平被 1 kΩ 外接
电阻下拉至低电平,则器件将进入串行下载模式。在串行
● 读/校验时序(单个 Flash/EE)
下载模式下,用户可以向 Flash/EE 的整个 30 Kb Flash/EE
● 存储器的字节编程时序
存储器空间内下载代码(尽管该器件在其目标应用硬件中
● 二次读/校验时序(耐久性周期)
为在线状态)。由开发系统提供的借助通用异步串口进行
在进行可靠性验证时,Flash/EE 存储器中的三页(顶、中、 串行下载的功能也支持 PC 串行下载。
底)的每半个字(16 位宽)可循环存取 10000 次(从 0x0000
当 ADuC706x 进入下载模式后,超时周期为 2 分钟的内部
至 0xFFFF)。Flash/EE 存储器耐久力是根据 JEDEC 保持
看门狗将被使能。如果 Flash 擦/写时序无法在该周期内完
期限规格 A117 在−40°C 至+125°C 工业温度范围内测量出
成,器件将复位。
来的。这个结果满足给定温度下最小耐久性超过 10,000 个
周期的规格。 JTAG 访问
保持期衡量Flash/EE存储器长时间保持编程数据的能力。 JTAG 协议允许借助片内 JTAG 接口进行代码下载和调试。
同样,在具体结温(TJ=85°C)下根据标准JEDEC保持期限
规格A117 对器件进行测试。作为此测试程序的一部分,如
处理器相关外设
中断系统 IRQ
ADuC706x 有 15 个中断源,各个中断源由中断控制器来控 中断请求(IRQ)是通知处理器进入 IRQ 模式的一个异常
制。除用户可编程的软件中断(SWI)外,其余中断均由 信号。它用于内、外部事件的通用中断处理。
片内外设产生。ARM7TDMI CPU 内核只能识别以下两类 所 有 的 32 个 位 经 过 逻 辑 “ 或 ” 运 算 后 , 形 成 要 发 送 给
中断:正常中断请求(IRQ)和快速中断请求(FIQ)。所 ARM7TDMI 内核的 IRQ 信号。器件有 4 个专门用于 IRQ
有中断都可以被单独屏蔽。 的 32 位寄存器。对各个寄存器的说明如下:
器件内部有许多用于控制和配置中断系统的寄存器。每一
IRQSIG
个 IRQ 寄存器和 FIQ 寄存器中的控制位都代表相同的中断
源,如 表 65 所示。
289H
IRQSIG 反映不同 IRQ 源的状态。如果一个外设产生了一
个 IRQ 信号,IRQSIG 中相应的位就会被置 1;否则就会被
ADuC706x 提供一个矢量中断控制器(VIC),用于支持中
清 0。当特定外设的中断请求取消时,IRQSIG 的位就会被
断嵌套(最高可达 8 级嵌套)。此外,VIC 还可以让编程
清 0。通过设置 IRQEN 寄存器,可屏蔽所有 IRQ 中断源。
人员为所有中断源指定优先级。通过设置 IRQCONN 寄存
IRQSIG 为只读寄存器。
器的 ENIRQN 位,可以启用中断嵌套功能。当整个矢量中
断控制器被使能后,需额外用到大量寄存器。 IRQSIG 寄存器
当内核开始执行中断服务程序( ISR )后,应立即保存 名称: IRQSIG
IRQSTA/FIQSTA,以确保能够响应所有有效中断。
地址: 0xFFFF0004
表 65. IRQ/FIQ 寄存器位功能描述 默认值: 未定义
位 描述 备注 访问类型: 只读
0 所有中断的逻辑或 任意 FIQ 激活时,该
(限 FIQ) 位置 1。 IRQEN
1 软件中断 用户可编程中断源。 IRQEN 提供了当前使能屏蔽值。将该寄存器的某一位置 1,
2 未定义 该位未使用。 可使能相应的中断请求,此时将产生 IRQ 异常。将某一位
3 定时器 0 通用定时器 0。 清 0,可禁用或屏蔽相应的中断请求,此时将无法产生 IRQ
4 定时器 1 或 通用定时器 1 或 异常。IRQEN 寄存器不可用来禁用中断。
唤醒定时器 唤醒定时器。
5 定时器 2 或 通用定时器 2 或 IRQEN 寄存器
看门狗定时器 看门狗定时器。
名称: IRQEN
6 定时器 3 或 STI 定时器 通用定时器 3。
地址: 0xFFFF0008
7 未定义 该位未使用。
8 未定义 该位未使用。 默认值: 0x00000000
9 未定义 该位未使用。 访问类型: 读、写
10 ADC ADC 中断源位。
IRQCLR
11 UART UART 中断源位。
12 SPI IRQCLR 是一个只写寄存器,可清除 IRQEN 寄存器的相应
SPI 中断源位。
位,从而屏蔽相应的中断源。将该寄存器的某一位置 1,
13 XIRQ0(GPIO IRQ0) 外部中断 0。
会清除 IRQEN 寄存器的相应位(但不影响其它位)。寄存
14 XIRQ1(GPIO IRQ1) 外部中断 1。
2
器 IRQEN 和 IRQCLR 配对使用,可以实现独立的使能屏
15 I C 主机 IRQ I2C 主机中断源位。
2
蔽功能,而无需执行原子性读-改-写操作。
16 I C 从机 IRQ I2C 从机中断源位。
17 PWM PWM 触发中断源位。
18 XIRQ2(GPIO IRQ2) 外部中断 2。
19 XIRQ3(GPIO IRQ3) 外部中断 3。
IRQSTA FIQEN
IRQSTA 是一个只读寄存器,提供当前使能的 IRQ 源的状 FIQEN 提供了当前使能屏蔽值。当某一位被置 1 时,相应
态(IRQSIG 和 IRQEN 对应位进行逻辑“与”操作)。当置 的中断源就会被使能,并产生一个 FIQ 异常。当某一位被
1 时,这个源将向 ARM7TDMI 内核发出一个有效的 IRQ 清 0 时,相应的中断源就会被禁止或屏蔽,此时将无法产
中断请求。没有优先级编码器和中断矢量产生。该功能可 生 FIQ 异常。FIQEN 寄存器无法用来禁用中断。
以在软件中通过一个普通的中断处理程序实现。
FIQEN 寄存器
IRQSTA 寄存器
名称: FIQEN
名称: IRQSTA 地址: 0xFFFF0108
地址: 0xFFFF0000 默认值: 0x00000000
默认值: 0x00000000 访问类型: 读、写
访问类型: 只读
FIQCLR
快速中断请求(FIQ) FIQCLR 是一个只写寄存器,可清除 FIQEN 寄存器的相应
快速中断请求(FIQ)是进入处理器 FIQ 模式的一个异常 位,从而屏蔽相应的中断源。如将该寄存器的某一位置 1,
信号。它提供一个短延时的服务于数据传输或通信通道的 清除 FIQEN 寄存器的相应位(但不影响其它位)。寄存器
任务。FIQ 接口与 IRQ 接口相同,此外,它还会提供二级 FIQEN 与 FIQCLR 配合使用,可以实现独立的使能屏蔽功
中断(拥有最高优先级)。器件内有 4 个 32 位寄存器专门 能,而无需执行原子性读-改-写操作。
用于 FIQ,包括:FIQSIG、FIQEN、FIQCLR 和 FIQSTA。
FIQCLR 寄存器
FIQSTA 的第 31 至 1 位通过“或”逻辑运算后,产生 FIQ 信
名称: FIQCLR
号。该信号将分别传递给内核以及 FIQ 和 IRQ 寄存器的位
0(FIQ 源)。 地址: 0xFFFF010C
器允许控制可编程源中断。
IRQBASE 寄存器
SWICFG 寄存器
名称: IRQBASE
名称: SWICFG
地址: 0xFFFF0014
地址: 0xFFFF0010
默认值: 0x00000000
默认值: 0x00000000
访问类型: 读、写
访问类型: 只写
表 67. IRQBASE 寄存器位功能描述
表 66. SWICFG 寄存器位功能描述
位 访问类型 初始值 描述
位 描述
31:16 只读 保留 读出的数值始终为 0。
31:3 保留。
15:0 读/写 0 矢量基地址。
2 可编程中断 FIQ。将该位置 1 或清 0,可将 FIQSTA 和
FIQSIG 寄存器的位 1 置 1 或清 0。 IRQVEC
1 可编程中断 IRQ。将该位置 1 或清 0,可将 IRQSTA 和
IRQVEC(IRQ 中断矢量寄存器)指向包含指向一个存储
IRQSIG 寄存器的位 1 置 1 或清 0。
地址,该地址包含当前活动 IRQ 的中断服务程序的指针。
0 保留。
当产生 IRQ 中断, 且已通过设置 IRQCONN 的位 0 启用 IRQ
注意,任何中断信号的有效时间不得少于中断延迟时间, 中断嵌套功能后,该寄存器为只读的。
这样才能保证中断信号能够被中断控制器检测到或者被用
户在 IRQSTA 或 FIQSTA 寄存器中检测到。 IRQVEC 寄存器
名称: IRQVEC
矢量中断控制器(VIC)
地址: 0xFFFF001C
ADuC706x 集成一个增强的中断控制系统或矢量中断控
制器。通过设置 IRQCONN 寄存器的位 0,可以启用针 默认值: 0x00000000
对 IRQ 中 断 源 的 矢 量 中 断 控 制 器 。 同 样 , 通 过 设 置 访问类型: 只读
IRQCONN 寄存器的位 1,可以启用针对 FIQ 中断源的
矢量中断控制器。矢量中断控制器在以下几个方面增强
了标准 IRQ/FIQ 中断:
名称: IRQCLRE 位 名称 描述
31:20 保留 这些位为保留位,不允许向其中写入
地址: 0xFFFF0038
数据。
默认值: 0x00000000 19 IRQ3CLRI 必须在 IRQ3 中断服务程序中在该位
写入 1,以清除边沿触发的 IRQ3 中断。
访问类型: 读、写
18 IRQ2CLRI 必须在 IRQ2 中断服务程序中在该位
置 1,以清除边沿触发的 IRQ2 中断。
17:15 保留 这些位为保留位,不允许向其中写入
数据。
14 IRQ1CLRI 必须在 IRQ1 中断服务程序中在该位
置 1,以清除边沿触发的 IRQ1 中断。
13 IRQ0CLRI 必须在 IRQ0 中断服务程序中在该位
置 1,以清除边沿触发的 IRQ0 中断。
12:0 保留 这些位为保留位,不允许向其中写入
数据。
定时器
ADuC706x 具有 4 个通用定时器/计数器。 表 78.定时器事件捕捉
● 定时器 0 位 描述
● 定时器 1 或唤醒定时器 0 保留
32-BIT LOAD
32.768kHz OSCILLATOR
CORE CLOCK
FREQUENCY/CD PRESCALER 32-BIT 8-BIT
1, 16, 256, OR 32,768 UP/DOWN COUNTER POSTSCALER
CORE CLOCK TIMER0 IRQ
FREQUENCY
GPIO
TIMER0
VALUE
07079-017
IRQ[31:0] CAPTURE
图 23.定时器 0 框图
定时器 0 控制寄存器
名称: T0CON
地址: 0xFFFF0328
默认值: 0x01000000
访问类型: 读、写
功能: 该 32 位寄存器用于设置定时器 0 的工作模式。
11 保留位。
10:9 T0CLKSEL 时钟选择。
[00]=32.768 kHz。
[01]=10.24 MHz/CD。
[10]=10.24 MHz。
[11]=P1.0。
8 T0DIR 递增计数。
用户置 1,定时器 0 递增计数。
用户清 0,定时器 0 递减计数(默认)。
7 T0EN 定时器 0 使能位。
用户置 1,使能定时器 0。
用户清 0,禁用定时器 0(默认)。
6 T0MOD 定时器 0 模式。
用户置 1,选择周期模式。
用户清 0,选择自由模式(默认)。
访问类型: 只读
功能: T1VAL 是一个 32 位寄存器,可用于保存定
时器 1 的当前值。
CORE CLOCK
FREQUENCY/CD PRESCALER 32-BIT
1, 16, 256, OR 32,768 UP/DOWN COUNTER TIMER1 IRQ
CORE
CLOCK
EXTERNAL 32.768kHz
WATCH CRYSTAL
07079-018
TIMER1
VALUE
图 24.定时器 1 框图
定时器 1 控制寄存器
名称: T1CON
地址: 0xFFFF0348
默认值: 0x0000
访问类型: 读、写
功能: 该 16 位寄存器用于设置定时器 1 的工作模式。
状态。一旦看门狗定时器被使能,它需要周期性服务来阻
● T2LD 和 T2VAL 均为 16 位寄存器(位 0 至 15),用
止自身强制处理器执行复位操作。
于保存 16 位无符号整数。T2VAL 为只读寄存器。
当产生定时器 2 溢出时或当执行 T2CLRI 写操作后,定时
● T2CLRI 是一个 8 位寄存器。在正常模式下向这个寄存
器 2 将从 T2LD 载入数值。
器写入任意值,将清除定时器 2 中断;在看门狗模式下
正常模式 向这个寄存器写入任意值,则重新开始一个超时周期。
TIMER2
VALUE
图 25.定时器 2 框图
定时器 3 载入寄存器
定时器 3 控制寄存器
名称: T3LD
名称: T3CON
地址: 0xFFFF0380
地址: 0xFFFF0388
默认值: 0x0000
默认值: 0x00000000
访问类型: 读、写
访问类型: 读、写
功能: T3LD 是一个 16 位寄存器,它保存载入计
功能: 该 32 位寄存器用于设置定时器 3 的工作
数器的 16 位数值。
模式。
定时器 3 清除寄存器
名称: T3CLRI
地址: 0xFFFF038C
访问类型: 只写
功能: 通过用户代码向该 8 位只写寄存器写入任
意值,可以清除中断。
11 保留。
10:9 T3CLKSEL 时钟选择。
[00]=32.768 kHz 振荡器。
[01]=10.24 MHz/CD。
[10]=10.24 MHz。
[11]=保留。
8 T3DIR 递增计数。
用户置 1,可将定时器 3 的计数方式设定为递增计数。
用户清 0,可将定时器 3 的计数方式设定为递减计数(默认)。
7 T3EN 定时器 3 使能位。
用户置 1,可使能定时器 3。
用户清 0,可禁用定时器 3(默认)。
6 T3MOD 定时器 3 工作模式。
用户置 1,选择周期模式。
用户清 0,选择自由模式(默认模式)。
5:4 保留。
3:0 T3SCALE 预分频器。
[0000]=时钟源/1(默认)。
[0100]=时钟源/16。
[1000]=时钟源/256。
[1111]=时钟源/32768。
脉宽调制器
脉宽调制器概述 PWMxCOMx寄存器用于控制在各种模式下改变PWM输出
ADuC706x 集成了一个 6 通道脉宽调制器(PWM)接口。 状态的时间点。第一对PWM输出示例(PWM0 和PWM1)
PWM 输出即可用于驱动 H 桥或也可作为标准 PWM 输出。 如 图 26 所示。
29H
引脚内输出信号。用户既可以控制每一对输出引脚的工作
周期,又可以单独控制每一个输出端的占空比。 LOW SIDE
(PWM1)
07079-020
PWM0COM1 用于比较 PWM 输出 0 和 PWM 输出 1 的比较 PWM0LEN
寄存器 1。
图 26. PWM 时序
PWM0COM2 用于比较 PWM 输出 0 和 PWM 输出 1 的比较
寄存器 2。 通过 PWMCON,可将 PWM 时钟频率设定为以下值之一:
PWM0LEN 用于 PWM 输出 0 和 PWM 输出 1 的频率控制。 UCLK 除以 2/4/8/16/32/64/128/256。PWMxLEN 用于设定
PWM1COM0 用于比较 PWM 输出 2 和 PWM 输出 3 的比较 PWM 周期长度。
寄存器 0。
PWM波形由 16 位定时器的计数值和比较寄存器的内容来
PWM1COM1 用于比较 PWM 输出 2 和 PWM 输出 3 的比较 决定,如 图 26 所示的PWM0 和PWM1 的波形。
寄存器 1。
30H
表 86.比较寄存器
名称 地址 默认值 访问类型
PWM0COM0 0xFFFF0F84 0x0000 读/写
PWM0COM1 0xFFFF0F88 0x0000 读/写
PWM0COM2 0xFFFF0F8C 0x0000 读/写
PWM1COM0 0xFFFF0F94 0x0000 读/写
PWM1COM1 0xFFFF0F98 0x0000 读/写
PWM1COM2 0xFFFF0F9C 0x0000 读/写
PWM2COM0 0xFFFF0FA4 0x0000 读/写
PWM2COM1 0xFFFF0FA8 0x0000 读/写
PWM2COM2 0xFFFF0FAC 0x0000 读/写
UART 串行接口
ADuC706x 集成一个 16450 兼容的 UART。该 UART 是一 利用小数分频器计算波特率的公式如下:
个全双工通用异步接收器/发送器。UART 的作用是对从外 10.24 MHz
波特率 = (2)
设接收的数据字符进行串并转换、对从 ARM7TDMI 处接 ⎛ N ⎞
16 × 2 × DL × ⎜ M + ⎟
收的数据字符进行并串转换。该 UART 有一个小数分频器, ⎝ 2048 ⎠
能够促进高精度波特率的生成且支持网络可寻址模式。
N 10.24 MHz
ADuC706x 的 P1.0/IRQ1/SIN/T0 和 P1.1/SOUT 引脚支持 M+ =
2048 Baud Rate × 16 × 2 × DL
UART 功能。
表 88 列举了几种常见波特率值。
串行通信支持异步协议,支持各种字长、停止位以及奇偶
304H
/16DL UART
07079-021
/(M + N/2048)
图 27.小数分频器波特率生成
COMDIV0 寄存器
名称: COMDIV0
地址: 0xFFFF0700
默认值: 0x00
访问类型: 读、写
名称: COMSTA1 位 名称 描述
COMIEN0 寄存器
UART 中断识别寄存器 0
名称: COMIEN0
COMIID0 寄存器
地址: 0xFFFF0704
名称: COMIID0
默认值: 0x00
地址: 0xFFFF0708
访问类型: 读、写
默认值: 0x01
功能: 该 8 位寄存器用于使能或禁用单独的
UART 中断源。 访问类型: 只读
功能: 该 8 位寄存器用于反映 UART 中断源。
UART 小数分频器寄存器
名称: COMDIV2
地址: 0xFFFF072C
默认值: 0x0000
访问类型: 读、写
GP0CON0=BIT4 + BIT12; // Select SPI/I2C alternative function for P0.1 and P0.3
GP0KEY1=0x7; // Write to GP0KEY1
GP0CON1=BIT1; // Select I2C functionality for P0.1 and P0.3
GP0KEY2=0x13; // Write to GP0KEY2
名称: I2CMSTA
地址: 0xFFFF0904
默认值: 0x0000
访问类型: 只读
功能: 该 16 位寄存器是主机模式下的 I2C 状态寄存器。
行时钟生成”部分。
表 101. 10 位地址模式下的 I2CADR1 寄存器
位 名称 描述 表 102. I2CDIV 寄存器位功能描述
7:0 I2CLADR 在 10 位 寻 址 模 式 下 , 这 些 位 包 含 位 名称 描述
ADDR[7:0]。 15:8 DIVH 这些位用于控制 SCL 高电平周期的持续时间。
I2C 从机寄存器
I2CSCON(I2C 从机控制寄存器)
名称: I2CSCON
地址: 0xFFFF0928
默认值: 0x0000
访问类型: 读、写
功能: 该 16 位寄存器用于在从机模式下配置 I2C
外设。
名称: I2CSSTA
地址: 0xFFFF092C
默认值: 0x0000
访问类型: 读、写
功能: 该 16 位寄存器是从机模式下的 I2C 状态寄存器。
0xFFFF0940=I2CID1
0xFFFF0944=I2CID2
0xFFFF0948=I2CID3
默认值: 0x00
访问类型: 读、写
功能: 通过编程,可在这些 8 位寄存器内编程从机
的I2C总线ID。详情请参见对“I2C总线地址”
308H
部分的说明。
串行外设接口
ADuC706x 片 内 集 成 了 一 个 完 整 的 硬 件 串 行 外 设 接 口 在从机模式下,可对 SPICON 寄存器进行设置,以配置预
(SPI)。SPI 是一个工业标准同步串行接口,允许同时双 期输入时钟的相位和极性。从机可以从外部主机处接收数
向传输 8 位数据(即,全双工),最大比特率可达 5.12 Mbps。 据(速率可达 5.12 Mbps)。
该 SPI 端口可配置为主机或从机操作,一般由 4 个引脚组 在主机或从机模式下,在 SCLK 信号的一个沿启动数据发
成:MISO、MOSI、SCLK 和SS。 送,在该信号的另一个沿启动数据采样。因此,从机时钟
的极性和相位必须与主机的配置一致。
MISO(主机输入,从机输出)引脚
在主模式下,MISO 引脚被配置为输入;在从模式下,配 从机选择(P0.0/SS)输入引脚
置为输出。主机上的 MISO 线路(数据输入)应与从机内 在 SPI 从机模式时,在 P0.0/SS引脚上断言 SS,可启动一
的 MISO 线路(数据输出)相连。传输的数据均为以字节 次数据传输。该引脚为一个低电平有效信号。然后, SPI
宽(8 位)为单位的串行数据,最高有效位最先被传输。 端口开始发送和接收 8 位数据,直到发送结束时为止,此
时SS无效。在从机模式下,SS总是输入。
MOSI(主机输出,从机输入)引脚
在 SPI 主机模式下,SS是低电平有效输出信号。传输开始
在主模式下,MISO 引脚被配置为输出,在从模式下,配
后,它自动断言;传输完成后,它自动无效。
置为输入。主机上的 MOSI 线路(数据输出)应与从机内
的 MOSI 线路(数据输入)相连。传输的数据均为以字节 SPI 功能的外部引脚配置
宽(8 位)为单位的串行数据,最高有效位最先被传输。
ADuC706x 器件的 SPI 引脚由 P0[0:3]引脚实现。
SCLK(串行时钟输入/输出)引脚 ● P0.0/SS:从机片选引脚。在从机模式下,该引脚作为
主机串行时钟(SCL)用于在 MOSI SCLK 周期内同步发 输入引脚,必须通过主机将其驱动为低电平。在主机模
送和接收数据。所以,每隔 8 个 SCLK 周期,芯片发送/ 式下,该引脚为输出引脚。当传输开始后,该引脚的电
接收一个字节。在主机模式下,SCLK 引脚配置成输出, 平为低电平,当传输完成后,该引脚的电平为高电平。
而在从机模式下,配置成输入。 ● P0.1/SCLK/SCL:SCLK 引脚。
GP0CON0=BIT0 + BIT4 + BIT8 + BIT12; //Select SPI/I2C alternative function for P0[0...3]
GP0KEY1=0x7; //Write to GP0KEY1
GP0CON1 &=~ BIT1; //Select SPI functionality for P0.0 to P0.3
GP0KEY2=0x13; //Write to GP0KEY2
SPI 状态寄存器
SPISTA 寄存器
名称: SPISTA
地址: 0xFFFF0A00
默认值: 0x00000000
访问类型: 只读
功能: 该 32 位寄存器用于存储主、从机模式下 SPI 接口的状态。
GPxCON 寄存器的某一位进行写操作,可以启动相应的
所有输入输出引脚的电压均为 3.3V,也就是说,GPIO 支 GPIO引脚的备选功能。
持的输入电压为 3.3 V。
端口 引脚名称 00 01
GPxCON 寄存器
GPxCON是端口x(x为:0、1、2)的控制寄存器,它可以决定端口x中每一个引脚的功能。引脚功能如 表 110 所示。 310H
硬件设计考虑
DIGITAL ANALOG
电源 SUPPLY
BEAD
SUPPLY
+
– 10µF 10µF
ADuC706x工作电压范围为 2.375 V至 2.625 V。模拟电源引
ADuC7060/
脚和数字电源引脚(分别对应AVDD和DVDD)是分离的, ADuC7061
AVDD
因此,AVDD不受系统DVDD线路上经常出现的干扰数字 DVDD
0.1µF
信号的影响。在这种模式下,器件可以在分离电源下工作;
0.1µF
也就是说,各个电源的电压可以是不同的。例如,系统的
AGND
DVDD工作电压为 2.6 V,而AVDD电压为 2.5 V;反之亦
然。图 28 是一个典型的分离电源配置。
07079-023
31H
DGND
注意:无论在任何时候,ADuC706x 的模拟和数字接地引
图 28.外部双电源连接 脚必须以同一系统接地基准点为基准。
外形尺寸
5.00 0.60 MAX
BSC SQ 0.60 MAX PIN 1
INDICATOR
25 32
1
24
PIN 1
INDICATOR 0.50
TOP BSC EXPOSED 3.65
4.75
VIEW BSC SQ PAD 3.50 SQ
(BOTTOM VIEW)
3.35
0.50
0.40 17 8
16 9
0.30
0.25 MIN
0.80 MAX
12° MAX 3.50 REF
0.65 TYP
100608-A
COMPLIANT TO JEDEC STANDARDS MO-220-VHHD-2
图 30. 32 引脚 LFCSP_VQ 封装
5 mm×5 mm,超薄体
(CP-32-4)
尺寸单位:mm
0.30
7.00 0.60 MAX 0.23
BSC SQ
0.60 MAX 0.18
PIN 1
INDICATOR
37 48
36 1
PIN 1
INDICATOR
0.50
0.40 25 12
24 13
0.30
0.25 MIN
5.50
0.80 MAX REF
1.00 12° MAX 0.65 TYP
0.85 FOR PROPER CONNECTION OF
0.05 MAX THE EXPOSED PAD, REFER TO
0.80
0.02 NOM THE PIN CONFIGURATION AND
COPLANARITY FUNCTION DESCRIPTIONS
0.50 BSC SECTION OF THIS DATA SHEET.
0.20 REF 0.08
SEATING
PLANE
042809-A
9.20
0.75 9.00 SQ
1.60
0.60 MAX 8.80
0.45 48 37
1 36
PIN 1
7.20
1.45 TOP VIEW 7.00 SQ
0.20 (PINS DOWN) 6.80
1.40
0.09
1.35
7°
3.5° 12 25
0.15 0° 13 24
0.05 SEATING 0.08
PLANE VIEW A 0.50
0.27
COPLANARITY
BSC 0.22
LEAD PITCH 0.17
VIEW A
ROTATED 90° CCW
051706-A
COMPLIANT TO JEDEC STANDARDS MS-026-BBC
图 32. 48 引脚 LQFP 封装
(ST-48)
尺寸单位:mm
订购指南
1
型号 38F 温度范围 封装描述 封装选项 订购数量
ADuC7060BCPZ32 -40℃至+125℃ 48 引脚 LFCSP_VQ CP-48-3
ADuC7060BCPZ32-RL -40℃至+125℃ 48 引脚 LFCSP_VQ CP-48-3 2,500
ADuC7060BSTZ32 -40℃至+125℃ 48 引脚 LQFP ST-48
ADuC7060BSTZ32-RL ST-48 2,000
-40℃至+125℃ 48 引脚 LQFP
ADuC7061BCPZ32 -40℃至+125℃ 32 引脚 LFCSP_VQ CP-32-4
ADuC7061BCPZ32-RL -40℃至+125℃ 32 引脚 LFCSP_VQ CP-32-4 5,000
EVAL-ADuC7060QSPZ ADuC7060 Quick Start Plus 开发系统
EVAL-ADuC7061MKZ ADuC7061 Quick Start 评估系统
1
Z = 符合RoHS标准的兼容器件。
注释
注释
注释