Professional Documents
Culture Documents
I Dp
2
k p' W L p VGS Vtp
1 2
בתחום הרוויה עבור VDSVGS-Vt :PMOS
1 2
I Dn k n' W L n VGS Vtn V DS V DS בתחום הטריודי עבור VDSVGS-Vt :NMOS
2
I Dp
1 2
k p' W L p VGS Vtp V DS V DS
בתחום הטריודי עבור VDSVGS-Vt :PMOS
2
- Vtמתח הסף.
C V DD
2
PDynamic f C C V DD
2
:פיזור הספק דינאמי בשער
TC
.PDP=PDtP [joules] :)PDP – Power Delay Product( פרמטר יעילות משפחה של שערים
. כאשר לפחות אחד מפיזורי ההספק קייםPD=PStatic + PDynamic כאשר
NM L V IL VOL
1
3VDD 2Vt NM H VOH V IH
1
3VDD 2Vt
8 8
t P min ( N ) N t p 0 1 N F
2
כניסות: דיאגראמת בלוקים של שער CMOSמורכב מרובה
מתחי המוצא של שער CMOSהם:
VOL=VSS VOH=VDD
nCox W L n K n
r הגדרת היחס :r
pCox W L p K p
כאשר המונה מתאר את הגודל השקול של רשת ה PDN
שהוא בדרך כלל שקול לזה של טרנזיסטור NMOSבודד.
המכנה מתאר את הגודל של ה PMOSהבודד הנמצא במעגל.
3
:VTC חישוב מתחים בעקומת ה
VDD Vt 1
VOH VDD VM Vt VOL VDD Vt 1 1
r 1 r
2
NM H VDD Vt 1 NM L Vt VDD Vt 1 1
1 1
3r r r r 1
1.7C 1.7C
t PLH t PHL
0.46
k pVDD k n 1 VDD
r
G g1 g2 g N F f1 f 2 f N C L H G F h N FG N H
C g,1
N N
H N h
t P t p 0 p j t p0 p j N
:השהייה של שרשרת שערים
j 1 j 1
g1s1 i 1
si
gi
f
j 1
j i 1 :Sizing הגדלים של הטרנזיסטורים
Gate Type p
g (for 1 to n input gates)
Gate Type
Inverter 1 1 2 3 n
Inverter 1 - - -
n-input NAND n
NAND 4/3 5/3 (n+2)/3
n-input NOR n
NOR 5/3 7/3 (2n+1)/3
נחוץ לחישוב ההשהיה הכוללתp
4
Latches and FF
C1 C 2 C
v (t ) VDD v (0) e t כאשר C Gm : משוואת המתחים במצב מטא סטבילי:
o
2
et
MTBF (t r ) מנוסחת :MTBF
T0 f clk a
– aמספר השינויים בשנייה של האות הלא מסונכרן הנדגם ע"י ה .FFלפעמים כותבים .fd
משפט הדפקים
v(t ) V f (V f Vi )e t
v(t ) V (V Vi )et
) – V(tהמתח על הקבל ברגע tכלשהו.
הזמן Tלטעינה או פריקה של קבל במעגל RCכאשר =RCממתח Viועד מתח מסוים :Vt
V f Vi
T ln
V V
f t
זכרונות
C B V
t חישוב הזמן לפריקת הקבל במתח Vעבור זרם I5הזורם ב :Q5
I5
נוסחה סופית לחישוב הזרם הממוצע ב SRAM -בעת קריאת תוכן התא בצד ה:'0' -
I 5 I1 k n' W L 1 VDD Vt VQ 0.5 VQ2 4.75 k n' W L 1
5
CSVCS CBVPr echarge CS CB VPr echarge V :DRAM חוק שימור המטען בזיכרון
2N
N code Vin : ללא הזזה של חצי סיביתADC קידוד של
FS
2N
N code roundVin : עם הזזה של חצי סיביתADC קידוד של
FS
FS 1
r.m.s.(Q.N .) N :רעש הקוונטיזציה
2 12
1
S Va2 :Va הספק אות סינוס בכניסה באמפליטודה
2
1
S FS 2 :)Va=FS/2( הספק אות סינוס בכניסה באמפליטודה מקסימלית
8
SINAD 1.761
ENOB :ENOB=Effective # of Bits
6.02
v v
T2 T1 A N N REF A :Dual-Slope ADC שנקבל בN הקוד
VREF VREF
6
:PLL חוג נעול מופע -
7